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cadence? 文章 進(jìn)入cadence?技術(shù)社區
海思半導體采用CADENCE混合信號和低功耗技術(shù)
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司，今日宣布海思半導體有限公司已在其高級無(wú)線(xiàn)與網(wǎng)絡(luò )芯片設計方面與Cadence加強合作。海思已經(jīng)將其Cadence Encounter Digital Implementation System、Encounter Power System和Virtuoso 定制設計技術(shù)擴展應用于其先進(jìn)技術(shù)節點(diǎn)上的低功耗與混合信號流程。海思也采用了Cadence Encounter Conformal ECO Designer應用于其工程變更單流程，幫助設計
- 關(guān)鍵字： Cadence 混合信號
芯邦采用Cadence Incisive Xtreme III系統提升SoC驗證實(shí)效
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司今天宣布，位于中國深圳的、無(wú)晶圓廠(chǎng)集成電路設計領(lǐng)先企業(yè)芯邦科技股份有限公司已采用Cadence Incisive Xtreme III系統來(lái)加速其RTL設計流程，并為下一代數字消費和網(wǎng)絡(luò )芯片提供了一個(gè)驗證流程。 芯邦是一家領(lǐng)先的芯片供應商，其芯片的目標應用領(lǐng)域有數字音視頻處理、移動(dòng)存儲、網(wǎng)絡(luò )通信和消費電子等。 Cadence Incisive Xtreme III 系統以及Incisive Enterprise Simulator的部署，使芯邦的
- 關(guān)鍵字： Cadence IC設計 Xtreme
中芯國際采用 Cadence DFM解決方案
- 今天宣布，中芯國際集成電路制造有限公司采用了 Cadence(R) Litho Physical Analyzer 與 Cadence Litho Electrical Analyzer，從而能夠更準確地預測壓力和光刻差異對65和45納米半導體設計性能的影響。Cadence Litho Electrical Analyzer -- 半導體行業(yè)第一個(gè)用于各大領(lǐng)先半導體公司從90到40納米生產(chǎn)中的DFM電氣解決方案 -- 與 Cadence Litho Physical Analyzer 結合，形成了一個(gè)
- 關(guān)鍵字： 中芯國際 65納米 45納米 Cadence
Cadence推出IEV 帶來(lái)形式分析與仿真引擎雙重動(dòng)力
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司今天在CDNLive! Silicon Valley上推出了Cadence Incisive Enterprise Verifier (IEV)。它是一個(gè)整合式驗證解決方案，可通過(guò)形式分析和仿真引擎的雙重作用，帶來(lái)獨特和全新的功能。 IEV可幫助設計和驗證工程師發(fā)現深藏的邊角情形(corner-case)bug，能測試到單獨使用形式或仿真引擎漏掉的隱蔽的覆蓋點(diǎn)。 IEV通過(guò)更快建立設計和更快發(fā)現bug，可提高生產(chǎn)效率;通過(guò)產(chǎn)生更多指標提高可預測性，可促
- 關(guān)鍵字： Cadence 仿真 IEV
華虹設計采用多種Cadence解決方案用于高級半導體設計
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司宣布中國領(lǐng)先的無(wú)工廠(chǎng)半導體公司上海華虹集成電路有限責任公司(以下簡(jiǎn)稱(chēng)華虹設計)已經(jīng)采用多種Cadence解決方案及服務(wù)，為中國快速發(fā)展的電子市場(chǎng)設計高級芯片。華虹設計之所以采用Cadence的技術(shù)，是看中其技術(shù)實(shí)力，包括可制造性設計(DFM)的低功耗與模擬/射頻產(chǎn)品，以及Cadence的技術(shù)支持服務(wù)的優(yōu)勢。 華虹設計目前已經(jīng)獲得Cadence多種產(chǎn)品與解決方案的使用權，包括Cadence Incisive 功能驗證、Encounter 數字IC設
- 關(guān)鍵字： 華虹 Cadence Virtuoso
Cadence低功耗解決方案納入PowerMagic低功耗設計方法中
- 全球電子設計創(chuàng )新領(lǐng)導廠(chǎng)商Cadence益華電腦今天宣布，創(chuàng )意電子(Global Unichip Corporation，GUC)將以CPF為基礎的Cadence低功耗解決方案，整合至其PowerMagic設計方法中，協(xié)助客戶(hù)將復雜的低功耗ASIC設計實(shí)現最佳化。 創(chuàng )意電子在PowerMagicTM設計方法，針對ASIC設計驗證與實(shí)現，整合Cadence®低功耗解決方案 (包括Cadence Encounter® RTL Compiler、Encounter 數位設計實(shí)現系統(ED
- 關(guān)鍵字： Cadence PowerMagic 低功耗 EDI
Cadence與TSMC推出65納米混合信號/射頻參考設計
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(Nasdaq: CDNS)與全球最大的專(zhuān)業(yè)積體電路制造服務(wù)公司-臺灣積體電路制造股份有限公司(TWSE: 2330 , NYSE: TSM) (以下簡(jiǎn)稱(chēng)臺積公司)今日共同宣布推出業(yè)界第一款的混合信號/射頻參考設計”錦囊”(MS/RF RDK)。這款錦囊采用Cadence? Virtuoso?混合信號技術(shù)研發(fā)完成，可提供矽芯片特性行為模型(silicon-characterized behavioral mode
- 關(guān)鍵字： Cadence 納米 混合信號
Cadence擴大在中國的渠道伙伴網(wǎng)絡(luò )
- 全球設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司今天宣布上海東好科技發(fā)展有限公司(東好科技)已正式加盟Cadence®渠道伙伴計劃，成為一家增值代理商(VAR)。這一合作讓專(zhuān)注于中國EDA軟件先進(jìn)技術(shù)與服務(wù)的東好科技能夠為國內設計師提供更豐富的途徑使用Cadence Allegro® PCB與IC封裝工具和技術(shù)。東好科技加入渠道伙伴計劃后，Cadence擴大了滿(mǎn)足中國本地設計團隊客戶(hù)需求的能力，并加強了其對全球客戶(hù)提供支持的承諾。 “我們很自豪也很興奮能夠成為Caden
- 關(guān)鍵字： Cadence 集成電路
Cadence與NEC電子宣布開(kāi)發(fā)出V850的System LSI原型
- Cadence設計系統公司和NEC電子公司，宣布開(kāi)發(fā)出NEC電子公司基于業(yè)界最先進(jìn)水平的V850™的System LSI的原型。它是在Cadence最新的Encounter數字實(shí)現系統(Encounter Digital Implementation System)8.1版本的支持下實(shí)現的。 NEC電子開(kāi)發(fā)出其LSI下一代的CPU核，成功地降低了50%的設計周期(TAT)，同時(shí)在整個(gè)設計流程后端包含了完全的全多模多角分析和優(yōu)化。 自1996年4月推出第一款帶V850核心的單芯片微控制
- 關(guān)鍵字： Cadence LSI NEC
Cadence 端對端解決方案助華亞微實(shí)現一次性芯片成功
- 【中國上海，2009年3月23日】- 全球設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(NASDAQ: CDNS)，今天宣布世界級數字電視與視頻處理解決方案系統級芯片IC供應商華亞微電子有限公司 ( 華亞微 )已經(jīng)實(shí)現一次性芯片成功，目前已經(jīng)將一個(gè)面向液晶電視市場(chǎng)的0.162微米系統級芯片設計投入量產(chǎn)，實(shí)現了超過(guò)10%的尺寸縮減程度。 華亞微在選擇了Cadence作為其首要的EDA供應商，并采用Cadence端到端企業(yè)解決方案后實(shí)現了此次成功，為高清電視、機頂盒和多媒體市場(chǎng)提供高性能芯片。該公
- 關(guān)鍵字： Cadence Encounter Incisive Virtuoso
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歡迎您創(chuàng )建該詞條，闡述對cadence?的理解，并與今后在此搜索cadence?的朋友們分享。 創(chuàng )建詞條
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