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Cadence 推出開(kāi)拓性的 Virtuoso Studio

  • ·       這是一個(gè)業(yè)界用于打造差異化定制芯片的領(lǐng)先平臺,可借助生成式 AI 技術(shù)顯著(zhù)提升設計生產(chǎn)力;·       Virtuoso Studio 與 Cadence 最前沿的技術(shù)和最新的底層架構集成,助力設計工程師在半導體和 3D-IC 設計方面取得新突破;·       依托 30 年來(lái)在全線(xiàn)工藝技術(shù)方面取得的行業(yè)領(lǐng)先
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Cadence Virtuoso定制IC設計平臺助力WillSemi提升模擬IC設計的穩健性和交付速度

  •   楷登電子(美國Cadence公司)今日宣布,WillSemi采用Cadenceò Virtuosoò 定制集成電路設計平臺,增強了模擬集成電路設計的可靠性,并縮短了產(chǎn)品的總體上市時(shí)間。較此前部署的行業(yè)解決方案,WillSemi采用Cadence定制集成電路設計流程不僅將模擬設計和實(shí)現時(shí)間減半,總設計周期時(shí)間也縮短了三分之一?! adence定制設計流程工具幫助WillSemi集成電路設計團隊實(shí)現了如下目標:  · 采用Virtuoso電路原理圖編輯器與Virtuoso版
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全新Cadence Virtuoso系統設計平臺幫助實(shí)現IC、封裝和電路板無(wú)縫集成的設計流程

  •   楷登電子(美國Cadence公司)今日發(fā)布全新Cadence? Virtuoso? System Design Platform(Virtuoso系統設計平臺),結合Cadence Virtuoso平臺與Allegro? 及Sigrity?技術(shù),打造一個(gè)正式的、優(yōu)化的自動(dòng)協(xié)同設計與驗證流程。多項跨平臺技術(shù)的高度集成幫助設計工程師實(shí)現芯片、封裝和電路板的同步和協(xié)同設計。這一過(guò)程在此之前只能通過(guò)手動(dòng)完成,全新Virtuoso系統設計平臺可以實(shí)現流
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Cadence發(fā)布7納米工藝Virtuoso先進(jìn)工藝節點(diǎn)擴展平臺

  •   楷登電子(美國Cadence公司)今日正式發(fā)布針對7nm工藝的全新Virtuoso® 先進(jìn)工藝節點(diǎn)平臺。通過(guò)與采用7nm FinFET工藝的早期客戶(hù)展開(kāi)緊密合作,Cadence成功完成了Virtuoso定制設計平臺的功能拓展,新平臺能幫助客戶(hù)管理由于先進(jìn)工藝所導致的更復雜的設計以及特殊的工藝效應。新版Virtuoso先進(jìn)工藝平臺同樣支持所有主流FinFET先進(jìn)節點(diǎn),性能已得到充分認證;同時(shí)提高了7nm工藝的設計效率。   為了應對7nm設計的眾多技術(shù)挑戰,Virtuoso先進(jìn)工藝平臺提供豐富
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Cadence物理驗證系統通過(guò)FinFET制程認證

  •   重點(diǎn):  ·?認證確保精確性方面不受影響,并包含用于65納米至14納米FinFET制程的物理驗證簽收的先進(jìn)技術(shù)  ·?雙方共同的客戶(hù)可通過(guò)它與Cadence?Virtuoso及Encounter平臺的無(wú)縫集成進(jìn)行版圖設計和驗證版圖  全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司今天宣布Cadence??Physical?Verification?System?(PVS)通過(guò)了GLOBALFOUNDRIES的認證,可用于65納米
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Cadence采用全新可支持電學(xué)感知設計的Virtuoso版圖套件

  • 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(NASDAQ:CDNS) 日前宣布推出用于實(shí)現電學(xué)感知設計的Virtuoso?版圖套件,它是一種開(kāi)創(chuàng )性的定制設計方法,能提高設計團隊的設計生產(chǎn)力和定制IC的電路性能。
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臺積電TSMC擴大與Cadence在Virtuoso定制設計平臺的合作

  • 為專(zhuān)注于解決先進(jìn)節點(diǎn)設計的日益復雜性,全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(NASDAQ:CDNS) 日前宣布,臺積電已與Cadence在Virtuoso定制和模擬設計平臺擴大合作以設計和驗證其尖端IP。
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Cadence的Virtuoso平臺的高級定制化設計介紹

  • 大型多領(lǐng)域模擬混合信號(AMS)系統在電子行業(yè)中越來(lái)越常見(jiàn),此類(lèi)設計必須同時(shí)滿(mǎn)足進(jìn)度和準確度要求,從而給設計工程師帶來(lái)了極大的挑戰。本文介紹了一種結合自上而下和自下而上的方法來(lái)實(shí)現 “中間相遇”,
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國民技術(shù)選擇Cadence作為先進(jìn)工藝系統SOC設計的優(yōu)選供應商

  •   全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司今天宣布,中國領(lǐng)先的無(wú)工廠(chǎng)IC設計企業(yè)國民技術(shù)股份有限公司在對Cadence® Virtuoso®、Encounter®、以及系統級封裝(SiP)技術(shù)進(jìn)行了縝密的評估后,認為Cadence技術(shù)和方法學(xué)的強大組合,可幫助國民技術(shù)更好地實(shí)現在先進(jìn)工藝條件下,復雜的系統級SOC的高品質(zhì)設計。寄予這樣的評估國民技術(shù)選擇Cadence公司作為公司設計的EDA優(yōu)選供應商,應用其EDA軟件開(kāi)發(fā)安全、通信電子市場(chǎng)尖端的系統級芯片(SoC)。 國
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華虹設計采用多種Cadence解決方案用于高級半導體設計

  •   全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司宣布中國領(lǐng)先的無(wú)工廠(chǎng)半導體公司上海華虹集成電路有限責任公司(以下簡(jiǎn)稱(chēng)華虹設計)已經(jīng)采用多種Cadence解決方案及服務(wù),為中國快速發(fā)展的電子市場(chǎng)設計高級芯片。華虹設計之所以采用Cadence的技術(shù),是看中其技術(shù)實(shí)力,包括可制造性設計(DFM)的低功耗與模擬/射頻產(chǎn)品,以及Cadence的技術(shù)支持服務(wù)的優(yōu)勢。   華虹設計目前已經(jīng)獲得Cadence多種產(chǎn)品與解決方案的使用權,包括Cadence Incisive 功能驗證、Encounter 數字IC設
  • 關(guān)鍵字: 華虹  Cadence  Virtuoso  

Cadence 端對端解決方案助華亞微實(shí)現一次性芯片成功

  •   【中國上海,2009年3月23日】- 全球設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(NASDAQ: CDNS),今天宣布世界級數字電視與視頻處理解決方案系統級芯片IC供應商華亞微電子有限公司 ( 華亞微 )已經(jīng)實(shí)現一次性芯片成功,目前已經(jīng)將一個(gè)面向液晶電視市場(chǎng)的0.162微米系統級芯片設計投入量產(chǎn),實(shí)現了超過(guò)10%的尺寸縮減程度。   華亞微在選擇了Cadence作為其首要的EDA供應商,并采用Cadence端到端企業(yè)解決方案后實(shí)現了此次成功,為高清電視、機頂盒和多媒體市場(chǎng)提供高性能芯片。該公
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Cadence強化的高級節點(diǎn)設計解決方案對定制IC設計實(shí)現經(jīng)過(guò)實(shí)際生產(chǎn)驗證的改良

  •   全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(納斯達克: CDNS),今天公布了一系列新的定制IC設計功能,幫助芯片制造商加快大型復雜設計的量產(chǎn)化,尤其是在65納米及以下的高級節點(diǎn)工藝。這些經(jīng)過(guò)實(shí)際生產(chǎn)證明對Virtuoso?技術(shù)的提升,進(jìn)一步強化了Cadence用于降低風(fēng)險和提升生產(chǎn)力的同時(shí)管理幾何尺寸與復雜性的全套解決方案。   對Virtuoso? 定制設計平臺的主要改進(jìn)將會(huì )出現在最新版本中,提供更為緊密的可生產(chǎn)性整合、更好的寄生分析,更快的仿真工具,用于精確而高效地驗證
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Cadence新技術(shù)加速模擬和混合信號驗證

  •   全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司(納斯達克: CDNS),今天宣布Cadence®Virtuoso® Spectre® Circuit Simulator中的高級“turbo”技術(shù)目前已經(jīng)推出,這是業(yè)界領(lǐng)先的模擬SPICE電路仿真器,獲得了全面的晶圓廠(chǎng)支持。這種turbo技術(shù)能夠在提升性能的同時(shí),確保硅片的精確性,讓設計師能夠驗證他們復雜的大型模擬設計,例如PLL(phase-locked loops)、ADC(analog-to-di
  • 關(guān)鍵字: Cadence  turbo  Cadence?Virtuoso? Spectre? Circuit Simulator  

基于Virtuoso平臺的單片射頻收發(fā)系統電路設計

  • 本文基于對Cadance Virtuoso 平臺的研究,結合單片射頻收發(fā)芯片的設計實(shí)踐,討論了利用Virtuoso 完成的自頂向下、從系統到模塊、從前端到后端的整個(gè)設計流程,最終實(shí)現了一個(gè)完整的射頻芯片。
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