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CADENCE為PALLADIUM加速/仿真系統開(kāi)發(fā)出先進(jìn)的驗證環(huán)境

  • Cadence設計系統公司推出一種新型的高性能驗證環(huán)境,該驗證環(huán)境是針對Cadence Incisive Palladium加速/仿真系統而設計的,其功能包括增強的、基于事務(wù)的驗證加速(TBA);帶IP的SpeedBridge驗證解決方案;與嵌入式軟件調試器的進(jìn)一步整合;附加對多語(yǔ)言和多標準的支持等。上述環(huán)境功能大大提高了第一軟件和第一芯片設計成功的可能性。www.cadence.com
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Cadence 推出新的OrCAD 技術(shù)以縮短PCB設計周期

  • Cadence公司宣布,其專(zhuān)為OrCAD產(chǎn)品線(xiàn)設計的、基于PSpice的新仿真技術(shù)—PSpice Enhancements 實(shí)現了模擬仿真與MathWork的MATLAB之間高水平的整合,其中Smoke工具標出了諸如功耗、二次崩潰限制、電流/電壓以及結溫限制等違規之處。借助PSpice Smoke選項,設計師們可進(jìn)行電應力分析以驗證電子元件運行時(shí)是否滿(mǎn)足制造商們的“安全操作限制或降額限制”,從而可有效縮短電力電子、軍事/航天以及自動(dòng)化等領(lǐng)域的PCB設計周期。www.cadence.com
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Cadence 公司董事會(huì )主席Ray Bingham先生來(lái)華推動(dòng)國內IC設計

  • Cadence 設計系統公司董事會(huì )主席Ray Bingham先生一行近期到北京集成電路設計園訪(fǎng)問(wèn),  并表示將進(jìn)一步加強支持與合作,繼續提供技術(shù)和服務(wù), 幫助北京集成電路設計園成為北京IC企業(yè)面向全國以至世界的窗口。同時(shí), Ray Bingham先生還對清華大學(xué)進(jìn)行了參觀(guān)訪(fǎng)問(wèn),清華副校長(cháng)龔克先生與Ray Bingham先生以及同來(lái)的Cadence高級副總裁兼亞太區總裁詹崇新先生、中國區總裁鄧偉安先生進(jìn)行了會(huì )談,雙方對在通訊、計算機、微電子等領(lǐng)域的多年成功合作進(jìn)行了交流。www.cadence.c
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Cadence公司加強與Coware公司合作

  • 近期Cadence2004年度CPU和SoC設計和驗證技術(shù)北京研討會(huì )在中關(guān)村Cadence軟件技術(shù)學(xué)院圓滿(mǎn)舉行。本次研討會(huì )繼續了Cadence和系統層級EDA軟件工具及服務(wù)方面的領(lǐng)導性供貨商CoWare公司的合作。會(huì )上Cadence全球副總裁Michael Chang做了Cadence公司在CPU/DSP等處理器設計和驗證方面解決方案的主題演講。CoWare公司專(zhuān)家則介紹了最前沿的CPU、SoC以及DSP設計技術(shù)信息以及公司的最新動(dòng)向。www.cadence.com
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Cadence公司加強與Coware公司合作

  • 近期Cadence2004年度CPU和SoC設計和驗證技術(shù)北京研討會(huì )在中關(guān)村Cadence軟件技術(shù)學(xué)院圓滿(mǎn)舉行。本次研討會(huì )繼續了Cadence和系統層級EDA軟件工具及服務(wù)方面的領(lǐng)導性供貨商CoWare公司的合作。會(huì )上Cadence全球副總裁Michael Chang做了Cadence公司在CPU/DSP等處理器設計和驗證方面解決方案的主題演講。CoWare公司專(zhuān)家則介紹了最前沿的CPU、SoC以及DSP設計技術(shù)信息以及公司的最新動(dòng)向。www.cadence.com
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Cadence和MIPS合作瞄準32位核心芯片

  • Cadence公司和MIPS公司宣布為 MIPS32 24K芯片的用戶(hù)提供優(yōu)化的MIPS-Cadence Encounter 參考方法。這種經(jīng)過(guò)優(yōu)化的數字IC設計平臺將SoC Encounter RTL-to-GDSII和Encounter RTL Compiler 綜合器相結合,支持0.13mm級的芯片設計。www.mips.com
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摩托羅拉采用Cadence Encounter數字IC設計平臺實(shí)現90nm無(wú)線(xiàn)信號處理器

  • Cadence公司宣布摩托羅拉公司通過(guò)使用Cadence Encounter數字IC設計平臺,成功地用90nm硅片技術(shù)實(shí)現一無(wú)線(xiàn)基帶芯片。Cadence IC應用系統從一個(gè)硅虛擬原型開(kāi)始,直至最終布線(xiàn)。通過(guò)在芯片設計的最初階段產(chǎn)生一個(gè)設計的準確物理原型,幫助設計師們大大提高整個(gè)設計過(guò)程中的可預測性。www.cadence.com
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廣晟微電子使用Cadence Virtuoso平臺實(shí)現10Gbps光傳送IC設計的商業(yè)化

  • Cadence設計系統公司和廣晟微電子公司共同宣布,廣晟已經(jīng)通過(guò)Cadence Virtuoso全定制平臺成功開(kāi)發(fā)出第一代10Gbps高速光傳輸IC。接下來(lái)雙方將共同完成用于GPS、GSM、CDMA以及WLAN應用的前端收發(fā)器集成電路,以及40Gbps高速光傳輸集成電路芯片組等其他項目。www.cadence.com
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Cadence和ARM發(fā)布最新參考方法

  • Cadence與ARM公司宣布他們最新升級的ARM-Cadence Encounter參考方法問(wèn)世,該方法目前結合了Encounter RTL Compiler綜合工具,基于 Cadence_ Encounter 數字IC平臺,為ARM的合作伙伴們提供了完整的、以布線(xiàn)為中心的RTL-to-GDSII的實(shí)現方法。www.cadence.com
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Cadence將支持基于A(yíng)MD64處理器的64位Linux計算平臺

  • Cadence Design Systems公司宣布將在運行64位Linux、基于A(yíng)MD64處理器的系統之上推出Cadence Encounter數字IC設計平臺的主要產(chǎn)品。為了滿(mǎn)足用戶(hù)需求,這種舉措將提供實(shí)現復雜SoC設計所需要的更高容量和高性能。另外,這也是該公司戰略的一部分,旨在提供豐富的產(chǎn)品選擇及操作系統,以滿(mǎn)足用戶(hù)的設計需求。www.cadence.com
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以系統為中心的全層次納米級SoC設計方法學(xué)

  • 引言2003年SoC的收入達到了310億美元,隨著(zhù)通信行業(yè)及個(gè)人電子設備市場(chǎng)的快速發(fā)展,這一數字有望在2008年再翻上一番。其主要應用領(lǐng)域包括:數字蜂窩式移動(dòng)電話(huà)及基礎設施、存儲設備、視頻游戲機、消費類(lèi)顯示設備、圖形卡、數字電視、個(gè)人電腦用主板、寬帶接入設備以及DVD等。個(gè)人電子設備需求的持續上升表示SoC設計正發(fā)展到一個(gè)轉折點(diǎn),因為此類(lèi)系統的產(chǎn)品壽命一般都不會(huì )超過(guò)一年,而新產(chǎn)品的問(wèn)世周期為兩年。研究表明,一項高科技新產(chǎn)品只要延遲上市6個(gè)月,其生命周期內的收入就要減少大概30%。而且,近年來(lái)這種商業(yè)影響有
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華為采用Cadence Incisive驗證平臺

  •  Cadence公司宣布,華為技術(shù)有限公司為了開(kāi)發(fā)其新一代電信設備,已經(jīng)在SystemC和多語(yǔ)言方式下廣泛評估了Cadence的Incisive平臺和其他驗證產(chǎn)品。并已決定采用Cadence Incisive功能驗證平臺作為其納米級IC的主要驗證平臺。www.cadence.com
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CADENCE與中國教育部簽訂合作備忘錄

  • Cadence Design Systems與中華人民共和國教育部簽訂合作備忘錄,發(fā)展中國第一個(gè)國家IC設計培訓計劃。該計劃最初主要集中在中國9所頂級大學(xué)。除了幫助大學(xué)開(kāi)發(fā)課程內容外,該公司還提供先進(jìn)的IC設計和EDA課程,以及實(shí)驗課程,從基礎概念到實(shí)施全部自動(dòng)化電子設計解決方案,覆蓋整個(gè)IC設計周期。此外,Cadence還將在中國和海外提供培訓教授的課程, 讓大學(xué)教授能夠開(kāi)發(fā)、講授先進(jìn)的課程,并獲得海外實(shí)習的機會(huì )。www.cadence.com
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準時(shí)性——高級定制設計的要求

  • 在過(guò)去10年間,對從事模擬、定制數字、RF和混合信號設計的公司需求呈現出了指數增長(cháng)。效益以及競爭正迫使定制設計隊伍采納先進(jìn)工藝技術(shù),把以前各自獨立的IC功能塊集成到單個(gè)硅片中。事實(shí)上,許多設計隊伍被迫跳過(guò)工藝節點(diǎn),在0.18mm、0.13mm、甚至納米工藝上進(jìn)行大規模數字邏輯集成。先進(jìn)的混合信號設計包括超過(guò)10萬(wàn)個(gè)模擬晶體管和超過(guò)上億個(gè)數字晶體管(包括內存)。而且,其封裝、電源網(wǎng)絡(luò )、互連、器件和襯底都要面對數量巨大且還在不斷增長(cháng)的物理效應。如果不解決這些問(wèn)題,上述任何一種因素都會(huì )造成昂貴的重復流片。所有這
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通過(guò)合并Verisity公司Cadence驗證解決方案和專(zhuān)業(yè)技能得到加強

  • 世界領(lǐng)先的電子設計解決方案提供者Cadence設計系統公司正式簽署協(xié)議,將Verisity公司(納斯達克代碼:VRST)納入自己旗下。Verisity公司位于加利福尼亞州山景城(Mountain View),是一家驗證流程自動(dòng)化(VPA)軟件供應商。合并工作完成后,Verisity公司CEO Moshe Gavrielov將加入Cadence公司的管理團隊,同時(shí)該公司創(chuàng )始人和CTO Yoav Hollander則全權負責指導公司驗證技術(shù)研究開(kāi)發(fā)工作。Cadence公司總裁兼首席執行官Mike Fister
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