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asic ip核 文章 進(jìn)入asic ip核技術(shù)社區
Nufront第三代處理器采用Cadence接口IP解決方案
- 全球電子設計創(chuàng )新領(lǐng)先企業(yè)Cadence設計系統公司 (NASDAQ: CDNS)，日前宣布Nufront(新岸線(xiàn))的NS115芯片組采用了Cadence可配置的DDR3/3L/LPDDR2存儲控制器與硬化PHY IP核，應用于其雙核ARM Cortex –A9移動(dòng)應用處理器。TSMC 40LP工藝， 32位DDR3/LPDDR2接口的數據傳輸速率最高可達800Mbps，并能提供對超薄筆記本、平板電腦和智能手機等產(chǎn)品至關(guān)重要的基于數據流量的自動(dòng)功耗管理。 Cadence 的DDR3/3L/LPDDR2 IP
- 關(guān)鍵字： Cadence DDR2 IP核
Cosmic Circuits力爭成為主要的半導體IP核提供商
- Cosmic Circuits，領(lǐng)先的差異化模擬和混合信號IP核提供商，宣布開(kāi)發(fā)MIPI D-PHY、MIPI M-PHY、USB2.0、USB3.0、PCI Express和HDMI IPs標準的28納米和20納米IP核。Cosmic Circuits也正在開(kāi)發(fā)這些標準的控制器解決方案，以便為客戶(hù)提供完整的解決方案。 Cosmic Circuits提供差異化混合信號IP核的廣泛組合，提供的產(chǎn)品大致分為兩類(lèi)：AMS(模擬和混合信號)IP核和連接(接口)IP核。Cosmic Circuits的AM
- 關(guān)鍵字： 半導體 IP核
基于Nexys 3開(kāi)發(fā)板的堆棧處理器的測試
- 堆棧處理器是一種專(zhuān)門(mén)面向嵌入式控制領(lǐng)域的處理器，其所有執行過(guò)程均依賴(lài)于兩個(gè)硬件支持的堆棧：執行數學(xué)表達式的數據堆棧(Data Stack)和保存子程序返回地址的返回堆棧(Return Stack)，而不是大量的通用寄存器。堆棧處理器的特征使其相比較于RISC和CISC等通用寄存器處理器，更加適合應用于嵌入式實(shí)時(shí)控制領(lǐng)域。本文在上述背景下，介紹了一個(gè)堆棧處理器的IP核，給出了其在Digilent公司的Nexys 3開(kāi)發(fā)板上的實(shí)現結果，以及使用ModelSim SE 6.5C仿真測試的結果。
- 關(guān)鍵字： 嵌入式 IP核
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