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AES加解密算法IP核的設計與實(shí)現

  • 計算機科學(xué)技術(shù)中的數據加密是信息安全的重要手段。Rijndael加密算法由比利時(shí)密碼學(xué)家JoanDaemen和VincentRijmen發(fā)明的一種迭代型分組加密算法,2000年被確定為美高級加密標準AES的最終算法。本文通過(guò)對AES算法的流程
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ASIC都去哪兒了?

  • 上周在看了我的朋友Dave Jones拆解一臺舊的Fluke 91 ScopeMeter DSO(數字采樣示波器)的視頻時(shí),我突然發(fā)現,這款有20年歷史的測試設備標志著(zhù)ASIC設計歷時(shí)10年的衰落正開(kāi)始顯著(zhù)加速。
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基于SOPC的異步串行通信IP核設計

  • 隨著(zhù)嵌入式技術(shù)的發(fā)展,基于SoPC技術(shù)的嵌入式系統所具有的軟硬件可裁減、可擴充、可升級以及可在線(xiàn)修改的特點(diǎn)越來(lái)越受到人們的重視。SoPC系統通常具有以下基本特征:采用大容量可編程邏輯器件來(lái)實(shí)現,單芯片、低功耗
  • 關(guān)鍵字: SOPC  IP核  異步串行通信    

富士通半導體獲海思半導體策略ASIC合作

  •   富士通半導體(上海)有限公司于日前宣布其獲得海思半導體策略ASIC合作伙伴榮譽(yù)。富士通的高速I(mǎi)P解決方案和ASIC設計服務(wù),是海思授予其這一榮譽(yù)的關(guān)鍵所在。   由于不斷升級的處理速度和越來(lái)越復雜的調制解調算法,現代通信芯片往往會(huì )集成數億個(gè)同時(shí)工作的晶體管和超高速的模擬互聯(lián)IP。而在這樣的芯片上,領(lǐng)先工藝所帶來(lái)的物理設計收斂會(huì )變得越來(lái)越困難,片上巨大規模的數字電路對超高速模擬IP的串擾也變得越來(lái)越明顯,如何在很短的設計周期內去盡可能的定義和優(yōu)化全芯片的低功耗策略,如何協(xié)同考慮封裝設計來(lái)包容超高的功耗
  • 關(guān)鍵字: 富士通  ASIC  半導體  

基于SOPC的觸控屏控制器IP核設計

  • 可編程片上系統(SOPC)是一種特殊的嵌入式系統,它設計方式靈活,具備軟硬件在系統可編程功能。SOPC在設計上...
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中國汽車(chē)半導體市場(chǎng)年末反彈

  •   據IHS iSuppli公司的中國研究報告,盡管需求比前幾年放緩,但2012年中國汽車(chē)半導體市場(chǎng)仍有望強勁增長(cháng)9.7%。政府激勵措施在第四季度促進(jìn)了中國汽車(chē)市場(chǎng)的增長(cháng)。   今年中國汽車(chē)半導體市場(chǎng)營(yíng)業(yè)收入預計達到41億美元,高于2011年的38億美元。明年,中國總體汽車(chē)半導體營(yíng)業(yè)收入將增長(cháng)12%,達到46億美元。2011-2016年,中國汽車(chē)半導體市場(chǎng)的復合年度增長(cháng)率將達11%,如圖所示。    ?   圖:中國汽車(chē)半導體市場(chǎng)營(yíng)業(yè)收入預測   這種增長(cháng)令人鼓舞。中國消費者要求汽
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基于UART的智能卡接口IP核設計

  • 分析了UART核的結構和智能卡的傳輸協(xié)議,提出一種基于UART核的智能卡接口IP核的設計。該設計以成熟的UART核為基礎,無(wú)需編寫(xiě)異步串口的時(shí)序與接口邏輯,僅在串口核中增加收發(fā)緩沖器和協(xié)議處理等模塊,減少了工作量并縮短了開(kāi)發(fā)周期。最后對所設計的IP核進(jìn)行仿真和實(shí)際測試,結果表明該IP核設計正確,運行穩定,適合在多卡系統中應用。
  • 關(guān)鍵字: UART  IP核  智能卡  接口    

Cadence合成技術(shù)為Renesas微系統公司加快生產(chǎn)時(shí)間

  • 全球電子設計創(chuàng )新領(lǐng)先企業(yè) Cadence 設計系統公司 (NASDAQ:CDNS) 日前宣布 Renesas 微系統有限公司已采用 Cadence? Encounter? RTL Compiler 用于綜合實(shí)現,尤其是將復雜 ASIC 設計的芯片利用率提高了 15%,面積減少了 8.4%,加速了實(shí)現周期并降低了成本。
  • 關(guān)鍵字: Cadence  Renesas  微系統  ASIC  

基于IP核技術(shù)的SoC設計

  • 1概述

    隨著(zhù)集成電路(Integrated Circuit,IC)設計技術(shù)和工藝水平進(jìn)入超深亞微米,集成電路規模越來(lái)越大,芯片設計規模和設計復雜度也急劇提高,工藝流程呈現專(zhuān)業(yè)化,EDA設計逐步發(fā)展和完善。九十年代出現了SoC芯片,即可
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基于DDS IP核及Nios II的可重構信號源設計

  • SOPC(System on a Programmable Chip,片上可編程系統)是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器、存儲器、I/O接口、LVDS、CDR等系統設計需要的功能模塊集成到一個(gè)可編程邏輯器件上,構建一個(gè)可
  • 關(guān)鍵字: Nios  DDS  IP核  可重構    

超低噪聲混合信號芯片 助力醫療CT性能顯著(zhù)提升

  •   2012年11月14日,奧地利微電子宣布開(kāi)始供應新款高集成ASIC,在較低的X射線(xiàn)劑量下,幫助西門(mén)子新型計算機斷層掃描(CT)光探測器模塊提供更高分辨率的圖像。奧地利微電子公司是全球領(lǐng)先的高性能模擬IC和傳感器解決方案的設計者及制造商,專(zhuān)為消費通信、醫療電子、汽車(chē)應用行業(yè)服務(wù)。   作為西門(mén)子新型Stellar CT光探測器模塊的組成部分,奧地利微電子的ASIC可捕捉并數字化病人身體的圖像。它在一個(gè)層疊骰子型(3D集成式)配置結構內,將一個(gè)高分辨率光電二極管同一個(gè)低噪聲模數轉換器(ADC)整合在了一
  • 關(guān)鍵字: 西門(mén)子  ASIC  CT  

基于IP核的FIR低通濾波器的設計與實(shí)現

  • 0.引言

    FIR(Finite Impulse Response,有限沖擊響應)數字濾波器具有穩定性高、可以實(shí)現線(xiàn)性相位等優(yōu)點(diǎn),廣泛被應用于信號檢測與處理等領(lǐng)域[1,2]。由于FPGA(Field Programmable Gate Array,現場(chǎng)可編程門(mén)陣列)
  • 關(guān)鍵字: FIR  IP核  低通濾波器    

基于IP核的FPGA 設計方法

  • 幾年前設計專(zhuān)用集成電路(ASIC) 還是少數集成電路設計工程師的事, 隨著(zhù)硅的集成度不斷提高,百萬(wàn)門(mén)的ASIC 已不難實(shí)現, 系統制造公司的設計人員正越來(lái)越多地采用ASIC 技術(shù)集成系統級功能(System L evel In tegrete - SL
  • 關(guān)鍵字: FPGA  IP核  設計方法    

Bluetooth ASIC及其嵌入式應用

  • 1 引言 Bluetooth(藍牙)作為新的短程無(wú)線(xiàn)電通信技術(shù),可以隨時(shí)隨地用無(wú)線(xiàn)接口來(lái)代替有線(xiàn)電纜連接,可應用于多種通 ...
  • 關(guān)鍵字: Bluetooth  ASIC  PH2401  

基于A(yíng)RM的IEEE802.11bMAC層協(xié)議IP核設計

  • 摘要:介紹了IEEE 802.11b MAC層協(xié)議IP核設計,提出了基于32位微處理器ARM7DMI的系統設計方案,闡述了系統硬件平 ...
  • 關(guān)鍵字: ARM  IEEE802.11b  MAC層協(xié)議  IP核  
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asic ip核介紹

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