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asic ip核
asic ip核 文章 進(jìn)入asic ip核技術(shù)社區
華虹NEC推出高效nvSOC產(chǎn)品原型平臺
- 世界領(lǐng)先的純晶圓代工廠(chǎng)之一，上海華虹NEC電子有限公司(以下簡(jiǎn)稱(chēng)“華虹NEC”)日前宣布成功推出nvSOC產(chǎn)品原型平臺，這一平臺的推出可以幫助客戶(hù)高效創(chuàng )建SOC和ASIC原型，大大縮短客戶(hù)SOC產(chǎn)品開(kāi)發(fā)周期和減少設計風(fēng)險。 nvSOC平臺的硬件主要由通用FPGA芯片和華虹NEC特有的平臺核心IP芯片構成，其中平臺核心IP芯片是指集成了華虹NEC 某一種NVM(Non Volatile Memory, 包括Flash，EEPROM，OTP等)工藝平臺的NVM模塊和基礎模擬/
- 關(guān)鍵字： 華虹NEC 晶圓代工 SOC ASIC
基于FPGA的8段數碼管動(dòng)態(tài)顯示IP核設計
- 設計基于FPGA的8段數碼管動(dòng)態(tài)顯示IP核，介紹8段數碼管內部結構及其驅動(dòng)顯示方式和IP核設計方法，給出8段數碼管動(dòng)態(tài)顯示IP核的Verilog HDL程序源代碼及其C語(yǔ)言驅動(dòng)程序。此IP核可例化成1～8個(gè)共陰極(或共陽(yáng)極)數碼管控制器，能方便地控制1～8個(gè)數碼管同時(shí)顯示數字和小數點(diǎn)位。測試結果表明，該IP核工作可靠、穩定，可直接應用于電子設計中。
- 關(guān)鍵字： FPGA 8段數碼管 動(dòng)態(tài)顯示 IP核
基于A(yíng)SIC設計的手工綜合研究
- 針對IC前端設計中的關(guān)鍵技術(shù)，即將寄存器傳輸級(RTL)描述的手工綜合成門(mén)級網(wǎng)表，通過(guò)人工參與的方式，運用數字電路設計知識將行為級代碼用一些最基本的邏輯門(mén)(比如與非門(mén)、非門(mén)、或非門(mén)等)按照時(shí)應的綜合電路模型得出其相應的門(mén)級電路。在A(yíng)SIC設計過(guò)程中運用這種方法，不僅優(yōu)化電路的結構，且能保證邏輯功能的正確性，同時(shí)可降低傳輸過(guò)程中的延遲，提高芯片設計的可靠性。因此，研究ASCI設計中的手工綜合具有重要的實(shí)用價(jià)值。
- 關(guān)鍵字： ASIC
Open-Silicon、MIPS和Virage Logic共同完成ASIC處理器設計
- Open-Silicon、業(yè)界標準處理器架構與內核領(lǐng)導廠(chǎng)商 MIPS 科技公司和Virage Logic 三家公司共同宣布，已成功開(kāi)發(fā)一款測試芯片，充分展現出構建高性能處理器系統的業(yè)界領(lǐng)先技術(shù)。該處理器測試芯片實(shí)現了1.1GHz的頻率速度，成功通過(guò)了65nm 芯片測試，使其成為65nm ASIC 中最快的處理器之一。同時(shí)，后續40nm器件的開(kāi)發(fā)工作也已經(jīng)開(kāi)始進(jìn)行，目標是超過(guò)2.5GHz頻率，并提供超過(guò)5000 DMIPS的性能。這項開(kāi)發(fā)計劃采用了Open-Silicon的CoreMAXTM技術(shù)，以及超
- 關(guān)鍵字： MIPS ASIC 測試芯片 65nm 40nm
賽普拉斯和Cytech Global 簽訂分銷(xiāo)特許協(xié)議
- 賽普拉斯半導體公司日前宣布Cytech Global 公司將在印度和東南亞國家銷(xiāo)售賽普拉斯全部專(zhuān)屬和可編程解決方案。Cytech的母公司Macnica與賽普拉斯在日本具有長(cháng)期成功的合作伙伴關(guān)系。近來(lái)，Macnica 香港公司(Macnica 的子公司)開(kāi)始在中國銷(xiāo)售賽普拉斯產(chǎn)品。雙方的合作協(xié)議即刻生效。 Cytech在亞太區的“需求創(chuàng )造引擎”擁有16個(gè)辦事處，超過(guò)200名雇員。其銷(xiāo)售隊伍技術(shù)背景深厚，能在整個(gè)設計過(guò)程中給與客戶(hù)大力協(xié)助。此外，該公司在銷(xiāo)售可編程和專(zhuān)屬解決方
- 關(guān)鍵字： 賽普拉斯 PSoC ASIC
ADI推出新型微處理器監控IC
- ADI最新推出用于監控手持式工業(yè)設備、電信設備和其它便攜式應用中的欠壓狀況的新型微處理器監控電路，擴充了其監控 IC 系列。ADM6326 、ADM6328、ADM6346? 和 ADM6348? 監控電路只需500nA 的超低供電電流，從而延長(cháng)了移動(dòng)裝置的電池續航時(shí)間。這些新型電路可為 DSP、ASIC、FPGA 和其它處理器電源的精密監控提供低功耗選擇方案，以檢測可能導致系統故障的欠壓狀況。這些監控 IC 可以監控2.5V、3V、3.3V 和5V 電壓軌。ADM6326、ADM
- 關(guān)鍵字： ADI 監控電路 監控IC DSP ASIC FPGA
FPGA平臺漸成系統核心
- 今天，FPGA已經(jīng)被應用于系統的核心。無(wú)論是用來(lái)完成關(guān)鍵功能還是直接作為系統核心，今天的FPGA所提供的性能、功耗和容量都已經(jīng)達到甚至超過(guò)此前ASIC或ASSP的水平。 25年前，賽靈思公司共同創(chuàng )始人之一 Ross Freeman發(fā)明了FPGA(現場(chǎng)可編 程門(mén)陣列)，僅憑一項專(zhuān)利，Ross就激發(fā)了一個(gè)行業(yè)的創(chuàng )新熱情。 很多電子設計師認為，FGPA將是21世紀最重要的集成電路技術(shù)之一，而傳統門(mén)陣列和結構陣列技術(shù)將退居到特殊的大批量應用。在FPGA誕生之初，可編程邏輯主要用于系統外圍，作
- 關(guān)鍵字： 賽靈思 FPGA ASIC ASSP
SoC原型驗證領(lǐng)域FPGA應用逐年增加
- 近幾年來(lái)，FPGA在驗證SoC設計上的應用發(fā)展非常迅速，這是因為隨著(zhù)半導體設計、制造工藝越來(lái)越先進(jìn)，SoC、ASIC設計的規模變得越來(lái)越大，只采用傳統軟件仿真的方式，已經(jīng)不能夠充分地驗證功能。另外，大量的前期軟件開(kāi)發(fā)也需要一個(gè)接近SoC、ASIC設計的硬件原型。而采用FPGA來(lái)模擬芯片設計的原型，已被證明是最有效、最經(jīng)濟的方式。目前，用于 SoC原型驗證的FPGA銷(xiāo)售額已增加到整個(gè)FPGA銷(xiāo)售的7%～9%，相信這一比例還將逐年提高。 SoC原型應用對FPGA有一定的需求。比如規模通常需要比較大，
- 關(guān)鍵字： FPGA SoC ASIC
PLD產(chǎn)業(yè)市場(chǎng)持續擴大加速替代ASIC
- 雖然PLD公司之間的競爭一直非常激烈，但ASIC仍然是我們主要的競爭對手。而競爭的結果是客戶(hù)趨向于使用可編程解決方案。相信PLD產(chǎn)業(yè)會(huì )持續擴大市場(chǎng)份額，加速替代ASIC。 在過(guò)去幾年中，半導體產(chǎn)業(yè)整體上經(jīng)歷了明顯的衰退。而這一衰退對于可編程邏輯器件(PLD)行業(yè)來(lái)講實(shí)際上卻是很好的發(fā)展機會(huì )。雖然PLD公司之間的競爭一直非常激烈，但ASIC(專(zhuān)用集成電路)仍然是我們主要的競爭對手。而競爭的結果是客戶(hù)趨向于使用可編程解決方案。 相對于10年前，目前采用前沿技術(shù)實(shí)現一個(gè)ASIC設計的成本幾乎翻了
- 關(guān)鍵字： PLD ASIC FPGA 40nm
FPGA為測試測量?jì)x器帶來(lái)獨特性能
- 電子行業(yè)的設計工程師，在很多應用領(lǐng)域包括通信、國防、醫療和教育等等，都在使用FPGA。在調試FPGA電路的時(shí)候，他們可能不知道，安捷倫的測量?jì)x器本身也使用了FPGA技術(shù)，并且和FPGA供應商在研發(fā)領(lǐng)域深入合作，甚至分享一些IP(知識產(chǎn)權)，雙方從測量和調試的角度積累了大量的經(jīng)驗。實(shí)際的設計往往會(huì )綜合使用FPGA和ASIC(專(zhuān)用芯片)來(lái)達到最佳效果，安捷倫在其示波器、邏輯分析儀、脈沖源、誤碼儀等產(chǎn)品中，正是采用這樣的綜合設計。 世上沒(méi)有完美的儀器，其設計總是在某一方面優(yōu)化、在某些方面作出妥協(xié)。以基
- 關(guān)鍵字： 安捷倫 FPGA ASIC
asic ip核介紹
您好，目前還沒(méi)有人創(chuàng )建詞條asic ip核!
歡迎您創(chuàng )建該詞條，闡述對asic ip核的理解，并與今后在此搜索asic ip核的朋友們分享。 創(chuàng )建詞條
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