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asic ip核
asic ip核 文章 進(jìn)入asic ip核技術(shù)社區
DARPA：人工智能需要ASIC芯片 我們正在努力
- 上周三，美國國防部高級研究計劃局(DARPA)宣布，為了幫助人工智能技術(shù)獲得長(cháng)足發(fā)展，他們即將開(kāi)展兩項新項目，開(kāi)發(fā)新一代計算機芯片。DARPA相信，開(kāi)發(fā)專(zhuān)門(mén)應用于人工智能領(lǐng)域的特制芯片將推動(dòng)該領(lǐng)域的不斷發(fā)展。 特制芯片 50年來(lái)，摩爾定律作為一項基本原理，一直推動(dòng)著(zhù)計算機芯片微處理器的發(fā)展。 20世紀60年代，英特爾聯(lián)合創(chuàng )始人Gordon Moore在經(jīng)過(guò)一系列的觀(guān)察后，得出了一個(gè)推測，他推測集成電路上晶體管的數量，約每隔18-24個(gè)月便會(huì )增加一倍，微芯片的性能也會(huì )得到有效的提升。但現在的
- 關(guān)鍵字： 人工智能 ASIC
ASIC廠(chǎng)商大戰AI芯片市場(chǎng)，這家公司可能成為最大黑馬？
- 人工智能(AI)現在的熱度節節攀升。這項技術(shù)存在了數十年之久，一直不溫不火，但它最近已經(jīng)成為數據中心分析、自動(dòng)駕駛汽車(chē)和增強現實(shí)等應用的焦點(diǎn)。這項技術(shù)怎么就重獲新生了呢?在我看來(lái)，人工智能迅速走熱的趨勢是由兩種力量所推動(dòng)的：訓練人工智能系統所需要的數據的大爆發(fā)和可以大大加快訓練進(jìn)程的新技術(shù)的出現。下面，我們分別從這兩個(gè)方面進(jìn)行一下解讀。 數據就是人工智能世界的貨幣。沒(méi)有大量的已知結果，就無(wú)法進(jìn)行推論和機器學(xué)習。得益于數據中心領(lǐng)域幾個(gè)巨無(wú)霸的強力推動(dòng)，各種數據庫正處于如火如荼的建設中。谷歌已經(jīng)積累
- 關(guān)鍵字： ASIC AI
想成為一個(gè)優(yōu)秀的硬件工程師，你需要具備這些能力！
- 一個(gè)好的硬件工程師實(shí)際上就是一個(gè)項目經(jīng)理，你需要從外界交流獲取對自己設計的需求，然后匯總，分析成具體的硬件實(shí)現。還要跟眾多的芯片和方案供應商聯(lián)系，從中挑選出合適的方案，當原理圖完成后，你需要組織同事來(lái)進(jìn)行配合評審和檢查，還要和CAD工程師一起工作來(lái)完成PCB的設計。與此同時(shí)，要準備好BOM清單，開(kāi)始采購和準備物料，聯(lián)系加工廠(chǎng)家完成板的貼裝?！薄 』局R 1) 基本設計規范 2) CPU基本知識、架構、性能及選型指導 3) MOTOROLA公司的PowerPC系列基
- 關(guān)鍵字： PCB ASIC
如何利用FPGA進(jìn)行時(shí)序分析設計
- FPGA(Field-Programmable Gate Array)，即現場(chǎng)可編程門(mén)陣列，它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現的，既解決了定制電路的不足，又克服了原有可編程器件門(mén)電路數有限的缺點(diǎn)。對于時(shí)序如何用FPGA來(lái)分析與設計，本文將詳細介紹?！ 』镜碾娮酉到y如圖 1所示，一般自己的設計都需要時(shí)序分析，如圖 1所示的Design，上部分為時(shí)序組合邏輯，下部分只有組合邏輯。而對其進(jìn)行時(shí)序分析時(shí)，一般都以時(shí)鐘為參考的，因此一般主要分析
- 關(guān)鍵字： FPGA ASIC
如何采用SystemVerilog來(lái)改善基于FPGA的ASIC原型
- ASIC在解決高性能復雜設計概念方面提供了一種解決方案,但是ASIC也是高投資風(fēng)險的,如90nm ASIC/SoC設計大約需要2000萬(wàn)美元開(kāi)發(fā)成本.為了降低成本,現在可采用FPGA來(lái)實(shí)現ASIC.但是,但ASIC集成度較大時(shí),需要幾個(gè)FPGA來(lái)實(shí)現,這就需要考慮如何來(lái)連接ASIC設計中所有的邏輯區塊.采用SystemVerilog,可以簡(jiǎn)化這一問(wèn)題.
- 關(guān)鍵字： SystemVerilog ASIC FPGA
SoC設計中的IP核保護方法研究
- 對現有主要IP核保護方法的原理和性能進(jìn)行了研究分析,指出了各種方法的優(yōu)缺點(diǎn),同時(shí)指出了IP核保護方法的發(fā)展方向。 隨著(zhù)集成電路的規模依據摩爾定律不斷呈指數增長(cháng),目前已經(jīng)可以將整個(gè)系統集成到一塊單硅芯片上,片上系統(Sys-tem on a Chip, SoC)的概念也應運而生。然而對于大型的SoC 來(lái)說(shuō),無(wú)論從設計的費用、周期還是可靠性來(lái)考慮,傳統的設計方法均已不能滿(mǎn)足需求,因此,基于知識產(chǎn)權( Intellectual Pro-perty, IP)核復用的設計方法也就隨之出現。
- 關(guān)鍵字： 片上系統 知識產(chǎn)權核 數字水印 簽名 IP核
IP核互連策略及規范
- 摘要：IP核有關(guān)標準及IP核互連規范目前正處于一個(gè)發(fā)展的關(guān)鍵時(shí)期，受到了業(yè)界的普遍關(guān)注。本文就IP核互連采取的策略進(jìn)行了分析，對目前幾種使用較多的IP核互連規范作了介紹。
- 關(guān)鍵字： 片上系統SOC 片上總線(xiàn)（On-ChipBus） IP核 互連策略 互連規范
ASIC中的異步時(shí)序設計
- 絕大部分的ASIC設計工程師在實(shí)際工作中都會(huì )遇到異步設計的問(wèn)題，本文針對異步時(shí)序產(chǎn)生的問(wèn)題，介紹了幾種同步的策略，特別是結繩法和異步FIFO的異步比較法都是比較新穎的方法。
- 關(guān)鍵字： ASIC
如何實(shí)現IP核心網(wǎng)的QoS
- NGN作為一個(gè)面向未來(lái)網(wǎng)絡(luò )業(yè)務(wù)應用，基于分組平臺可以同時(shí)提供語(yǔ)音、數據、多媒體等綜合業(yè)務(wù)的系統，成為各大運營(yíng)商以及設備提供商關(guān)注的焦點(diǎn)。 在影響NGN運營(yíng)模式和運營(yíng)收益的各種關(guān)鍵因素中，IPQoS特別是核心網(wǎng)的IPQoS，無(wú)疑是非常重要的一項。
- 關(guān)鍵字： IP核
浮點(diǎn)矩陣相乘IP核并行改進(jìn)的設計與實(shí)現
- 基于A(yíng)ltera浮點(diǎn)IP核實(shí)現浮點(diǎn)矩陣相乘運算時(shí)，由于矩陣階數的增大，造成消耗的器件資源雖增加但系統性能反而下降的問(wèn)題，針對現有IP核存在數據加載不連貫、存儲帶寬不均勻的不足，提出采用并行化數據存儲、依據查找表加載數據和處理數據的方式對IP核進(jìn)行改進(jìn)。然后將改進(jìn)的浮點(diǎn)矩陣運算在FPGA中實(shí)現，經(jīng)過(guò)Quartus、Matlab軟件聯(lián)合仿真并進(jìn)行結果比對，其誤差不超過(guò)萬(wàn)分之一，且節省了器件資源、提升了系統性能。仿真結果表明該設計可行，有利于提高諸多高性能領(lǐng)域浮點(diǎn)矩陣的運算速度。
- 關(guān)鍵字： IP核 浮點(diǎn)矩陣運算 存儲方式
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