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3-DES IP核的VerilogHDL設計

  • 首先介紹了3-DES算法的加密/解密原理，在此基礎上，采用流水線(xiàn)技術(shù)，設計了一種高速的3-DES加/解密IP核，并用VerilogHDL語(yǔ)言描述其中的各個(gè)模塊。
  • 關(guān)鍵字： IP核  流水線(xiàn)技術(shù)  VerilogHDL  DES加/解密  

基于Nios II的過(guò)程控制實(shí)驗裝置的研究

  • 利用SOPC強大的IP核和容易配置的優(yōu)勢簡(jiǎn)化設計流程。充分發(fā)揮NiosⅡ強大的并行處理能力。該系統主要涉及多個(gè)下位機與FPGA的通信問(wèn)題。
  • 關(guān)鍵字： SOPC  IP核  NiosII  

MCUUSB設備控制器IP核的設計

  • 本論文針對USB1.1 協(xié)議規范，本著(zhù)自主開(kāi)發(fā)USB控制芯片，把MCU 和USB 設備控制器用軟核的形式集成在一塊芯片上，微控制器我們是用14 位指令字長(cháng)度，且是單字節指令和單周期指令，其核心指令只有 39 條，容易掌握和設計，而且完全滿(mǎn)足總體設計的要求。
  • 關(guān)鍵字： USB控制芯片  IP核  MCU  

基于FPGA 的二維提升小波變換IP核設計

  • 提出了一種高效并行的二維離散提升小波(DWT)變換結構，該結構只需要7 行數據緩存，即可實(shí)現行和列方向同時(shí)進(jìn)行濾波變換。
  • 關(guān)鍵字： 小波變換  數據緩存  FPGA  IP核  

面積優(yōu)先的分組密碼算法SMS4 IP核設計

  • 對新分組密碼算法SMS4進(jìn)行了FPGA實(shí)現。所設計的SMS4算法的IP核主要包括具有加解密功能的非流水線(xiàn)式數據通路和實(shí)時(shí)產(chǎn)生子密鑰的密鑰擴展模塊，并且支持電子密碼本(ECB)和分組鏈接(CBC)兩種工作模式。提出了一種不含密鑰初始化的運行模式，使解密吞吐率提高近一倍。
  • 關(guān)鍵字： 分組密碼  IP核  FPGA  

基于A(yíng)valon-ST接口幀讀取IP核的設計和應用

  • 研究基于A(yíng)valon-ST接口幀讀取的IP核設計應用，通過(guò)Avalon-ST接口將外部存儲中不同格式的幀數據轉化為視頻流輸出。根據Avalon總線(xiàn)協(xié)議及Avalon-ST視頻協(xié)議研究設計方案，使用Verilog HDL語(yǔ)言對模塊進(jìn)行硬件設計，并將實(shí)現的模塊進(jìn)行測試。
  • 關(guān)鍵字： Avalon-ST  IP核  Verilog  

有功電能計量IP核的設計

  • 對有功電能計量的數學(xué)模型進(jìn)行了分析，給出了相應的IP核實(shí)現模型，并詳細討論了CIC抽取濾波器、IIR高通濾波器、FIR低通濾波器、數字頻率變換等模塊的原理與設計。
  • 關(guān)鍵字： 有功電能  CycloneII  IP核  

基于FPGA的二-十進(jìn)制轉碼器設計

  • 針對二進(jìn)制轉十進(jìn)制(BCD)轉碼器的FPGA實(shí)現目標，提出了一種高效、易于重構的轉碼器設計方案。并在FPGA開(kāi)發(fā)板上成功地實(shí)現了該設計。
  • 關(guān)鍵字： BCD轉碼器  IP核  路徑延遲  

在選用FPGA進(jìn)行設計時(shí)如何降低功耗

  • 傳統意義上，ASIC和CPLD是低功耗競爭中當仁不讓的贏(yíng)家。但是由于相對成本較高，且用戶(hù)對高端性能和額外邏輯的要求也越來(lái)越多，在低功耗應用中使用CPLD正在失去優(yōu)勢。ASIC也面臨相同的風(fēng)險。而例如FPGA這樣日益增長(cháng)的可編程半導體器件正逐步成為備受青睞的解決方案。
  • 關(guān)鍵字： 低功耗  ASIC  CPLD  可編程半導體器件  

FPGA并行計算抽象接口的設計與實(shí)現

  • 本設計為基于C語(yǔ)言開(kāi)發(fā)的程序開(kāi)發(fā)了一個(gè)FPGA的并行計算接口，凡是以C語(yǔ)言設計的程序，均可通過(guò)調用本設計的接口，把復雜的算法、數值處理交給FPGA芯片完成，在不需要程序員學(xué)習FPGA知識以及使用FPGA開(kāi)發(fā)工具的前提下，大大地減輕CPU的負荷以及從根本上提高了程序的執行效率，是FPGA并行化應用的一次全新嘗試。
  • 關(guān)鍵字： IP核  調度模塊  FPGA  PCI設備驅動(dòng)  Express總線(xiàn)  

基于FPGA的3D圖像處理器IP核的實(shí)現

  • LCD顯示屏的應用越來(lái)越廣，數量越來(lái)越多。LCD顯示屏應用廣泛,無(wú)處不在。如家庭各種電器設備。更常見(jiàn)是用于各種公共場(chǎng)合如體育館、廣場(chǎng)等商業(yè)用途。給我們傳遞一種更為直觀(guān)、生動(dòng)的信息。從此我們的生活發(fā)生了巨大改變。巨大的應用巨大的市場(chǎng)帶來(lái)了巨大的商機?；贔PGA的LCD顯示的3D影像是為了LCD顯示屏的信息量更多，滿(mǎn)足人需求。
  • 關(guān)鍵字： IP核  3D圖像處理器  FPGA  LCD  Verilog  

如何用C語(yǔ)言描述AES256加密算法最高效？

  • 高級加密標準 (AES) 已經(jīng)成為很多應用（諸如嵌入式系統中的應用等）中日漸流行的密碼規范。
  • 關(guān)鍵字： ASIC  AES  FPGA  嵌入式  

可配置電源管理ASIC--當今的系統黏合劑

  • 上個(gè)世紀，在數字化思維主導設計領(lǐng)域時(shí)，系統是標準處理器，ASSP，模擬電路和黏合邏輯的混合物?！梆ず线壿嫛笔峭ㄟ^(guò)小型和中型集成電路把不同數字芯片的協(xié)議和總線(xiàn)連在一起。為了降低成本實(shí)現一體化，“黏合邏輯”曾經(jīng)風(fēng)靡整個(gè)ASIC業(yè)。
  • 關(guān)鍵字： 集成電路  ASIC  電源管理  

基于FPGA的信息安全系統設計

  • 本模塊采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作為核心控制芯片，對采集到底模擬信號進(jìn)行數字轉換后通過(guò)3DES算法進(jìn)行加密、然后通過(guò)網(wǎng)絡(luò )傳輸，再經(jīng)過(guò)解密算法解密出明文數據。
  • 關(guān)鍵字： 信息安全系統  RAM  IP核  FPGA  乒乓操作  

MEMS麥克風(fēng)技術(shù)滿(mǎn)足音量市場(chǎng)的性能要求

  • 隨著(zhù)智能設備的迅猛發(fā)展，市場(chǎng)需要更高性能的麥克風(fēng)，而MEMS可以在緊湊的尺寸內麥克風(fēng)提供高性能和保真度及可靠性，適用于便攜式設備。本文介紹了MEMS麥克風(fēng)的結構和工作模式，并介紹了相關(guān)的MEMS麥克風(fēng)套件。
  • 關(guān)鍵字： MEMS  麥克風(fēng)  ASIC  201706  
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