基于DAC芯片AD9248和CY7C09449的PCI高速數據采集方案

　　0 引言

　　數據采集向高精度和高速度兩個(gè)方向發(fā)展。高精度數據采集依賴(lài)于A(yíng)/D器件的精度，高速度數據采集不僅依賴(lài)于A(yíng)/D器件的速度還依賴(lài)于數據采集系統的設計。高速數據采集按是否可連續采集而可以分為兩類(lèi)。第一類(lèi)是在一段時(shí)間內的高速數據采集，采集數據的時(shí)間長(cháng)度取決于存放數據的RAM存儲器的空間大小;另外一種是可以連續地高速數據采集，采集的數據被存放在大容量的存儲器上，一般為硬盤(pán)，這種采集的速度相對較小。本文提出屬于第一類(lèi)的PCI接口高速數據采集方案，可以實(shí)現高達80Mb/s的數據采集速度。

　　1 硬件結構

　　高速數據采集卡的硬件結構見(jiàn)圖1。

　　采集系統使用AD9248 DAC芯片，可以同時(shí)對兩路模擬信號進(jìn)行模數轉換，每路輸入可以選擇差分輸入或單端輸入。它最大的采樣率可達65MS/s，采樣精度為14bit。數據傳輸使用了CY7C09449集成芯片，它實(shí)現局部總線(xiàn)和PCI總線(xiàn)之間的數據傳輸。一片FPGA將CY7C09449和AD-9248連接起來(lái)。FPGA的作用有兩個(gè)，其一是控制A/D芯片實(shí)現數據轉換，其二是和PCI接口芯片交互，實(shí)現數據傳輸。

　　硬件設計上，CY7C09449和PCI總線(xiàn)是無(wú)縫連接，CY7C09449的局部總線(xiàn)和FPGA相連，AD9248的數據線(xiàn)及控制線(xiàn)和FPGA相連。軟件設計包括FPGA器件的邏輯設計、高速數據采集卡在WindowsXP下的驅動(dòng)程序設計和應用軟件設計。本文主要介紹高速數據采集卡的軟件設計。

　　2 數據采集過(guò)程

　　CY7C09449是美國Cypress公司生產(chǎn)的一款PCI接口控制芯片，支持PCI2.O協(xié)議，可以作為PCI總線(xiàn)的主設備也可以作為PCI總線(xiàn)的從設備。CY7C09449的局部總線(xiàn)可以和多種常用的微處理器直接相連。它內部包含的128kbit的雙端口SRAM共享存儲區可以從PCI總線(xiàn)訪(fǎng)問(wèn)也可以從局部總線(xiàn)訪(fǎng)問(wèn)，這是它最主要的資源。它內部包含的一些配置寄存器可以從PCI總線(xiàn)訪(fǎng)問(wèn)也可以從局部總線(xiàn)訪(fǎng)問(wèn)。在PCI總線(xiàn)上，CY7C09449可以處于從設備的地位，接收主機對它的配置寄存器或共享存儲區的訪(fǎng)問(wèn)。在PCI總線(xiàn)上，CY7C09449也可以處于主設備地位，主動(dòng)發(fā)起數據傳輸，將數據傳出或存入共享存儲區。它能夠產(chǎn)生任何32位PCI總線(xiàn)地址，可以發(fā)起PCI總線(xiàn)的突發(fā)傳輸。在局部總線(xiàn)上，CY7C09449處于從屬的地位，微處理器控制著(zhù)對它訪(fǎng)問(wèn)的主動(dòng)權。CY7C09449的局部總線(xiàn)本質(zhì)上是同步傳輸接口，可以支持突發(fā)傳輸。TMS320VC33處理器通過(guò)配置CY7C09449內部寄存器使其與SCY7C09449的局部總線(xiàn)相連接，并兼容TMS320VC33的異步訪(fǎng)問(wèn)方式。

　　數據采集的過(guò)程由主機發(fā)起。主機的應用程序向驅動(dòng)程序請求數據采集，驅動(dòng)程序通過(guò)寫(xiě)入CY7C09449的主機控制狀態(tài)寄存器0bit使引腳RSOUTD的狀態(tài)由低電平到高電平轉換，FPGA根據此信號來(lái)啟動(dòng)一次數據采集。FPGA從A/D讀取數據，然后寫(xiě)入CY7C09449的SRAM中。SRAM的大小為4k的雙字，FPGA把它分為2個(gè)2k雙字的塊，循環(huán)交替使用。FPGA每寫(xiě)完一個(gè)塊就通過(guò)CY7C09449的引腳IRQ IN向主機請求一次中斷。主機的驅動(dòng)程序在中斷服務(wù)程序中通過(guò)寫(xiě)入CY7C09449的DMA局部基地址寄存器、DMA主機物理基地址寄存器、DMA長(cháng)度寄存器來(lái)配置數據傳輸的源地址、目的地址、數據長(cháng)度，然后再寫(xiě)入CY7C09449的DMA控制寄存器來(lái)啟動(dòng)DMA傳輸。這樣直到本次所有的數據采集完畢，FPGA停止數據的讀取處于等待狀態(tài)。主機的中斷服務(wù)程序在收到最后一塊數據后向應用程序發(fā)送一個(gè)消息，告知本次數據采集完成。應用程序這時(shí)就可以處理采集到的數據或將數據存在硬盤(pán)中。

　　3 FPGA的邏輯設計

　　FPGA器件要實(shí)現的功能是從A/D器件讀取數據，然后通過(guò)局部總線(xiàn)將數據傳送給CY7C09449內部的雙端口SRAM。對FPGA的邏輯編程是在Quatus6.0下進(jìn)行的。頂層邏輯設計使用原理圖設計方法，把FPGA的邏輯分為3個(gè)模塊，每個(gè)模塊內部邏輯使用文本設計方法，使用VHDL語(yǔ)言編程。FPGA內的邏輯模塊如圖2所示。

　　A/D控制模塊產(chǎn)生A/D器件的控制信號，從A/D讀取數據，然后寫(xiě)入FIFO。AD控制模塊的功能相對比較簡(jiǎn)單，也比較容易實(shí)現。

　　因為在數據采集的過(guò)程中A/D采樣速度數據是固定的，但是數據傳輸有時(shí)速度很快而有時(shí)因為等待出現短時(shí)的阻塞。所以必須要有FIFO來(lái)緩沖采集的數據。FIFO模塊是用Quatus6.0的向導生成的，只需要設定有關(guān)參數即可。FIFO的寫(xiě)入和讀取使用同步接口邏輯，FIFO的存儲寬度是32 位，其深度是512。

　　局部總線(xiàn)控制模塊從FIFO中讀取數據然后寫(xiě)入CY7C09449的SRAM中。CY7C09449的局部總線(xiàn)支持同步數據傳輸，雖然它也兼容異步數據傳輸，但FPGA的局部總線(xiàn)控制模塊選用了同步數據傳輸邏輯，因為這樣可以獲得更高的數據傳輸速度。CY7C09449的局部總線(xiàn)支持最高的時(shí)鐘速度是50MHz，一次同步的突發(fā)數據傳輸在給出讀或寫(xiě)的起始地址之后，每個(gè)時(shí)鐘周期可以傳送一次數據。CY7C09449局部總線(xiàn)的數據總線(xiàn)寬度是32位，這使得局部總線(xiàn)的最高傳輸速度達200Mb/s。

　　在CY7C09449的局部總線(xiàn)上，FPGA處于類(lèi)似于微處理器的地位，控制著(zhù)局部總線(xiàn)數據傳輸的主動(dòng)權。FPGA的邏輯設計中，局部總線(xiàn)控制模塊的邏輯設計是獲得高速數據傳輸的關(guān)鍵。同步數據傳輸要比異步數據傳輸的邏輯復雜得多。在局部總線(xiàn)控制模塊的邏輯設計中使用了狀態(tài)機，其設計的關(guān)鍵在于狀態(tài)機的狀態(tài)的定義和在各種條件下?tīng)顟B(tài)的轉換。為了簡(jiǎn)單起見(jiàn)這里不對多塊數據傳輸控制、中斷信號產(chǎn)生邏輯作討論而只介紹傳送一個(gè)數據塊的邏輯。

　　狀態(tài)機共定義了7個(gè)狀態(tài)，各種狀態(tài)的轉換關(guān)系見(jiàn)圖3。

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