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fpga soc 文章 進(jìn)入fpga soc技術(shù)社區
Silicon Labs在全球率先推出安全Sub-GHz片上系統，無(wú)線(xiàn)傳輸距離超過(guò)1英里，電池壽命超過(guò)10年
- – Silicon Labs擴展Series 2平臺，支持Amazon Sidewalk、mioty、無(wú)線(xiàn)M-Bus和Z-Wave
- 關(guān)鍵字： Silicon Labs 物聯(lián)網(wǎng) SoC
AI與機器學(xué)習發(fā)展迅速，FPGA可提供高能效和靈活性
- 1? ?為什么AI/ML發(fā)展如此迅速？多年來(lái)，人工智能（AI）/機器學(xué)習（ML）市場(chǎng)一直以指數級的速度快速增長(cháng)，其解決方案遍布我們周?chē)?，從機器人和其他機械系統的預測故障算法、電子商務(wù)中的購買(mǎi)行為建議、自動(dòng)駕駛車(chē)輛的目標檢測、電子交易中的風(fēng)險緩解到DNA測序等等，我們身邊有各種各樣的解決方案，示例不勝枚舉。那么，為什么AI/ML發(fā)展如此迅速呢？據IDC、Gartner和其他市調機構的分析，全球大約80%的數據是非結構化數據。電子郵件、照片、語(yǔ)音郵件、視頻和許多其他數據源每天都在堆積。無(wú)論
- 關(guān)鍵字： AI 機器學(xué)習 FPGA
一種基于FPGA的BiSS編碼器解碼器設計
- BiSS協(xié)議是一種高速同步串行通信協(xié)議，使用BiSS協(xié)議的編碼器有利于提高伺服控制系統的動(dòng)態(tài)性能，在高精度絕對式編碼器中應用廣泛。本文在分析BiSS協(xié)議數據幀特點(diǎn)的基礎上，利用FPGA設計了BiSS協(xié)議編碼器解碼器，采集了BiSS協(xié)議編碼器位置數據和總線(xiàn)波形，通過(guò)與DSP聯(lián)合使用，基于BiSS協(xié)議編碼器對永磁同步電機的動(dòng)態(tài)性能進(jìn)行了驗證，結果表明該設計的合理性。
- 關(guān)鍵字： BiSS FPGA 編碼器 DSP 202108
基于FPGA的一種DDR4存儲模塊設計
- 5G通信的主要特征包括“高速率、大帶寬”，為了滿(mǎn)足高速率、大帶寬數據的傳輸要求，需要一種存儲技術(shù)對數據進(jìn)行存儲。本文就存儲技術(shù)結合DDR4協(xié)議，設計了一種DDR4傳輸機制，本研究采用高性能的XCVU9P系列的FPGA芯片作為控制芯片，使用其內部自帶的DDR4 SDRAM（MIG）IP核進(jìn)行例化核設計。經(jīng)過(guò)驗證，實(shí)現在250 MHz時(shí)鐘下對DDR4 SDRAM的讀/寫(xiě)操作，數據無(wú)丟失，能夠保證高速率、大帶寬數據正常傳輸，該傳輸機制具有良好的可靠性、適用性及有效性。
- 關(guān)鍵字： DDR4 高速率 大帶寬 FPGA 202108
英特爾推進(jìn)全新架構，面向數據中心、HPC-AI和客戶(hù)端計算
- 英特爾推出兩大x86 CPU內核、兩大數據中心SoC、兩款獨立GPU，以及變革性的客戶(hù)端多核性能混合架構 本文作者：Raja M.Koduri英特爾公司高級副總裁兼加速計算系統和圖形事業(yè)部總經(jīng)理 架構是硬件和軟件的“煉金術(shù)”。它融合特定計算引擎所需的先進(jìn)晶體管，通過(guò)領(lǐng)先的封裝技術(shù)將它們連接，集成高帶寬和低功耗緩存，在封裝中為混合計算集群配備高容量、高帶寬內存和低時(shí)延、可擴展互連，并確保所有軟件無(wú)縫地加速。披露面向新產(chǎn)品的架構創(chuàng )新，是英特爾架構師在每年架構日上的期許，今年舉辦的第三屆英特爾架構日令人
- 關(guān)鍵字： 英特爾 架構日 CPU SoC GPU IPU
基于逐次最鄰近插值的動(dòng)力電池電壓模擬方法*
- 動(dòng)力電池模擬系統是新能源汽車(chē)測試平臺等工業(yè)領(lǐng)域的重要裝備，而電池模型是該系統能否精確模擬電池特性的關(guān)鍵環(huán)節。為兼顧數據容量和給定電壓的精確性，提出逐次最鄰近插值算法應用于電池模型數據查表，該方法根據動(dòng)力電池在電池電荷狀態(tài)(State of Charge，SOC)初始段、平穩段和末尾段的輸出特性，建立了三個(gè)不同分辨率的模型子表，并借鑒最鄰近插值算法的計算量小和容易實(shí)現的優(yōu)點(diǎn)，采用對模型表逐次迭代分區，進(jìn)而逼近實(shí)際SOC和采樣電流對應的電池模型給定電壓值，達到細化電池模型表分辨率效果。討論了迭代次數選擇對算法
- 關(guān)鍵字： 查表 最鄰近插值算法 動(dòng)力電池 SOC 給定電壓 202102
毫米波5G接收機多速率數據設計與研究
- 針對5G毫米波通信宏基站、微基站等設備的研發(fā)、生產(chǎn)、預認證、維修保障等測試需求，設計一款可應用于“5G新基建”通信設備產(chǎn)業(yè)鏈多環(huán)節所需儀表的高效多速率信號接收機處理模塊。采用先進(jìn)的并行多相濾波技術(shù)和任意速率比FFT處理技術(shù)，基于FPGA算法平臺實(shí)現毫米波5G接收機多路信號接收時(shí)域/頻域并行變速率處理邏輯電路，提高5G復雜波形接收機信號解析的實(shí)時(shí)性。實(shí)驗結果表明，該電路能高效完成5G復雜波形接收機信號的時(shí)域/頻域解析，適合作為毫米波5G接收機多速率數據處理實(shí)施方案，滿(mǎn)足毫米波5G接收機的功能設計要求。
- 關(guān)鍵字： FPGA 5G 毫米波 接收機 202105
基于EG4A20BG256和AD7403的電流采樣電路設計
- AD7403是一種Σ-Δ型模數轉換器，廣泛應用于需要電氣隔離的伺服控制電機相電流采集場(chǎng)合。EG4A20BG256是一種國產(chǎn)FPGA，適用于伺服控制系統信號采集﹑接口擴展等應用場(chǎng)景。本文基于EG4A20BG256 FPGA設計了AD7403模數轉換器接口電路，采集永磁同步電機相電流，并與伺服控制電路內霍爾電流傳感器和DSP采樣結果進(jìn)行了對比。結果表明，EG4A20BG256 FPGA可以通過(guò)AD7403模數轉換器實(shí)現對永磁同步電機相電流的準確采集。
- 關(guān)鍵字： AD7403 EG4A20BG256 FPGA DSP 永磁同步電機 202105
一種BiSS協(xié)議的編碼器數據讀取方法
- 摘要：針對目前BiSS協(xié)議編碼器數據讀取多采用FPGA實(shí)現的實(shí)際情況，文中介紹一種基于XMC4500微控制器的BiSS協(xié)議編碼器數據讀取實(shí)現方案。采用該方案，可將使用BiSS協(xié)議編碼器的伺服系統控制電路常用的DSP+FPGA雙控制器架構方式簡(jiǎn)化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開(kāi)發(fā)難度。用該方案采集BiSS協(xié)議編碼器數據的實(shí)物平臺，使用LabVIEW顯示對讀取的數據，并與電機自帶增量編碼器值進(jìn)行對比，同時(shí)記錄BiSS協(xié)議編碼器實(shí)際數據波形圖，結果表明，該方案具有較高的采樣速率和較好
- 關(guān)鍵字： 202106 BiSS XMC4500 DSP FPGA LabVIEW
5G NR小區搜索算法的研究及FPGA實(shí)現
- 隨著(zhù)移動(dòng)通信的高速發(fā)展，5G NR通信已經(jīng)進(jìn)入我們的日常生活，5G系統對信息傳輸制訂了全新標準，基于5G NR的小區搜索相對于長(cháng)期演進(jìn)（LTE）而言，對同步信號進(jìn)行了重新定義。文章詳細分析了5G NR系統的主輔同步信號（PSS&SSS），對其新增內容進(jìn)行了研究，提出了適用于5G NR系統的小區搜索算法，使用MATLAB軟件對該算法的性能進(jìn)行了仿真分析，最后在FPGA上實(shí)現開(kāi)發(fā)應用。
- 關(guān)鍵字： 5G NR FPGA 小區搜索 PSS SSS 202105
賽靈思：以更高AI效能功耗比 支持邊緣運算自主
- 邊緣運算主要包含以下四個(gè)部分，低時(shí)延、AI算力、低功耗以及安全和保密，這四者是邊緣自主非常重要的組成部分，也是邊緣區別于工業(yè)和IoT的一個(gè)主要特點(diǎn)，也就是用運算資源來(lái)支持邊緣的自主，使它能夠獨立于云端。 賽靈思Versal AI Edge系列資深產(chǎn)品線(xiàn)經(jīng)理 Rehan Tahir賽靈思Versal AI Edge系列高級產(chǎn)品線(xiàn)經(jīng)理Rehan Tahir指出，當賽靈思在2018年引入Versal ACAP的時(shí)候，首先推出的是Versal Core和Prime系列，用于云端和網(wǎng)絡(luò )，然后推出了Vers
- 關(guān)鍵字： 賽靈思 FPGA ADAS
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歡迎您創(chuàng )建該詞條，闡述對fpga soc的理解，并與今后在此搜索fpga soc的朋友們分享。 創(chuàng )建詞條
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