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DSP內嵌PLL中的CMOS壓控環(huán)形振蕩器設計

  • DSP內嵌PLL中的CMOS壓控環(huán)形振蕩器設計,本文設計了一種應用于DSP內嵌鎖相環(huán)的低功耗、高線(xiàn)性CM0S壓控環(huán)形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時(shí)鐘,每級采用RS觸發(fā)結構來(lái)產(chǎn)生差分輸出信號,在有效降低靜態(tài)功耗的同時(shí).具有較好的抗噪聲能力。在延遲單元的設計時(shí)。綜合考慮了電壓控制的頻率范圍以及調節線(xiàn)性度,選擇了合適的翻轉點(diǎn)。 仿真結果表明.電路叮實(shí)現2MHz至90MHz的頻率調節范圍,在中心頻率附近具有很高的調節線(xiàn)性度,可完全滿(mǎn)足DSP芯片時(shí)鐘系統的要求。
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污水處理智能化系統的Multi-Agent通信技術(shù)與實(shí)現

異步FIFO和PLL在高速雷達數據采集系統中的應用

  • 異步FIFO和PLL在高速雷達數據采集系統中的應用,將異步FIFO和鎖相環(huán)應用到高速雷達數據采集系統中用來(lái)緩存A/D轉換的高速采樣數據,解決嵌入式實(shí)時(shí)數據采集系統中,高速采集數據量大,而處理器處理速度有限的矛盾,提高系統的可靠性。根據FPGA內部資源的特點(diǎn),將FIFO和鎖相環(huán)設計在一塊芯片上。因為未使用外掛FIFO和PLL器件,使得板卡設計結構簡(jiǎn)單,并減少硬件板卡的干擾。由于鎖相環(huán)的使用,使得整個(gè)采集系統時(shí)鐘管理方便。異步FIFO構成的高速緩存具有一定通用性,方便系統進(jìn)行升級維護。
  • 關(guān)鍵字: 數據采集  系統  應用  雷達  高速  FIFO  PLL  異步  

自動(dòng)反饋調節時(shí)鐘恢復電路設計

三星宣布新層疊封裝技術(shù) 8層僅厚0.6mm

  •   三星公司今天宣布,該公司已經(jīng)成功開(kāi)發(fā)出了全球最薄的Multi-die堆疊封裝技術(shù),將8顆閃存晶片(Die)層疊封裝在一顆芯片內,厚度僅為0.6mm,比目前常見(jiàn)的8層封裝技術(shù)厚度降低一半。三星的這項技術(shù)最初是為32GB閃存顆粒設計的,將8顆30nm工藝32Gb NAND閃存核心層疊封裝在一顆芯片內,每層晶片的實(shí)際厚度僅為15微米,最終封裝完成的芯片才實(shí)現了0.6mm的厚度。據稱(chēng)這樣的超薄大容量閃存芯片可 以讓手機和移動(dòng)設備設計者在存儲模塊上節省40%的空間和重量。   三星稱(chēng),這項層疊封裝新技術(shù)的關(guān)鍵
  • 關(guān)鍵字: 三星  封裝  Multi-die  

一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案

  • 由于超寬帶信號的帶寬很寬,傳統的信號產(chǎn)生辦法已不能直接應用于超寬帶通信。為此,提出一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案,該方法聯(lián)合使用了DDS和PLL兩種信號產(chǎn)生技術(shù),優(yōu)勢互補。通過(guò)ADS結合Matlab對系統的模型建立和性能分析證明,該方案輸出信號性能優(yōu)良,完全能滿(mǎn)足設計要求,并已成功應用于某超寬帶通信系統。
  • 關(guān)鍵字: 產(chǎn)生  方案  信號  Chirp-UWB  DDS  PLL  基于  轉換器  

基于FPGA的PLL頻率合成器設計

  • 頻率合成技術(shù)是現代通信的重要組成部分,它是將一個(gè)高穩定度和高準確度的基準頻率經(jīng)過(guò)四則運算,產(chǎn)生同樣穩定度和準確度的任意頻率。頻率合成器是電子系統的心臟,是影響電子系統性能的關(guān)鍵因素之一。本文結合F
  • 關(guān)鍵字: FPGA  PLL  頻率合成器    

基于低噪音單芯片高頻分頻器的PLL設計

  • VSAT是一種小衛星通信系統,可為邊遠地區的家庭和商業(yè)用戶(hù)提供可靠的、具有成本效應的寬帶數據和其它業(yè)務(wù)。VSAT采用一種小型天線(xiàn)來(lái)發(fā)送和接收衛星信號,可為所有處于衛星覆蓋區域內的用戶(hù)提供高帶寬連接,無(wú)論用
  • 關(guān)鍵字: PLL  設計  高頻  單芯片  噪音  基于  

TLi選擇FineSim SPICE作為模擬IC設計的標準驗證工具

  •   芯片設計解決方案供應商微捷碼(Magma®)設計自動(dòng)化有限公司日前宣布,消費電子產(chǎn)品全球供應商Technology Leaders & Innovators (TLi)公司已采用FineSim™ SPICE作為大型模擬IP設計的標準驗證工具。TLi是在對大量商用SPICE仿真產(chǎn)品進(jìn)行徹底詳盡的評估,結果顯示具有線(xiàn)性多CPU功能的FineSim SPICE提供了較傳統多線(xiàn)程仿真器快上一個(gè)數量級的運行時(shí)間后才決定選用這款微捷碼軟件。   “我們設計著(zhù)許多不同類(lèi)型的
  • 關(guān)鍵字: Magma  FineSim  PLL  ADC/DAC  高速I(mǎi)/O  

完全集成的PLL發(fā)送器ATA5749及其應用

  • 概述
    ATA5749是一款集成了完整小數分頻器(fractional-N)的PLL射頻發(fā)送器IC,適用于輪胎氣壓計、遙控無(wú)鍵入口和被動(dòng)式入口汽車(chē)應用。ATA5749采用幅移鍵控(ASK)和閉環(huán)頻移鍵控(FSK)調制,僅使用13.000 0 MHz晶體
  • 關(guān)鍵字: 分頻  應用  ATA5749  發(fā)送  集成  PLL  完全  

一種基于DDS和PLL技術(shù)本振源的設計與實(shí)現

  • 現代頻率合成技術(shù)正朝著(zhù)高性能、小型化的方向發(fā)展,應用最為廣泛的是直接數字式頻率合成器(DDS)和鎖相式頻率合成器(PLL)。介紹直接數字頻率合成器和鎖相環(huán)頻率合成器的基本原理,簡(jiǎn)述用直接數字頻率合成器(AD9954)和鎖相環(huán)頻率合成器(ADF4112)所設計的本振源的實(shí)現方案,重點(diǎn)闡述了系統的硬件實(shí)現,包括系統原理、主要電路單元設計等,并且對系統的相位噪聲和雜散性能做了簡(jiǎn)要分析,最后給出了系統測試結果。
  • 關(guān)鍵字: DDS  PLL    

IDT 推出 Versacloc 計時(shí)器件新產(chǎn)品系列

  •   致力于豐富數字媒體體驗、提供領(lǐng)先的混合信號半導體解決方案供應商 IDT® 公司(Integrated Device Technology, Inc.)推出其 VersaClock™ 計時(shí)器件的最新產(chǎn)品系列。VersaClock III 器件是專(zhuān)為高性能消費、電信、網(wǎng)絡(luò )和數據通信應用設計的可編程時(shí)鐘發(fā)生器,可以更經(jīng)濟有效地在多個(gè)晶體和振蕩器之間進(jìn)行選擇。這些可編程計時(shí)解決方案對節省占板空間和保持功效非常關(guān)鍵,因其體積可能不允許全定制解決方案。多個(gè)具有各種不同需求的系統能夠整合成更少的
  • 關(guān)鍵字: IDT  VersaClock  可編程時(shí)鐘發(fā)生器  PLL  

泰科電子推出Multi-Beam XLE連接器

  •   全球全球領(lǐng)先的電子組件供應商泰科電子近日宣布推出全新MULTI-BEAM XLE連接器產(chǎn)品。作為泰科電子備受市場(chǎng)認可的MULTI-BEAM XL配電連接器的增強版,新產(chǎn)品的負載電流較標準型MULTI-BEAM XL配電連接器提升20%以上,而耐用度更是其他同類(lèi)產(chǎn)品的兩倍之多。原有MULTI-BEAM XL產(chǎn)品負載電流為35安培,而新型連接器的每個(gè)觸點(diǎn)可負載高達50安培的電流。MULTI-BEAM XLE的觸點(diǎn)設計采用直角型垂直P(pán)CB插頭,以及線(xiàn)纜基座式插頭。此外,此款新型連接器還可提供20安培&ldq
  • 關(guān)鍵字: 泰科  連接器  MULTI-BEAM XL  

基于DDS驅動(dòng)PLL結構的寬帶頻率合成器設計

  • 摘 要:結合數字式頻率合成器(DDs)和集成鎖相環(huán)(PLL)各自的優(yōu)點(diǎn),研制并設計了以DDS芯片AD9954和集成鎖相芯片ADF4113構成的高分辨率、低雜散、寬頻段頻率合成器,并對該頻率合成器進(jìn)行了分析和仿真,從仿真和測試結果
  • 關(guān)鍵字: DDS  PLL  驅動(dòng)  寬帶頻率    
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