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CPLD在無(wú)功補償控制儀鍵盤(pán)中的設計應用
- 本控制儀以單片機80c196kc為核心，集無(wú)功補償、電度量計量、電能質(zhì)量監測及通信于一體，能實(shí)時(shí)顯示電網(wǎng)的各項參數，通過(guò)鍵盤(pán)可人工設定系統運行的參數。單片機外圍芯片PSD8XX及復雜可編程邏輯器件（CPLD）的使用不僅使系統的硬件電路簡(jiǎn)化，而且使系統的性能提高。本文將討論用CPLD來(lái)實(shí)現控制儀的鍵盤(pán)系統，給出了硬件電路和軟件設計方法。
- 關(guān)鍵字： 鍵盤(pán)擴展 無(wú)功補償裝置 CPLD
基于FPGA和PCI的AFDX終端接口卡設計
- 航空電子全雙工交換式以太網(wǎng)(AFDX)是在商用以太網(wǎng)的基礎上經(jīng)過(guò)改進(jìn)實(shí)時(shí)性和可靠性建立起來(lái)的。依據ARINC664規范第7部分對終端接口卡時(shí)延和抖動(dòng)的性能要求，提出基于FPGA和PCI的AFDX終端接口卡的整體設計方案，對發(fā)送和接收模塊等關(guān)鍵模塊進(jìn)行了設計，并分析了PCI接口驅動(dòng)程序。測試結果表明,該接口卡實(shí)時(shí)性好、傳輸速率高、穩定可靠，符合AFDX協(xié)議標準。
- 關(guān)鍵字： 全雙工交換式以太網(wǎng) 實(shí)時(shí)性 FPGA
LTE上行DFT/IDFT的一種設計實(shí)現
- MSL4163提供1MHz I2C串口，器件包括先進(jìn)的PWM引擎以及片上EEPROM等。主要用在電視和臺式電腦監視器、醫療、工業(yè)儀表和汽車(chē)音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應用電路、級聯(lián)連接電路。
- 關(guān)鍵字： 3GPP協(xié)議 流水線(xiàn)結構 FPGA
基于FPGA的級聯(lián)H橋多電平變流器CPS-PWM觸發(fā)脈沖快速生成
- 提出一種基于現場(chǎng)可編程門(mén)陣列(FPGA)及不對稱(chēng)規則采樣的級聯(lián)H橋型變流器觸發(fā)脈沖的快速生成方法。詳細分析了基于不對稱(chēng)規則采樣的載波相移SPWM(CPS-SPWM)觸發(fā)脈沖的快速生成原理。重點(diǎn)介紹了基于FPGA的CPS-SPWM觸發(fā)脈沖快速生成的實(shí)現方法。理論分析和實(shí)驗結果表明，在既沒(méi)有增加采樣頻率，又沒(méi)有增加計算量的情況下，相對基于對稱(chēng)規則采樣的CPS-SPWM脈沖生成方法，該方法具有較快的生成速度，并可廣泛應用于DSTATCOM等高壓級聯(lián)H橋多電平變流器觸發(fā)脈沖的快速生成。
- 關(guān)鍵字： 脈沖形成 CPS-SPWM技術(shù) FPGA
數字基帶預失真系統中環(huán)路延遲估計的FPGA實(shí)現
- 基于FPGA芯片Stratix II EP2S60F672C4設計實(shí)現了數字基帶預失真系統中的環(huán)路延遲估計模塊。該模塊運用了一種環(huán)路延遲估計新方法，易于FPGA實(shí)現。同時(shí)，在信號失真的情況下也能給出正確的估計結果。Modelsim SE 6.5c的時(shí)序仿真結果和SignalTaps II的硬件調試結果驗證了模塊的有效性。
- 關(guān)鍵字： 數字基帶預失真系統 環(huán)路延遲估計 FPGA
基于FPGA的FOR循環(huán)并行CRC流水線(xiàn)算法
- 通過(guò)研究通用串行循環(huán)冗余校驗(CRC)編碼技術(shù)并在此基礎上,利用等式代換或矩陣變換等方法推導出通用并行CRC編碼電路結構。根據傳統的并行CRC編碼方法,發(fā)現在高速數據傳輸校驗中,需要大量的人為計算量,由于計算量大,容易產(chǎn)生一些計算錯誤。于是在傳統的串行CRC編碼的思想基礎上,利用FOR循環(huán)語(yǔ)句與流水線(xiàn)技術(shù)相結合,提出基于FPGA的FOR循環(huán)并行CRC流水線(xiàn)算法。
- 關(guān)鍵字： 循環(huán)冗余校驗 流水線(xiàn)技術(shù) FPGA
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