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基于Verilog狀態(tài)機的PLC背板總線(xiàn)協(xié)議接口芯片設計

  • 設計了一組基于CPLD的PLC背板總線(xiàn)協(xié)議接口芯片,協(xié)議芯片可以區分PLC的背板總線(xiàn)的周期性數據和非周期性數據。詳細介紹了通過(guò)Verilog HDL語(yǔ)言設計狀態(tài)機、協(xié)議幀控制器、FIFO控制器的過(guò)程,25MHz下背板總線(xiàn)工作穩定的試驗結果驗證了協(xié)議芯片設計的可行性。
  • 關(guān)鍵字: VerilogHDL  PLC背板  CPLD  

基于FPGA的VHDL語(yǔ)言電路優(yōu)化設計

  • 在VHDL語(yǔ)言電路優(yōu)化設計當中,優(yōu)化問(wèn)題主要包括面積優(yōu)化和速度優(yōu)化。面積優(yōu)化是指CPLD/FPGA的資源利用率優(yōu)化,即用盡可能少的片內資源實(shí)現更多電路功能;速度優(yōu)化是指設計系統滿(mǎn)足一定的速度要求。
  • 關(guān)鍵字: 電路優(yōu)化設計  VHDL  FPGA  

用Zynq-7000 EPP實(shí)現端到端廣播

  • 在今年舉辦的美國國廣播電視設備展上亮相的數項創(chuàng )新中,BBC RD新開(kāi)發(fā)的Stagebox可以安裝到攝像機的背面,將有效傳輸距離從數百米延長(cháng)到互聯(lián)網(wǎng)協(xié)議數據包能抵達的幾乎任何一個(gè)地方。在近期涌現的利用 FPGA與生俱來(lái)的可編程功能提供更多功能和適應性,實(shí)現協(xié)議和標準的對接的開(kāi)創(chuàng )性設備中,Stagebox是最新一員。
  • 關(guān)鍵字: Zynq-7000  端到端廣播  FPGA  

基于FPGA的雷達回波實(shí)時(shí)模擬器的實(shí)現

  • 提出了一種基于FPGA的雷達回波實(shí)時(shí)模擬器的實(shí)現方法。該模擬器采用cPCI標準總線(xiàn),以FPGA為核心計算單元,配有高速數模、模數轉換模塊,可實(shí)現雷達回波信號實(shí)時(shí)在線(xiàn)注入模擬。該模擬器可實(shí)現多種體制下復雜回波的模擬,具有很好的工程應用價(jià)值。
  • 關(guān)鍵字: 雷達回波實(shí)時(shí)模擬器  并行處理  FPGA  

基于動(dòng)態(tài)重構技術(shù)和GSM通信的FPGA動(dòng)態(tài)配置

  • 提出了一種FPGA遠程動(dòng)態(tài)重構的方法,結合FPGA動(dòng)態(tài)重構技術(shù)和GSM通信技術(shù)來(lái)實(shí)現。利用GSM技術(shù)實(shí)現配置數據的無(wú)線(xiàn)傳輸,在單片機控制下將數據存儲于CF卡中。在內嵌硬核微處理器PowerPC405控制下,FPGA通過(guò)內部配置存取端口讀取CF卡中新的配置數據,對可重構區進(jìn)行配置以實(shí)現新的功能。
  • 關(guān)鍵字: 配置  GSM  FPGA  

基于FPGA的虛擬邏輯分析儀設計與實(shí)現

  • 闡述了一種基于FPGA的虛擬邏輯分析儀的設計,采用高性能的FPGA器件,再利用PC機的強大處理功能,配合LabVIEW圖形化語(yǔ)言開(kāi)發(fā)實(shí)現。由于虛擬邏輯分析儀的部分硬件功能軟件化,使硬件電路大為簡(jiǎn)化,提高了可靠性,同時(shí)降低了成本,具有一定的教學(xué)和科研價(jià)值。
  • 關(guān)鍵字: 邏輯分析儀  LabVIEW  FPGA  

基于DSP+CPLD的嵌入式車(chē)牌識別系統硬件電路設計

  • 基于數字信號處理器(DSP)TMS320VC5416和復雜可編程邏輯器件(CPLD)的嵌入式車(chē)牌識別系統的硬件設計,利用視頻處理芯片SAA7111作為視頻A/D,在CPLD的控制下將采集到的圖像數據寫(xiě)入幀存儲器中,DSP對圖像數據進(jìn)行實(shí)時(shí)分析處理。采用“乒乓”存儲結構,實(shí)現了圖像數據的采集和處理的并行運行。識別結果通過(guò)串口傳到上位機或者保存在E2PROM中,實(shí)現了車(chē)牌識別系統脫機、聯(lián)機工作,在實(shí)時(shí)高速圖像處理系統中有廣泛的工程技術(shù)應用前景。
  • 關(guān)鍵字: 車(chē)牌識別系統  嵌入式  CPLD  

基于A(yíng)RMFPGA的高速同步數據采集方案

  • 大多數的勘探、觀(guān)測工作都是在嚴苛的環(huán)境中進(jìn)行的,對數據的準確性、實(shí)時(shí)性都有著(zhù)較高的要求,并且大多情況下要求多參數同步測量。北京恒頤針對勘探、測控等行業(yè)的特點(diǎn),推出了基于A(yíng)RM+FPGA的低功耗、高速率
  • 關(guān)鍵字: 數據采集  ARM  FPGA  

基于FPGA的數字下變頻的工作理念分析

  •  近年來(lái),軟件無(wú)線(xiàn)電已經(jīng)成為通信領(lǐng)域一個(gè)新的發(fā)展方向,數字下變頻技術(shù)(Digital Down Converter-DDC)是軟件無(wú)線(xiàn)電的核心技術(shù)之一,也是計算量最大的部分?;贔PGA的DDC設計一
  • 關(guān)鍵字: DSP  DDC  FPGA  濾波器  

基于FPGA流水線(xiàn)分布式算法的FIR濾波器的實(shí)現

  • 提出了一種采用現場(chǎng)可編程門(mén)陣列器件(FPGA)并利用窗函數法實(shí)現線(xiàn)性FIR數字濾波器的設計方案,并以一個(gè)十六階低通FIR數字濾波器電路的實(shí)現為例說(shuō)明了利用Xilinx公司的Virtex-E系列芯片的設計過(guò)程。
  • 關(guān)鍵字: FIR濾波器  窗函數  FPGA  

基于FPGA的TD-LTE系統上行同步的實(shí)現

  • 基于最大似然 (ML)估計算法,改進(jìn)并利用FPGA實(shí)現了一種適用于TD-LTE系統的上行同步算法。主要介紹了如何利用FPGA實(shí)現ML算法。并以Virtex-5芯片為硬件平臺,進(jìn)行了仿真、綜合、板級驗證、聯(lián)機驗證等工作。結果表明,該同步算法應用到TD-LTE系統具有良好的穩定性和可行性。
  • 關(guān)鍵字: TD-LTE  Virtex-5  FPGA  

基于CPLD的USB總線(xiàn)讀寫(xiě)控制功能的實(shí)現

  • 以CPLD作為主控芯片,設計了一種針對USB總線(xiàn)的數據讀寫(xiě)控制器。u盤(pán)通過(guò)該控制器轉接到Pc機的USB接口,利用控制器對usB總線(xiàn)上的數據進(jìn)行實(shí)時(shí)監測分析,自動(dòng)禁止Pc機上的文件數據輸出到U盤(pán),同時(shí)不影響Pc機對u盤(pán)中文件的正常讀取。
  • 關(guān)鍵字: USB接口  讀寫(xiě)控制器  CPLD  

基于FPGA的以太網(wǎng)音頻廣播系統,軟硬件協(xié)同

  • 傳統的廣播系統從傳送音頻信號到廣播點(diǎn),都須鋪設專(zhuān)門(mén)的線(xiàn)路且傳送的事模擬音頻信號,模擬音頻信號抗干擾能力弱,長(cháng)距離的信號傳輸勢必造成信號的衰減,很難保證聲音質(zhì)量。同時(shí)為了對廣播的方式進(jìn)行控制,控制信號必須通過(guò)另外的控制線(xiàn)來(lái)傳送,布線(xiàn)復雜,成本高,施工及維修困難。
  • 關(guān)鍵字: 以太網(wǎng)  音頻廣播系統  FPGA  實(shí)時(shí)UDP傳輸  

基于FPGA的LCD顯示的遠程更新設計實(shí)現

  • 本設計“基于FPGA的LCD顯示的遠程更新”作為遠程視頻監視系統的監控終端設備,伴隨著(zhù)視頻監控系統的發(fā)展而發(fā)展。近年來(lái),中國視頻監控市場(chǎng)受平安城市建設,北京奧運會(huì )、上海世博會(huì )、廣州亞運會(huì )、深圳大運會(huì )等安保項目以及各行業(yè)視頻監控需求快速增長(cháng)等因素的刺激和拉動(dòng),取得了超常規快速發(fā)展,整體市場(chǎng)規模迅速擴大。
  • 關(guān)鍵字: LCD顯示  遠程更新  FPGA  FTP協(xié)議  

基于FPGA+DSP+ARM的數據傳送總線(xiàn)變換器設計

  • 介紹了基于FPGA+DSP+ARM的數據傳送總線(xiàn)變換器的整體設計及ARM、DSP和FPGA的器件選型,詳細描述了ARM與DSP、DSP與FPGA的接口電路設計,給出了系統軟件結構設計,詳細描述了HPI驅動(dòng)程序的實(shí)現過(guò)程。
  • 關(guān)鍵字: 總線(xiàn)變換器  ARM  FPGA  
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