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龍芯處理器IP核的FPGA驗證平臺設計

作者： 時(shí)間：2013-06-16 來(lái)源：網(wǎng)絡(luò ) 收藏
ck約束技術(shù)和人工干預布局布線(xiàn)，以達到預期目的。使用該平臺對所開(kāi)發(fā)的SoC的各個(gè)模塊進(jìn)行了驗證，并在lO MHz～70 MHz條件下與代碼前（后）仿真結果和SoC實(shí)測結果進(jìn)行了比較，發(fā)現該FPGA驗證平臺在多模塊、高速情況下，性能有所下降，如圖6所示，需進(jìn)一步提高綜合和布局布線(xiàn)技術(shù)。


圖6各模塊實(shí)驗驗證結果比較

本文設計了基于國產(chǎn)龍芯I號處理器IP核的SoC的FPGA驗證平臺，介紹了怎樣利用該平臺進(jìn)行軟硬件協(xié)同設計、SoC系統移植、IP核驗證和運行實(shí)時(shí)操作系統。在電壓設計、模塊選用甚至處理器核的選用方面都考慮了升級擴展技術(shù)，可為其他SoC的驗證所借鑒。驗證結果表明，基于龍芯I號CPU IP核的SoC可成功運行Linux嵌入式程序及VxWorks。

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