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基于FPGA的ISA總線(xiàn)／MMи總線(xiàn)數據轉換電路設計
作者：
時(shí)間：2012-06-08
來(lái)源：網(wǎng)絡(luò )
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該配置電路采用PS配置方式，首先通過(guò)QuartusⅡ軟件將FPGA的邏輯程序寫(xiě)入配置芯片EPC2LI20，該芯片數據具有掉電保護功能。上電后，配置芯片和FPGA同時(shí)復位，然后FPGA向配置芯片發(fā)送程序下載請求，配置芯片將存儲的邏輯程序寫(xiě)入FPGA，對FPGA進(jìn)行配置．配置完成后，FPGA內部的寄存器和I／O管腳均被初始化。完成初始化程序后，FPGA按照設計的邏輯功能正常工作，即按要求實(shí)現兩種總線(xiàn)之間的數據轉換。
2．3 地址比較電路
地址比較電路如圖3所示。74SL14為帶滯環(huán)比較的反向緩沖器，74SL85為4位數字比較器，6位的撥碼開(kāi)關(guān)為預存待轉數據程控模塊地址，74SL00為反向緩沖器。撥碼開(kāi)關(guān)共有6位，每1位都可以是邏輯高電平“1”或是邏輯低電平“0”，故該撥碼開(kāi)關(guān)共有26個(gè)組合，可以代表26個(gè)程控模塊的地址。如圖3所示，撥碼開(kāi)關(guān)為011001，代表將要進(jìn)行轉換的數據來(lái)自地址為011001的程控模塊，當控制信號給定的地址A27～A22與011001相符時(shí)，74SL00輸出低電平，該低電平與ISA總線(xiàn)的讀控制信號IOR和寫(xiě)控制信號IOW#一起構成FPGA從ISA總線(xiàn)讀數據或向ISA總線(xiàn)寫(xiě)數據控制信號。本文引用地址：http://dyxdggzs.com/article/190276.htm
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