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Synopsys推出動(dòng)態(tài)解析度自適應解碼器軟件優(yōu)化版本

  •   全球領(lǐng)先的半導體設計、驗證和制造軟件及知識產(chǎn)權(IP)供應商新思科技有限公司(Synopsys, Inc., 納斯達克股票市場(chǎng)代碼:SNPS)日前宣布推出動(dòng)態(tài)解析度自適應(DRA)解碼器軟件的優(yōu)化版本,主要面向已廣泛應用的DesignWare? ARC? Sound AS211SFX 和各種AS221BD 音頻處理器。
  • 關(guān)鍵字: Synopsys  DRA  IP  

Synopsys和華虹NEC合作推出低功耗參考流程3.0

  •   全球領(lǐng)先的半導體設計、驗證和制造軟件及知識產(chǎn)權(IP)供應商新思科技有限公司(Synopsys, Inc., 納斯達克股票市場(chǎng)代碼:SNPS),以及中國大陸領(lǐng)先的IC代工服務(wù)供應商上海華虹NEC電子有限公司(HHNEC)今日宣布:即日起推出130納米參考流程版本3.0。該參考流程是Synopsys和華虹NEC共同合作的結晶,它將Synopsys Eclypse? 低功耗解決方案加入到之前為設計師所提供的各種參考流程之中。
  • 關(guān)鍵字: Synopsys  130nm工藝  

Synopsys宣布提供DesignWareTM數據轉換器IP

  •   全球領(lǐng)先的半導體設計、驗證和制造軟件及知識產(chǎn)權(IP)供應商新思科技有限公司日前宣布:該公司所提供經(jīng)芯片生產(chǎn)驗證的DesignWareTM數據轉換器IP,已被應用于中芯國際廣受歡迎的65納米低漏電(Low Leakage)工藝技術(shù)。這可幫助設計工程師更有效地提升其芯片的功率,并在集成設計上達事半功倍之效。
  • 關(guān)鍵字: Synopsys  65nm  數據轉換器  

Synopsys推出HAPS?-600 系列

  •   全球領(lǐng)先的半導體設計、驗證和制造軟件及知識產(chǎn)權(IP)供應商新思科技有限公司(Synopsys, Inc., 納斯達克股票市場(chǎng)代碼:SNPS)日前宣布推出HAPS?-600 系列,這是其HAPS系列基于現場(chǎng)可編程門(mén)陣列(FPGA)原型驗證系統中容量最高的一款產(chǎn)品。HAPS-600系列將基于FPGA的原型驗證系統容量擴展到高達相當于8100萬(wàn)ASIC門(mén),從而確保了各種更大SoC項目的早期軟件開(kāi)發(fā)。
  • 關(guān)鍵字: Synopsys  FPGA  

Synopsys和中芯國際合作推出新SoC綜合設計解決方案

  •   全球領(lǐng)先的半導體設計、驗證、和制造軟件及知識產(chǎn)權 (IP) 的供應商新思科技有限公司(納斯達克市場(chǎng)交易代碼:SNPS)和中芯國際集成電路制造有限公司(中芯國際,紐約證券交易所交易代碼:SMI,香港聯(lián)交所交易代碼:00981.HK)宣布已正式提供用于中芯國際先進(jìn)65-nm 工藝的系統級芯片 (SoC) 綜合設計解決方案。該解決方案將 Synopsys 豐富的 DesignWare? 接口、模擬 IP 產(chǎn)品組合和其他基礎性 IP,通過(guò)可調參考流程與 Galaxy? 實(shí)現平臺集成在一起。
  • 關(guān)鍵字: Synopsys  SoC  

新思科技為創(chuàng )意電子達成首次流片就試產(chǎn)成功的成果

  •   全球半導體設計、驗證及制造軟件暨IP領(lǐng)導廠(chǎng)商新思科技(Synopsys)今日宣布,利用新思科技完整的DesignWare® SATA IP解決方案,包含控制器、實(shí)體層以及驗證IP,使創(chuàng )意電子(Global Unichip Corp.) 之GP5080固態(tài)硬盤(pán)系統單芯片第一次流片就試產(chǎn)成功之成果。   系統單芯片設計代工服務(wù)的龍頭企業(yè)創(chuàng )意電子,肯定了新思科技的DesignWare SATA IP在品質(zhì)、功耗、性能和功能集上的卓越性。對創(chuàng )意電子來(lái)說(shuō)SATA的互通性是一個(gè)關(guān)鍵的需求,而新思科技是唯
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新思科技助力英飛凌實(shí)現40納米3G基帶處理器芯片設計成功

  •   新思科技有限公司日前宣布:英飛凌科技(西安)有限公司通過(guò)采用新思完整的、基于統一功率格式(UPF)的低功耗綜合、物理實(shí)現和驗證流程,完成了國內首款采用40nm工藝技術(shù)的3G智能手機基帶處理器設計,并按照時(shí)間計劃成功實(shí)現一次流片成功。   為了達到芯片設計目標,英飛凌確定了在設計過(guò)程中采用了Synopsys全套實(shí)施流程,包括Design Compiler編譯器、ICC布局工具等,同時(shí)引入新思的知識產(chǎn)權(IP)和支持服務(wù)。同時(shí),還結合了英飛凌在移動(dòng)通信基帶芯片領(lǐng)域里豐富的經(jīng)驗和工程師的創(chuàng )新能力。   
  • 關(guān)鍵字: Synopsys  40nm  基帶處理器  

2009年EDA廠(chǎng)商排名出爐 Synopsys仍占榜首

  •   由Gary Smith的EDA小組及Nancy Wu與Marry Olsson共同編輯的市場(chǎng)統計已經(jīng)完成。2009年最大的變化是Mentor超過(guò)Cadence成為EDA市場(chǎng)全球銷(xiāo)售額依產(chǎn)品計的第二。這也意味著(zhù)市場(chǎng)向ESL方法論過(guò)渡。Synopsys仍是首位。   Mentor在IC設計居第二。在兼并Valor后mentor成為PCB設計的第三。   在Walden Rhines的帶領(lǐng)下當轉向RTL設計方法時(shí),相信近期Cadence已經(jīng)停止它的市場(chǎng)份額下降,十分相似于Mentor的變化。   
  • 關(guān)鍵字: Synopsys  EDA  

新思科技與中芯國際推出DesignWare USB 2.0 nanoPHY

  •   全球半導體設計制造軟件和知識產(chǎn)權領(lǐng)先企業(yè)新思科技有限公司和全球領(lǐng)先的半導體制造商中芯國際集成電路有限公司今天宣布開(kāi)始提供用于中芯國際65納米(nanometer)低漏電(Low Leakage)工藝技術(shù)的新思科技經(jīng)硅驗證的和獲得USB標志認證的DesignWare® USB 2.0 nanoPHY知識產(chǎn)權(IP)。作為一家提供包括控制器、PHY和驗證IP等USB2.0接口完整IP解決方案的領(lǐng)先供應商,新思科技繼續致力于通過(guò)提供高品質(zhì)IP助力設計人員降低集成風(fēng)險,這些IP具備了驗證過(guò)的互操作性,
  • 關(guān)鍵字: Synopsys  IP  65納米  DesignWare   

Synopsys推出快速原型系統HAPS-60系列

  • 下一代系統提供最高的性能、最高的容量、預測試IP和獨有先進(jìn)驗證功能 美國加利福尼亞州山景城,2010年5月—— 全球領(lǐng)先的半導體設計、驗證和制造軟件及知識產(chǎn)權(IP)供應商新思科技有限公司(Nasdaq:SNPS)今天宣布推出快速原型系統HAPS™-60系列,這是一種可降低復雜SoC設計和驗證挑戰的綜合解決方案。HAPS-60系列是Confirma™ Rapid Prototyping Platform快速原型平臺的一部分,是一種易于使用和具有高性?xún)r(jià)比的快
  • 關(guān)鍵字: Synopsys  HAPS-60  SoC  

Synopsys綜合和布局及布線(xiàn)生產(chǎn)效率提升兩倍

  •   Synopsys日前宣布,在其Galaxy設計實(shí)現平臺中推出了最新的RTL綜合工具Design Compiler 2010,它將綜合和物理層實(shí)現流程增速了兩倍。Design Compiler自1988年問(wèn)世以來(lái),隨著(zhù)工藝技術(shù)從1.5微米到32納米的進(jìn)步,而不斷得到調整升級。而今時(shí)序與面積布線(xiàn)的優(yōu)化已成為主要的挑戰,最新版工具與時(shí)俱進(jìn),針對拓撲技術(shù)進(jìn)行擴展,為Synopsys布局布線(xiàn)解決方案IC Compiler提供“物理層指引”;將時(shí)序和面積的一致性提升至5%的同時(shí),還將IC
  • 關(guān)鍵字: Synopsys  RTL  32納米  

Design Compiler 2010將綜合和布局及布線(xiàn)的生產(chǎn)效率提高2倍

  •   全球領(lǐng)先的半導體設計、驗證和制造的軟件及知識產(chǎn)權(IP)供應商新思科技有限公司日前宣布:該公司在其Galaxy™設計實(shí)現平臺中推出了最新的創(chuàng )新RTL綜合工具Design Compiler 2010,它將綜合和物理層實(shí)現流程增速了兩倍。為了滿(mǎn)足日益復雜的設計中極具挑戰性的進(jìn)度要求,工程師們需要一種RTL綜合解決方案,使他們盡量減少重復工作并加速物理實(shí)現進(jìn)程。為了應對這些挑戰,Design Compiler 2010對拓撲技術(shù)進(jìn)行擴展,為Synopsys旗艦布局布線(xiàn)解決方案IC Compile
  • 關(guān)鍵字: Synopsys  Galaxy  RTL  

Synphony:IC設計因此而改變

  •   假如IC設計的速度能夠加快數倍,那么擁有各種復雜功能的各類(lèi)電子產(chǎn)品將再次改變我們的生活。   IC設計中設計與驗證的流程通常需要數月甚至數年,其中的人工重新編碼的過(guò)程費時(shí)且容易出錯,Synopsys選擇這一環(huán)節為突破,開(kāi)發(fā)出了Synphony高層次綜合EDA工具,通過(guò)其獨特的MATLAB語(yǔ)言、基于模型的解決方案,針對ASIC和FPGA芯片設計實(shí)現了10倍的設計與驗證能力。   據Synopsys公司總監Chris Eddington介紹,Synphony的創(chuàng )意來(lái)自被收購的Synplicity公司,
  • 關(guān)鍵字: Synopsys  IC設計  EDA  

Synopsys推出Synphony高層次綜合

  •   全球領(lǐng)先的半導體設計、驗證和制造軟件、硬件及知識產(chǎn)權(IP)供應商新思科技公司(NASDAQ: SNPS),今天宣布推出其Synphony HLS (High Level Synthesis)解決方案。該解決方案集成了M語(yǔ)言和基于模型的綜合法,與 傳統RTL流程相比,能夠為通信和多媒體應用提供高達10倍速的更高的設計和驗證能力。Synphony HLS為ASIC 和 FPGA的應用、架構和快速原型生成最優(yōu)化的RTL。此外,通過(guò)在虛擬平臺中為系統驗證和早期軟件開(kāi)發(fā)生成C模型,Synphony HLS補充
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用智慧與激情迎接危機中的幸福

  •   簡(jiǎn)·奧斯汀的《理智與情感》告訴我們,若要在地位和金錢(qián)都凌駕于愛(ài)情之上的社會(huì )得到幸福,一定要懂得在理智與情感之間取得平衡。對于在競爭激烈的科技領(lǐng)域駕御企業(yè)走向成功,同樣不可缺少智慧和激情的平衡。近日,記者在北京采訪(fǎng)了Synopsys公司董事長(cháng)兼首席執行官Aart De Geus先生,這位一直強調以智慧和激情引領(lǐng)企業(yè)成功的商業(yè)奇才談起了應對金融危機下的企業(yè)發(fā)展策略。   讓De Geus先生可以坐在記者面前談笑風(fēng)生最重要的支撐就是Synopsys公司是在EDA行業(yè)中少數幾個(gè)業(yè)績(jì)預期繼續增長(cháng)
  • 關(guān)鍵字: Synopsys  EDA  IP  200907  
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synopsys介紹

Synopsys公司(Nasdaq: SNPS)是為全球集成電路設計提供電子設計自動(dòng)化(EDA)軟件工具的主導企業(yè)。為全球電子市場(chǎng)提供技術(shù)先進(jìn)的IC設計與驗證平臺,致力于復雜的芯片上系統(SoCs)的開(kāi)發(fā)。同時(shí),Synopsys公司還提供知識產(chǎn)權和設計服務(wù),為客戶(hù)簡(jiǎn)化設計過(guò)程,提高產(chǎn)品上市速度。 Synopsys公司總部設在美國加利福尼亞州Mountain View,有超過(guò)60家分公司分布在北美 [ 查看詳細 ]

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