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FPGA重點(diǎn)知識13條，助你構建完整“邏輯觀(guān)”之一

  • 　　1、查找表LUT和編程方式　　第一部分： 查找表LUT　　FPGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現的，即解決了定制電路的不足，又克服了原有可編程器件門(mén)電路有限的缺點(diǎn)?！　∮捎贔PGA需要被反復燒寫(xiě)，它實(shí)現組合邏輯的基本結構不可能像ASIC那樣通過(guò)固定的與非門(mén)來(lái)完成，而只能采用一種易于反復配置的結構。查找表可以很好 地滿(mǎn)足這一要求，目前主流FPGA都采用了基于SRAM工藝的查找表結構，也有一些軍品和宇航級FPGA采用
  • 關(guān)鍵字： FPGA  CPLD  

采用CPLD電器定時(shí)開(kāi)關(guān)控制系統電路

  • 采用CPLD電器定時(shí)開(kāi)關(guān)控制系統電路-隨著(zhù)當今社會(huì )工作和生活節奏的加快，人們對許多電器、儀器、設備的自動(dòng)化要求也越來(lái)越高，但現有的許多電器還不具備定時(shí)開(kāi)啟和關(guān)閉功能，許多需要在固定時(shí)間開(kāi)關(guān)的裝置，還需人工值守和操作，因此設計帶有時(shí)鐘顯示功能的多個(gè)電器定時(shí)開(kāi)關(guān)控制系統，具有實(shí)際意義。
  • 關(guān)鍵字： CPLD  開(kāi)關(guān)控制  應用電路  

五大優(yōu)勢凸顯 可編程邏輯或將呈現快速增長(cháng)

  • 五大優(yōu)勢凸顯 可編程邏輯或將呈現快速增長(cháng)-可編程邏輯器件的兩種類(lèi)型是現場(chǎng)可編程門(mén)陣列（FPGA）和復雜可編程邏輯器件（CPLD）。在這兩類(lèi)可編程邏輯器件中，FPGA是在PAL、GAL、EPLD等可編程器件的基礎上進(jìn)一步發(fā)展的產(chǎn)物。
  • 關(guān)鍵字： ASIC  FPGA  CPLD  半導體芯片  

FPGA/CPLD設計小技巧

  • FPGA/CPLD設計小技巧-這是一個(gè)在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過(guò)所有的這些檢查 。
  • 關(guān)鍵字： FPGA  CPLD  

基于CPLD的MIDI播放器設計方案

  • 大規?？删幊踢壿嬈骷﨏PLD和FPGA是當今應用最廣泛的兩類(lèi)可編程邏輯器件，電子設計工程師利用它可以在辦公室或實(shí)驗室設計出所自己所需要的專(zhuān)用芯片和專(zhuān)用產(chǎn)品，從而大大縮短了產(chǎn)品上市時(shí)間.
  • 關(guān)鍵字： MIDI播放器  CPLD  FPGA  

洗衣機洗滌程序控制器內部控制模塊方案

  • 設計一個(gè)洗衣機洗滌程序控制器，控制洗衣機的電機作如下規律運轉：用兩位數碼管預置洗滌時(shí)間（分鐘數），洗滌過(guò)程在送入預置時(shí)間后開(kāi)始運轉，洗滌中按倒計時(shí)方式對洗滌過(guò)程作計時(shí)顯示，用LED表示電機.
  • 關(guān)鍵字： 洗衣機  洗滌程序  FPGA  CPLD  

基于A(yíng)RM和CPLD的無(wú)線(xiàn)內窺系統設計

  • 　　當前，醫用無(wú)線(xiàn)內窺鏡已有產(chǎn)品問(wèn)世。以色列GI公司早在2001年5月即推出其M2A無(wú)線(xiàn)內窺鏡產(chǎn)品，并獲得美國FDA認證。GI公司生產(chǎn)的膠囊型內窺鏡 長(cháng)為26 mm，直徑為11mm，重3.5g;采用微功耗CMOS圖像傳感器，可觀(guān)察視角為14O°，可看清0.lmm左右的物體，采集速度為2幀/s。日本RF公 司也于2001年底研制出NORIKA3膠囊型內窺鏡系統。該產(chǎn)品采用超小型CCD攝像頭，含有8個(gè)鏡頭，可觀(guān)察視角為360°，圖像幀率可達30幀 /s?！癗ORIKA3
  • 關(guān)鍵字： ARM  CPLD  

基于單片機和CPLD的DDS正交信號源

  • 基于單片機和CPLD的DDS正交信號源，其頻率幅度可精密控制，擴展輸出頻率達300 kHz，增加掃頻輸出功能。采用紅外鍵盤(pán)控制頻率和幅度，采用液晶同步顯示信號的頻率和幅度；輸出端產(chǎn)生正弦波、方波、三角波、鋸齒波，梯形波、短形波、頻率突變的方波、尖脈沖數字信號等，且具有掃頻輸出的功能。測試結果表明，系統穩定可靠，人機交互界面友好，操作簡(jiǎn)單方便。
  • 關(guān)鍵字： DDS  正交信號源  CPLD  濾波器  DT9205  AT28C64  

基于CPLD的字符疊加器的設計

  • 本文提出一種基于CPLD的簡(jiǎn)易字符疊加器，具有成本低、抗干擾性能好等特點(diǎn)，適用于視頻監控。由于采用了CPLD器件，增強了系統集成度和設計靈活性。
  • 關(guān)鍵字： 字符疊加器  RAM  CPLD  VHDL  

開(kāi)關(guān)磁阻電機角度位置的純硬件控制

  • 針對開(kāi)關(guān)磁阻電機APC方式，本文介紹了一種基于CPLD的純硬件控制方式。該系統采用一臺1KW 6/4結構開(kāi)關(guān)磁阻電機作為機電能量轉換裝置，采用EP1K30TC144-3型CPLD(復雜可編程邏輯器件)和外圍電路構成數字控制器。實(shí)驗結果表明，本文提出的開(kāi)關(guān)磁阻電機純硬件控制系統在實(shí)踐上是可行的，基于CPLD的純硬件控制器可獲得優(yōu)良的控制效果。
  • 關(guān)鍵字： 開(kāi)關(guān)磁阻電機  APC  CPLD  

MAX II 控制路徑應用

  • 無(wú)論是在通訊，消費電子，計算還是工業(yè)領(lǐng)域，MAX II CPLD都是進(jìn)行控制路徑應用最好的選擇，這些應用都受成本和功耗預算的約束。MAX II器件提供更低的架構、更低的功耗以及更高的密度，使之成為復雜控制應用的最理想的解決方案，包括那些以前不可能采用CPLD的應用。
  • 關(guān)鍵字： MAXII  控制路徑  CPLD  

獨特的功能——只有MAX II CPLD能夠提供

  • MAX? II CPLD 體系結構中兩個(gè)獨特的功能是其他 CPLD 所不具有的：內部振蕩器和 8 Kbits 非易失用戶(hù)閃存 ( 請參考圖 1) 。
  • 關(guān)鍵字： MAX?II  體系結構  CPLD  獨特功能  

FPGA系列相關(guān)圖書(shū)介紹

使用MAX II CPLD 作為模擬鍵盤(pán)編碼器

  • CPLD 最常見(jiàn)的應用是鍵盤(pán)編碼器。處理器、ASSP 或者ASIC 一般無(wú)法提供足夠的引腳來(lái)實(shí)現鍵盤(pán)功能。I/O 擴展是CPLD 很普通的功能，使處理器采用很少的I/O 便可以解碼規模較大的鍵盤(pán)。雖然MAX? 和MAX? II 等CPLD 可以提供足夠的低成本I/O，但是在鍵盤(pán)解碼時(shí)沒(méi)有必要為每一開(kāi)關(guān)提供一個(gè)I/O。采用較少的連線(xiàn)進(jìn)行鍵盤(pán)解碼的優(yōu)點(diǎn)在于減少了鍵盤(pán)到主電路板的走線(xiàn)數量，降低了鍵盤(pán)區開(kāi)關(guān)矩陣的復雜度。本應用筆記解釋怎樣利用MAX II 器件資源來(lái)解碼只有兩個(gè)I/O 和一個(gè)GND 引腳的大規模開(kāi)
  • 關(guān)鍵字： MAXII  模擬鍵盤(pán)  CPLD  編碼器  
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