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asic ip核
asic ip核 文章 進(jìn)入asic ip核技術(shù)社區
基于SoC的數字攝像系統
- 1 概述 數字攝像機的最大特點(diǎn)在于信號數字化。它由成像芯片CCD將靜止或活動(dòng)的圖像分解成像素，并轉換成電信號。這些信號由數字攝像機內的數字信號轉換器轉換成數字信號，再經(jīng)微處理器進(jìn)行圖像處理和數據壓縮編碼后送到內部或外部存儲器，同時(shí)也可送到LCD/TV顯示屏。 存儲器中的數字信息通過(guò)接口輸入電腦再變成圖像。借助于CPU所提供的圖像處理軟件，按人們意愿進(jìn)行加工、編輯等處理，然后由彩色打印機制成一張理想的圖像。更重要的是，數字委員會(huì )還能通過(guò)電腦網(wǎng)絡(luò )傳到世界各地。 與模擬攝像機相比較，數字攝
- 關(guān)鍵字： 嵌入式系統 單片 數字攝像機 LCD/TV CCD SoC ASIC
基于SOPC的視頻編解碼IP核的設計
- 摘 要：本論文介紹視頻編解碼IP核在SOPC中的設計，用Verliog HDL實(shí)現其各個(gè)功能子模塊，全部調試仿真通過(guò)合并成一個(gè)模塊，實(shí)現了視頻信號的采集，分配，存儲以及色度空間的轉換。整個(gè)模塊都通過(guò)仿真實(shí)現與驗證，很好的達到了系統的要求。關(guān)鍵字：SOPC；視頻編解碼；IP核；Verilog HDL 引言 基于Nios II軟核的SOPC是Altera公司提出的片上可編程系統解決方案，它將CPU、存儲器、I/O接口、DSP模塊以及鎖相環(huán)的系統設
- 關(guān)鍵字： 嵌入式系統 單片機 SOPC 頻編解碼 SOPC 視頻編解碼 IP核 Verilog HDL
2010年全球ASIC銷(xiāo)售收入將達到41億美元
- 據市場(chǎng)研究公司Frost & Sullivan最新發(fā)表的研究報告稱(chēng)，全球汽車(chē)專(zhuān)用集成電路（ASIC）市場(chǎng)將從亞洲市場(chǎng)收入增長(cháng)中受益。這篇報告稱(chēng)，全球汽車(chē)專(zhuān)用集成電路市場(chǎng)2006年的收入為29.9億美元，2007年的銷(xiāo)售收入將達32.4億美元，2008年的銷(xiāo)售收入將達到35億美元，2010年的銷(xiāo)售收入將達到41億美元。這個(gè)市場(chǎng)從2006年至2010年的復合年增長(cháng)率將達8.2%。 Frost & Sullivan研究分析師Bonnie Varghese在聲明中說(shuō)，政府污染標準、安全標準
- 關(guān)鍵字： 汽車(chē)電子 集成電路 ASIC 汽車(chē)電子
Gartner調低對模擬專(zhuān)用IC市場(chǎng)的增長(cháng)率預測
- 據市場(chǎng)調研公司Gartner，專(zhuān)用標準產(chǎn)品(ASSP)和專(zhuān)用集成電路(ASIC)市場(chǎng)中的模擬領(lǐng)域，將以7.4%的復合年增率增長(cháng)，2011年將從2006年的237億美元上升到338億美元。這低于以前的預測。Gartner先前預測模擬專(zhuān)用IC市場(chǎng)的復合年增率將達11.4%。 在其最新預測中，汽車(chē)領(lǐng)域將是專(zhuān)用模擬IC市場(chǎng)中增長(cháng)最快的領(lǐng)域，復合年增率達10.8%，2011年將從2006年的35億美元增長(cháng)到59億美元。同時(shí)，消費領(lǐng)域增長(cháng)最慢，復合年增率只有5.5%，預計2011年將從2006年的39億美元上升到52
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探究最佳的結構化ASIC設計方法
- 由于與深亞微米標準單元ASIC相關(guān)的非重復性工程費用(NRE)越來(lái)越大，設計周期又很長(cháng)，因此利用結構化ASIC進(jìn)行定制IC設計的吸引力正變得越來(lái)越大。結構化ASIC能以極具競爭力的單位成本提供優(yōu)秀的硅片性能，并且NRE費用極低。結 構化ASIC的多樣性意味著(zhù)它即可以用作系統主芯片，也可以用作高性?xún)r(jià)比的小型輔助芯片。 許多物理設計問(wèn)題在結構化ASIC的片設計中已經(jīng)得到解決，因此后端版圖設計的時(shí)間可以大大縮短，從而導致更快的驗證確認和原型提供。不過(guò)ASIC片具有預定義的結構，因此設計師必須合理安排芯片
- 關(guān)鍵字： 嵌入式系統 單片機 ASIC FPGA MCU和嵌入式微處理器
IP核在SoC設計中的接口技術(shù)
- 引言 隨著(zhù)半導體技術(shù)的發(fā)展,深亞微米工藝加工技術(shù)允許開(kāi)發(fā)上百萬(wàn)門(mén)級的單芯片，已能夠將系統級設計集成到單個(gè)芯片中即實(shí)現片上系統SoC。IP核的復用是SoC設計的關(guān)鍵，但困難在于缺乏IP核與系統的接口標準，因此，開(kāi)發(fā)統一的IP核接口標準對提高IP核的復用意義重大。本文簡(jiǎn)單介紹IP核概念，然后從接口標準的角度討論在SoC設計中提高IP核的復用度，從而簡(jiǎn)化系統設計和驗證的方法，主要討論OCP(開(kāi)放核協(xié)議)。 OCP簡(jiǎn)介 基于IP核復用技術(shù)的SoC設計使芯片的設計從以硬件為中心轉向以軟件為中心，
- 關(guān)鍵字： 通訊 無(wú)線(xiàn) 網(wǎng)絡(luò ) IP核 SoC 接口 無(wú)線(xiàn) 通信
SoC設計：復雜性為驗證提出更高要求
- 由于片上系統(SoC)設計變得越來(lái)越復雜，驗證面臨著(zhù)巨大的挑戰。大型團隊不斷利用更多資源來(lái)尋求最高效的方法，從而將新的方法學(xué)與驗證整合在一起，并最終將設計與驗證整合在一起。雖然我們知道實(shí)現驗證計劃幾乎占去了整個(gè)芯片設計工作的2/3，但是我們還是發(fā)現有團隊遲交芯片，錯過(guò)計劃的流片最終期限。這種疏忽可能造成嚴重的商業(yè)后果，因為這意味著(zhù)硬件和軟件錯誤經(jīng)常被遺漏，直到設計周期的晚期。 為了創(chuàng )建一個(gè)全面的驗證解決方案，我們首先必須認識到設計工程師和驗證工程師所面臨的分歧和挑戰。在這個(gè)過(guò)程中，我們發(fā)現某些
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如何選擇適當的線(xiàn)性穩壓器
- 線(xiàn)性穩壓器通常被設計工程師作為輔助措施 ，并且經(jīng)常被選用于產(chǎn)品開(kāi)發(fā)的后期階段。設計工程師比較關(guān)注的是如何使復雜的基頻(BB) 或射頻( RF )ASIC 發(fā)揮作用，而不是其所選線(xiàn)性穩壓器的功率/性能。 線(xiàn)性穩壓器的選擇依據通常性能列表中的主要規格，而不是位于數據表封面以?xún)鹊姆浅ｊP(guān)鍵的核心和性能參數。規格經(jīng)常很容易令人誤解 — 封面上所列的規格只代表主要參數，但如果不與其他連接參數相結合時(shí)，便失去了價(jià)值。 例如，接地電流是這些參數中的一個(gè)。出現這
- 關(guān)鍵字： 模擬技術(shù) 電源技術(shù) 基頻 射頻 ASIC 模擬IC 電源
IP核：中國芯片設計業(yè)的機遇
- 利用商業(yè)化IP來(lái)設計大規模的復雜系統是中國芯片設計業(yè)實(shí)現跨越式發(fā)展的一種機遇。 利用商業(yè)化IP(硅知識產(chǎn)權)來(lái)設計大規模的復雜系統是中國芯片設計業(yè)實(shí)現跨越式發(fā)展的一種機遇。原因有四點(diǎn)。 第一，IP核交易成為IC設計企業(yè)加快產(chǎn)品研發(fā)進(jìn)程、提升產(chǎn)品質(zhì)量的捷徑；第二，IP重用技術(shù)前景廣闊，受到IC設計企業(yè)的重視；第三，IP核已經(jīng)成為IC設計企業(yè)的一種重要的知識產(chǎn)權；第四，我國擁有眾多的代工廠(chǎng)，為推廣國家IP核標準和復用提供了資源保證。 我
- 關(guān)鍵字： 通訊 無(wú)線(xiàn) 網(wǎng)絡(luò ) IP核 中國芯片
Nios SoC系統中的BCH編解碼IP核的設計
- 引 言 循環(huán)碼是最重要的一類(lèi)線(xiàn)性分組糾錯碼，而B(niǎo)CH碼又是目前發(fā)現的性能很好且應用廣泛的循環(huán)碼，它具有嚴格的代數理論，對它的理論研究也非常透徹。BCH碼的實(shí)現途徑有軟件和硬件兩種。軟件實(shí)現方法靈活性強且較易實(shí)現，但硬件實(shí)現方法的工作速度快，在高數據速率和長(cháng)幀應用場(chǎng)合時(shí)具有優(yōu)勢。FPGA(現場(chǎng)可編程門(mén)陣列)為DSP算法的硬件實(shí)現提供了很好的平臺，但如果單獨使用一片FPGA實(shí)現BCH編解碼，對成本、功耗和交互速度都不利。最新的SoC(片上系統)設計方法可以很好地解決這個(gè)問(wèn)題。
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如何成功地完成ASIC原型驗證
- 原型驗證---用軟件的方法來(lái)發(fā)現硬件的問(wèn)題 在芯片tap-out之前，通常都會(huì )計算一下風(fēng)險，例如存在一些的嚴重錯誤可能性。通常要某個(gè)人簽字來(lái)確認是否去生產(chǎn)。這是一個(gè)艱難的決定。ASIC的產(chǎn)品NRE的費用持續上升。一次失敗的ASIC流片將會(huì )推遲數個(gè)月的上市時(shí)間。誰(shuí)愿意承擔簽字的責任呢? 一些BUG通過(guò)仿真和Emulation是抓不到的。傳統的驗證方法認為設計的功能符合功能定義就是對的。 但功能定義到底對不對呢？唯一的辦法就是建立一個(gè)真實(shí)的硬件：原型。 基于FPGA的原型 --- 一個(gè)虛擬
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“首個(gè)”無(wú)線(xiàn)傳感器網(wǎng)絡(luò )SoC問(wèn)世
- Dust Networks公司在Electronica大會(huì )上發(fā)布了世上首個(gè)無(wú)線(xiàn)傳感器網(wǎng)絡(luò )系統級芯片(SoC)。Dust Networks在這張名為“智能塵?！钡男酒霞闪藰嫿ǚ峙涫絺鞲衅骶W(wǎng)絡(luò )所需的所有硬件和軟件功能，并表示它的功耗比Zigbee要低5倍，使系統不再需要路由器，而且使在現有網(wǎng)絡(luò )上添加新傳感器的總成本降低了10倍。 Dust Networks公司創(chuàng )始人之一，電氣工程師Rob Conant說(shuō)：“我們的ASIC的功耗比使用802.15.4無(wú)線(xiàn)電
- 關(guān)鍵字： 傳感器 傳感器專(zhuān)題 無(wú)線(xiàn) SoC ASIC
瑞薩開(kāi)發(fā)出具有45nm及以上工藝的微處理器和SoC器件
- 瑞薩科技布，開(kāi)發(fā)出一種具有45 nm（納米）及以上工藝的微處理器和SoC（系統級芯片）器件、低成本制造能力的超高性能晶體管技術(shù)。新技術(shù)利用瑞薩開(kāi)發(fā)的專(zhuān)有混合結構（在2006年12月以前發(fā)布的一種先進(jìn)技術(shù)）改善了CMIS（注1）晶體管的性能。瑞薩已經(jīng)在2007年6月12日于日本京都舉行的2007年超大規模集成電路技術(shù)專(zhuān)題研討會(huì )（2007 Symposium on VLSI Technology）上闡述了這一新的、增強的混合結構，并演示了測試數據。 像以前的技
- 關(guān)鍵字： SoC ASIC
asic ip核介紹
您好，目前還沒(méi)有人創(chuàng )建詞條asic ip核!
歡迎您創(chuàng )建該詞條，闡述對asic ip核的理解，并與今后在此搜索asic ip核的朋友們分享。 創(chuàng )建詞條
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