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從并行到串行再返回:對SerDes的理解

  • 串行化/去串行化電路,統稱(chēng)為SerDes,為數字通信系統提供了重要的好處,尤其是當需要高數據速率時(shí)。在我工程生涯的早期,我認為并行通信通常比串行通信更可取。我很欣賞同時(shí)移動(dòng)所有8個(gè)(或16個(gè),或32個(gè)…)數據位的簡(jiǎn)單性和效率,使用一兩個(gè)控制信號進(jìn)行握手,而不需要復雜的同步方案。然而,不久之后,主流的數字通信協(xié)議——UART、SPI、I2C等——使用串行接口就變得很明顯了,我還注意到,用于專(zhuān)業(yè)應用的高級協(xié)議有利于串行傳輸。盡管微控制器和中央處理器(CPU)的內部存儲、檢索和處理操作需要并行數據,這意味著(zhù)串行
  • 關(guān)鍵字: SerDes,并行,串行,PCB  

SerDes詳解

  • 一、SERDES的作用1.1并行總線(xiàn)接口在SerDes流行之前,芯片之間的互聯(lián)通過(guò)系統同步或者源同步的并行接口傳輸數據,圖1.1演示了系統和源同步并行接口。隨著(zhù)接口頻率的提高,在系統同步接口方式中,有幾個(gè)因素限制了有效數據窗口寬度的繼續增加。a)、時(shí)鐘到達兩個(gè)芯片的傳播延時(shí)不相等(clock skew)b)、并行數據各個(gè)bit的傳播延時(shí)不相等(data skew)c)、時(shí)鐘的傳播延時(shí)和數據的傳播延時(shí)不一致(skew between data and clock)雖然可以通過(guò)在目的芯片(chip #2)內用
  • 關(guān)鍵字: SerDes  通信  片內通信  

使用并行輸出的解串器分解SerDes系統中的各類(lèi)信號

  • 作者:Frank Qin問(wèn)題背景:在IVI系統中,SoC-串行器-解串器-屏幕的鏈路中存在很多的干擾及未知因素。尤其是當下各類(lèi)芯片基本都沒(méi)有提供各類(lèi)信號的并行輸出,導致難以在串行鏈路中的各個(gè)點(diǎn)位分別抓取我們希望得到的數字信號,從而導致在整個(gè)系統出現不穩定或者時(shí)鐘及脈沖信號不匹配時(shí),我們無(wú)從下手去找到不匹配的點(diǎn)。解決思路:如果可以把串行信號或者“黑盒子”中的有意義的信號單獨抓取出來(lái),找到其中的“可變量”和“定量”,就可以比較簡(jiǎn)單的判斷出鏈路中是否有哪個(gè)信號出現的偏差或抖動(dòng)。LVDS 可在并行和串行數據傳輸中
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泰克榮獲2023年DesignCon最佳論文獎,表彰PAM4 SerDes 建模領(lǐng)域創(chuàng )新

  • _____泰克日前成為2023年DesignCon最佳論文獎得主,該獎項旨在表彰其在數據驅動(dòng)式 PAM4 SerDes 建模領(lǐng)域的突出貢獻。這篇論文是由泰克Wenzheng (Shawn) Sun 和 Muhammad Saad Chughtai 與惠普企業(yè) (HPE) 的 Yongjin Choi 和 Chris Cheng 共同完成的。此外,北卡羅來(lái)納州立大學(xué)的 Priyank Kashyap 和 Pual Franzon 也參與了論文的撰寫(xiě)過(guò)程。最佳論文獎旨在表彰獲獎作者在半導體和電子設計領(lǐng)域的突出
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Cadence發(fā)布面向TSMC 3nm工藝的112G-ELR SerDes IP展示

  • 3nm 時(shí)代來(lái)臨了!Cadence 在 2023 年 TSMC 北美技術(shù)研討會(huì )期間發(fā)布了面向臺積電 3nm 工藝(N3E)的 112G 超長(cháng)距離(112G-ELR)SerDes IP 展示,這是 Cadence 112G-ELR SerDes IP 系列產(chǎn)品的新成員。在后摩爾時(shí)代的趨勢下,FinFET 晶體管的體積在 TSMC 3nm 工藝下進(jìn)一步縮小,進(jìn)一步采用系統級封裝設計(SiP)。通過(guò)結合工藝技術(shù)的優(yōu)勢與 Cadence 業(yè)界領(lǐng)先的數字信號處理(DSP)SerDes 架構,全新的 112G-ELR
  • 關(guān)鍵字: Cadence  TSMC  3nm工藝  SerDes IP  

Credo正式推出基于臺積電5nm及4nm先進(jìn)制程工藝的全系列112G SerDes IP產(chǎn)品

  • ?Credo Technology(納斯達克股票代碼:CRDO)近日正式宣布推出其基于臺積電5nm及4nm制程工藝的112G PAM4 SerDes IP全系列產(chǎn)品,該系列能夠全面覆蓋客戶(hù)在高性能計算、交換芯片、人工智能、機器學(xué)習、安全及光通信等領(lǐng)域的廣泛需求,包括:超長(cháng)距(LR+)、長(cháng)距(LR)、中距(MR)、超極短距(XSR+)以及極短距(XSR)。?Credo IP產(chǎn)品業(yè)務(wù)開(kāi)發(fā)助理副總裁Jim Bartenslager表示, “Credo先進(jìn)的混合信號以及數字信號處理(DSP)1
  • 關(guān)鍵字: Credo  臺積電  5nm  4nm  SerDes  IP  

視野無(wú)死角!哉英 SerDes 讓你入門(mén) Full HD 全景監控

  • 近年來(lái),車(chē)用全景監視系統 (Around View Monitor,AVM) 已經(jīng)逐漸成為汽車(chē)中高階市場(chǎng)的標準配備,影像處理及畫(huà)面拼接的技術(shù)也越來(lái)越成熟。消費者除了要求畫(huà)面的流暢度與拼接的準確度外,也開(kāi)始追求畫(huà)面的品質(zhì)。圖片取自:https://picclick.co.uk/ICAM-BMW-surround-360-camera-retrofit-set-kit-254219011731.html    目前市面上大部分的 AVM 系統都使用 720p HD 的鏡頭模組,因應未來(lái)市場(chǎng)
  • 關(guān)鍵字: THine  哉英  SerDes  Camera  MIPI-CSI  1080p  全景  環(huán)景  AVM  Automotive  

高速Serdes技術(shù)的發(fā)展趨勢和挑戰

  • 湛?偉(成都華微電子科技有限公司,成都?610041)摘?要:本文回顧了Serdes的發(fā)展歷程,提出了Serdes技術(shù)分代及其特點(diǎn),講述當前國內外Serdes的技術(shù)現狀,以及Serdes技術(shù)的發(fā)展趨勢,對Serdes架構和各模塊技術(shù)演變、關(guān)鍵技術(shù)挑戰進(jìn)行了分析,并從協(xié)議、電路設計、信號完整性、發(fā)展趨勢幾個(gè)維度加以詳細討論。關(guān)鍵詞:Serdes;PAM4;數據時(shí)鐘;恢復0 引言Serdes是英文單詞串行器(Serializer)和解串行器(De-Serializer)的合成詞,可以稱(chēng)之為串行解串器。根據其功
  • 關(guān)鍵字: 201909  Serdes  PAM4  數據時(shí)鐘  恢復  

Cyclone IV高速串口在微波數據傳輸中的應用

  • 采用ALTERA Cyclone IV FPGA內部SERDES實(shí)現多路數據的復分解,舍棄了專(zhuān)用的復分解芯片,在降低系統硬件設計復雜度的同時(shí)縮小了PCB板的體積以及系統功耗。利用數據提取、緩存、還原等處理方式,去除異步采樣帶來(lái)的數據傳輸帶寬增加的弊端。實(shí)現在有限的無(wú)線(xiàn)微波傳輸帶寬、有限的體積內部多種同步異步數據的高可靠性傳輸。
  • 關(guān)鍵字: SERDES  高速串口  數據提取  異步采樣  微波傳輸  201812  

獲得連接:解密串行解串器

  • 串行解串器是可將大位寬并行總線(xiàn)壓縮成少量(通常為一條)差分串行鏈路的器件,該鏈路可在遠遠高于低速大位寬并行總線(xiàn)的速率下進(jìn)行切換。串行解串器對大
  • 關(guān)鍵字: 解串  SerDes  

參考時(shí)鐘對SERDES性能的影響

  • 參考時(shí)鐘對SERDES性能的影響-我們知道,SERDES對參考時(shí)鐘有嚴格的相位噪聲性能要求。通常,SERDES供應商會(huì )根據其SERDES采用的PLL以及CDR架構特點(diǎn),以及性能數據,提出對參考時(shí)鐘的相位噪聲的具體要求。
  • 關(guān)鍵字: SERDES  參考時(shí)鐘  XILINX  

基于高速FPGA的PCB設計技術(shù)

  • 本文只談及了一些基本的概念。這里所涉及的任何一個(gè)主題都可以用整本書(shū)的篇幅來(lái)討論。關(guān)鍵是要在為PCB版圖設計投入大量時(shí)間和精力之前搞清楚目標是什么。一旦完成了版圖設計,重新設計就會(huì )耗費大量的時(shí)間和金錢(qián),即便是對走線(xiàn)的寬度作略微的調整。不能依賴(lài)PCB版圖工程師做出能夠滿(mǎn)足實(shí)際需求的設計來(lái)。原理圖設計師要一直提供指導,作出精明的選擇,并為解決方案的成功負起責任。
  • 關(guān)鍵字: PCB  電容  SERDES  FPGA  

基于SERDES的數字系統中高效時(shí)鐘設計方案

  • 基于SERDES的設計增加了帶寬,減少了信號數量,同時(shí)帶來(lái)了諸如減少布線(xiàn)沖突、降低開(kāi)關(guān)噪聲、更低的功耗和封裝成本等許多好處。而SERDES技術(shù)的主要缺點(diǎn)是需要非常精確、超低抖動(dòng)的元件來(lái)提供用于控制高數據速率串行信號所需的參考時(shí)鐘。即使嚴格控制元件布局,使用長(cháng)度短的信號并遵循信號走線(xiàn)限制,這些接口的抖動(dòng)余地仍然是非常小的。
  • 關(guān)鍵字: 參考時(shí)鐘源  高速串行接口  SERDES  

一種因光纖漂移引起 SERDES FIFO 溢出的解決方案

  • 摘要分布式基站系統中,RRU 通常會(huì )通過(guò)光纖拉遠實(shí)現與 BBU 的遠程互聯(lián)。由于光纖自身的特性,傳輸過(guò)程中必然會(huì )引入抖動(dòng)和漂移;尤其是漂移,因其低頻特性,并且難于濾除,在SERDES 的 FIFO 深度不夠的情況下有可能會(huì )造
  • 關(guān)鍵字: SERDES  FIFO  光纖  方案    

Maxim的SerDes芯片組降低車(chē)內線(xiàn)纜成本和重量

  •   Maxim汽車(chē)解決方案事業(yè)部管理總監Kent?Robinett說(shuō),美國/英國對車(chē)主的調查表明,車(chē)主強烈希望愛(ài)車(chē)配置ADAS(先進(jìn)的駕駛員輔助系統)。但消費者不愿意為目前的ADAS買(mǎi)單?! ☆A計2017年,ADAS系統的市場(chǎng)將增長(cháng)到近9000萬(wàn)套系統?! ∧壳暗奶魬鹬皇牵和ㄟ^(guò)低成本線(xiàn)纜發(fā)送百萬(wàn)像素沒(méi)有經(jīng)過(guò)壓縮的數據,并且還有強大的EMC(電磁兼容)性能?! axim的汽車(chē)互聯(lián)創(chuàng )新始于2003年。2014年4月9日,又推出全新的SerDes芯片組,可大大降低用于信息娛樂(lè )的線(xiàn)纜成本和重量?! ?/li>
  • 關(guān)鍵字: Maxim  SerDes  ADAS  
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serdes介紹

  SERDES 并串行與串并行轉換器,串化器/并化器 A device that serializes output from, and deserializes input to, a business machine.   一種(信號)轉換設備,對商業(yè)計算機的輸出(信號)進(jìn)行并串行(串行化)轉換,而對其輸入(信號)進(jìn)行串并行(解串)轉換。SERializer/DESerializer的縮 [ 查看詳細 ]

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