使用先進(jìn)技術(shù)來(lái)加速SoC驗證

　　模式3各場(chǎng)景仿真性能比較

　　在開(kāi)啟FSDB波形保存的場(chǎng)景三，性能比較如表5所示。

　　(1)關(guān)閉覆蓋率分析

　　Verdi3的并行開(kāi)關(guān)比ALP的并行保存快2%左右，二者性能基本相同?？焖倬幾g會(huì )有2倍以上的編譯時(shí)間減少，總仿真時(shí)間基本相同。并行保存會(huì )帶來(lái)30%+的仿真時(shí)間減少。

　　(2)開(kāi)啟覆蓋率分析

　　快速編譯帶來(lái)大概2.7倍的編譯時(shí)間增益。使用并行覆蓋率收集會(huì )帶來(lái)3倍左右的運行時(shí)間增益。同時(shí)使用2核進(jìn)行并行FSDB保存以及并行覆蓋率收集會(huì )帶來(lái)總仿真時(shí)間18%左右的提升。

　　Debug_pp和Debug_all的比較

　　(1)不做覆蓋率收集

　　從上面圖表中的場(chǎng)景1/2的比較可以看到，使用-debug_pp比使用-debug_all會(huì )帶來(lái)4%~30%左右的性能增益。

　　(2)作覆蓋率收集

　　帶有覆蓋率收集的時(shí)候，可以看到使用debug_pp會(huì )比使用debug_all帶來(lái)8%~10%左右的性能增長(cháng)。

　　結論

　　從在項目中的結果來(lái)看，使用快速編譯選項可以帶來(lái)最大2倍的編譯時(shí)間提升。當我們運行回歸測試時(shí)，如果不做波形保存，快速編譯選項是很好的選擇。

　　并行多核技術(shù)可以對于運行時(shí)間給與很大的性能提升，不管是進(jìn)行VPD波形保存還是FSDB波形保存，使用ALP技術(shù)都能帶來(lái)20%以上的性能提升，性能提升顯著(zhù)。

　　另外基于不同的驗證階段，建議使用不同調試粒度的仿真參數，也可以節省很多的仿真時(shí)間/內存消耗。后繼我們會(huì )考慮使用DLP技術(shù)以及一些更新的有關(guān)performance的工具去嘗試對性能進(jìn)行進(jìn)一步的優(yōu)化。

　　參考文獻：

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