基于Cadence_Allegro的高速PCB設計信號完整性分析與仿真

摘要：信號完整性問(wèn)題已成為當今高速PCB設計的一大挑戰，傳統的設計方法無(wú)法實(shí)現較高的一次設計成功率，急需基于EDA軟件進(jìn)行SI仿真輔助設計的方法以解決此問(wèn)題。在此主要研究了常見(jiàn)反射、串擾、時(shí)序等信號完整性問(wèn)題的基礎理論及解決方法，并基于IBIS模型，采用Ca-dence_Allegro軟件的Specctraquest和Sigxp組件工具對設計的高速14位ADC／DAC應用系統實(shí)例進(jìn)行了SI仿真與分析，驗證了常見(jiàn)SI問(wèn)題解決方法的正確性。
關(guān)鍵詞：高速PCB設計；信號完整性；反射；串擾；時(shí)序；SI分析及仿真

0 引言
隨著(zhù)半導體工藝的迅猛發(fā)展以及人們對信息高速化、寬帶化的需求，高速PCB設計已經(jīng)成為電子產(chǎn)品研制的一個(gè)重要環(huán)節，信號完整性(Signal Integrity，SI)問(wèn)題(包括反射、串擾、定時(shí)等)也逐漸發(fā)展成為高速PCB設計中難以避免的難題，若不能較好地解決信號完整性設計問(wèn)題，將有可能造成高速PCB設計的致命錯誤，浪費財力物力，延長(cháng)開(kāi)發(fā)周期，降低生產(chǎn)效率。
當今較主流的高速PCB設計基于SI仿真，在設計過(guò)程中融入SI分析與仿真指導設計優(yōu)化，能較好地解決SI問(wèn)題，產(chǎn)品首次成功率較傳統設計方法顯著(zhù)提高。目前主流的高速PCB設計EDA工具如Mentor公司的PADS，Cadence公司的Allegro SPB系列都支持SI仿真，且功能強大，為基于SI的高速PCB設計提供了有利條件。對于高速PCB設計者來(lái)說(shuō)，熟悉SI問(wèn)題的基礎理論知識，熟練掌握SI分析及仿真方法，靈活設計信號完整性問(wèn)題的解決方案具有非常重要的意義。
本文主要研究了常見(jiàn)反射、串擾、時(shí)序等信號完整性問(wèn)題的基礎理論及解決方法，并基于IBIS模型，采用Cadence_Allegro軟件的Specc-traquest和Sigxp組件工具對設計的高速14位ADC／DAC應用系統實(shí)例進(jìn)行了SI仿真與分析，驗證了常見(jiàn)SI問(wèn)題解決方法的正確性。

1 常見(jiàn)信號完整性問(wèn)題及解決方法
1．1 常見(jiàn)信號完整性問(wèn)題
信號完整性(Signal Integrity)是指信號未受到損傷的一種狀態(tài)，它表示信號質(zhì)量和信號傳輸后仍保持正確的功能特性。從廣義上講，是指高速產(chǎn)品中由互連引起的所有問(wèn)題，通過(guò)時(shí)序、噪聲、電磁干擾(ENI)3種形式影響高速信號的質(zhì)量，常見(jiàn)的SI問(wèn)題包括反射、串擾、延遲、振鈴、地彈、開(kāi)關(guān)噪聲、電源反彈、衰減等，解決信號完整性問(wèn)題的關(guān)鍵在于對互連線(xiàn)阻抗的認識，很多SI問(wèn)題都與互連阻抗有關(guān)，下文將從互連線(xiàn)阻抗的角度描述反射、串擾、定時(shí)問(wèn)題。
1．2 反射
反射問(wèn)題反映的是由單個(gè)網(wǎng)絡(luò )的信號質(zhì)量，與單個(gè)網(wǎng)絡(luò )的信號路徑及信號返回路徑的物理特性有關(guān)。信號沿單個(gè)網(wǎng)絡(luò )傳播時(shí)，感受到互連線(xiàn)的瞬態(tài)阻抗變化。若信號感受到的互連阻抗保持不變，則保持不失真；若信號感受到互連的阻抗發(fā)生變化，信號在變化處產(chǎn)生反射，則產(chǎn)生失真。引致互連阻抗發(fā)生變化的主要因素有線(xiàn)寬變化、層轉換、返回平面間隙、接插件、分支線(xiàn)、T型線(xiàn)或樁線(xiàn)、網(wǎng)絡(luò )末端。
信號反射、過(guò)沖、振鈴現象都是由阻抗突變引起的。反射的信號量由瞬態(tài)阻抗的變化量決定，將單個(gè)網(wǎng)絡(luò )由突變點(diǎn)劃分為入射前區域1、入射后區域2，兩區域瞬態(tài)阻抗分別為Z1，Z2，則反射信號與入射信號幅度之比為：

式中：Vrefelect為反射電壓；Vincindent為入射電壓；ρ為反射系數。由式(1)可見(jiàn)，若要減小反射，則需減小ρ。具體的方法為：使用可控阻抗互連線(xiàn)；傳輸線(xiàn)末端終端匹配；采用對多分支結構不敏感的布線(xiàn)拓撲結構；最小化傳輸線(xiàn)幾何不連續。對于點(diǎn)對點(diǎn)拓撲，常采用端接(即控制傳輸線(xiàn)一端或兩端的阻抗)的方法減小反射。主要端接方法示意如圖1所示。