基于FPGA的IRIG-B編碼器實(shí)現
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4．2．4 交流調制方法
把按照第4．2．1節方法生成的正弦查找表生成Altera mif文件，再例化一個(gè)M4K ROM，使用上述文件作為ROM的初始化文件。建立一個(gè)周期為10μs的定時(shí)器和一個(gè)地址計數器。地址計數器和定時(shí)器在B碼直流信號的變化沿復位，定時(shí)器溢出后啟動(dòng)地址計數器?；蛘甙堰壿?對應的查找表放在ROM的上半部，如果把邏輯1對應的查找表放在ROM的下半部，且輸入的直流B碼信號作為地址的高位，則此時(shí)刻對應的ROM輸出即為DAC的調制輸出，ROM查找表VHDL的代碼實(shí)現如下：本文引用地址：http://dyxdggzs.com/article/163206.htm
其中：B為來(lái)自編碼器中IRIG-B的直流編碼；AQC為地址計數器；ddata為輸出到DAC的數字調制輸出。由于查找表是按照對正弦信號做100次等間隔采樣形成的，交流載波為1 kHz。所以AQC每隔10μs自加1，順序輸出100個(gè)編碼值，在B碼的每個(gè)變化邊沿復位。
按上述方法設計的數字調制模塊，用示波器測得輸出波形如圖5所示。
圖5中，通道1(從上至下第一個(gè)信號)為M12T輸出的100pps信號PPM12；通道2(從上至下第三個(gè)信號)為IRIG-B的直流編碼輸出信號；通道3(從上至下第二個(gè)脈沖)為從PPM12信號中恢復的每秒脈沖數信號；通道4(最下面的波形)為IRIG-B編碼的交流輸出波形。圖5中示波器的觸發(fā)點(diǎn)即為B碼參考點(diǎn)Pr。
4．3 IRIG-B編碼輸出
4．3．1 直流碼輸出
為了保證輸出信號的邊沿和抗干擾，將第4．1節得到的TTL電平B碼信號和秒脈沖經(jīng)高速光耦隔離，輸出電路如圖6所示。
圖6中，輸入信號IRIG-B為第4．1節所述FPGA編碼模塊輸出的直流編碼信號；pps為FPGA從M12T的100 pps信號中恢復的秒脈沖信號；D350和D351實(shí)現了TTL／RS485的電平轉換。
4．3．2 模擬調制電壓輸出
IRIG-B編碼的交流碼輸出電路如圖6所示。將第4．2．3節所述數字調制信號通過(guò)DAC接口輸出到MAX5712上進(jìn)行D／A轉換，經(jīng)過(guò)AD8601濾除高次諧波后，再用電容耦合到由晶體管Q301構成的電壓放大器中，然后經(jīng)600∶600的隔離變壓器輸出。
5 結 語(yǔ)
利用FPGA和M12T授時(shí)型GPS內核構成的IRIG-B編碼模塊采用M12T的100 pps信號觸發(fā)IRIG-B編碼器，使得編碼輸出的每個(gè)碼元上升沿均與GPS模塊嚴格一致，每個(gè)碼元間隔嚴格相等，而且每個(gè)碼元的上升沿均可作為同步參考點(diǎn)。利用FPGA的并發(fā)處理能力，使得系統實(shí)時(shí)性好。本文介紹的基于查找表的B碼編碼方法和通過(guò)查找表的數字調制方法具有占用資源小，設計簡(jiǎn)單，調制輸出高次諧波小，信號邊沿穩定等特點(diǎn)。
經(jīng)過(guò)軟件仿真和系統測試。本文實(shí)現的B碼編碼器中DC碼參考點(diǎn)Pr和M12T GPS模塊的pps參考點(diǎn)的時(shí)間誤差小于20 ns。與絕對時(shí)間參考點(diǎn)之間的誤差小于40 ns，AC碼與DC碼之間的延遲為100 ns。利用上述方法實(shí)現的模塊已經(jīng)成功地應用在我公司的通信管理機和同步時(shí)間服務(wù)器中，現場(chǎng)運行結果穩定、準確、可靠。
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