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實(shí)現
實(shí)現 文章 進(jìn)入實(shí)現技術(shù)社區
基于FPGA和BU-65170的1553B遠程終端設計與實(shí)現
- 為了滿(mǎn)足載荷與衛星進(jìn)行可靠通信的目的,設計并實(shí)現了基于FPGA和BU-65170協(xié)議芯片的1553B遠程終端。自行設計了用于控制BU-65170的主控制狀態(tài)機,采用16位零等待緩沖接口模式,使用單消息和雙緩沖模式進(jìn)行消息傳輸。創(chuàng )新性地引入RS 422總線(xiàn)與1553B總線(xiàn)進(jìn)行通信,方便測試過(guò)程,結果直觀(guān)可見(jiàn)。采用專(zhuān)用測試板卡Alta ECD54-1553對系統進(jìn)行測試,獲得預期的可靠結果。FPGA取代傳統CPU來(lái)控制1553B通信并集成數據傳輸功能,采用Verilog HDL硬件描述語(yǔ)言有利于軟件移植,縮短
- 關(guān)鍵字: 終端 設計 實(shí)現 遠程 1553B FPGA BU-65170 基于
基于FPGA的FIR數字濾波器設計與實(shí)現
- 簡(jiǎn)要介紹了FIR數字濾波器的結構特點(diǎn)和基本原理,提出基于FPGA和DSP Builder的FIR數字濾波器的基本設計流程和實(shí)現方案。在Mat lab/Simulink環(huán)境下,采用DSP Builder模塊搭建FIR模型,根據FDATool工具對FIR濾波器進(jìn)行了設計,然后進(jìn)行系統級仿真和ModelSim功能仿真,其仿真結果表明其數字濾波器的濾波效果良好。通過(guò)SignalCompiler把模型轉換成VHDL語(yǔ)言加入到FPGA的硬件設計中,從QuartusⅡ軟件中的虛擬邏輯分析工具SignalTapⅡ中得到數
- 關(guān)鍵字: 設計 實(shí)現 濾波器 數字 FPGA FIR 基于
基于FPGA實(shí)現異步串行通信
- 為了適應全數字化自動(dòng)控制更加廣泛的應用,采用現場(chǎng)可編程門(mén)陣列(FPGA)對異步串行通信控制器(UART)進(jìn)行多模塊的系統設計的方法,使串口通信的集成度更高。對UART系統結構進(jìn)行了模塊化分解,可分為三個(gè)模塊:FPGA波特率發(fā)生器控制模塊、FPGA數據發(fā)送模塊及數據接收模塊。采用Venlog語(yǔ)言描述硬件功能,利用Xilinx公司的FPGA芯片,在Xilinx ISE Design Suite 13. 4環(huán)境下進(jìn)行設計、編譯、綜合、下載。采用第三方仿真工具M(jìn)odelSim進(jìn)行模擬仿真。
- 關(guān)鍵字: 串行 通信 異步 實(shí)現 FPGA 基于
基于FPGA的實(shí)時(shí)視頻圖像采集與顯示系統的設計與實(shí)
- 主要針對目前視頻圖像處理發(fā)展的現狀,結合FPGA技術(shù),設計了一個(gè)基于FPGA的實(shí)時(shí)視頻圖像采集與顯示系統。系統采用FPGA作為主控芯片,搭栽專(zhuān)用的編碼解碼芯片進(jìn)行圖像的采集與顯示,主要包括解碼芯片的初始化、編碼芯片的初始化、FPGA圖像采集、PLL設置等幾個(gè)功能模塊。采用FPGA的標準設計流程及一些常用技巧來(lái)對整個(gè)系統進(jìn)行編程。重點(diǎn)在于利用FPFA開(kāi)發(fā)平臺對普通相機輸出的圖像進(jìn)行采集與顯示,最終能在連接的RCA端口顯示屏顯示。
- 關(guān)鍵字: 顯示系統 設計 實(shí)現 采集 圖像 FPGA 實(shí)時(shí) 視頻 基于
實(shí)現介紹
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