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軟件無(wú)線(xiàn)電數字下變頻技術(shù)研究及FPGA實(shí)現
- 在數字下變頻系統實(shí)現方案中，輸入的模擬中頻信號經(jīng)過(guò)高速A/D采樣數字化后與數控振蕩器NCO(Numerically Controlled Osillator)產(chǎn)生的正交本振信號混頻，然后再由抽取濾波模塊進(jìn)行處理，以輸出低速的低頻或基帶信號。本文以軟件無(wú)線(xiàn)電數字下變頻技術(shù)為研究對象，參考GSM系統建立數字下變頻系統。
- 關(guān)鍵字： 數字變頻 軟件無(wú)線(xiàn)電 FPGA
10Gbps線(xiàn)速轉發(fā)引擎的并行流水線(xiàn)設計與實(shí)現
- 設計了一種基于FPGA平臺的并行處理流水線(xiàn)結構，配合高速查表，可支持10Gbps接口的報文轉發(fā)。該設計已應用在國家863計劃重大課題“可擴展到T比特的高性能IPv4/v6路由器基礎平臺及實(shí)驗系統”中,并通過(guò)測試。
- 關(guān)鍵字： 并行流水線(xiàn) 高速查表 FPGA
基于FPGA的雙路可移相任意波形發(fā)生器
- 本文論述了利用用FPGA來(lái)開(kāi)發(fā)DDS函數發(fā)生器的總體設計思路，詳細討論了任意波形產(chǎn)生、頻率精確調整、雙路移相輸出、PWM調制波產(chǎn)生、D/A轉換與濾波電路、鍵盤(pán)與顯示等諸方面軟硬件實(shí)現方法。 整個(gè)設計
- 關(guān)鍵字： DDS 任意波形發(fā)生器 FPGA
一種并行存儲器系統的FPGA實(shí)現
- 圍繞小衛星體積小、重量輕和價(jià)格低廉的特點(diǎn)，一個(gè)多CPU共享內存的系統（CPU仍然采用有相應宇航級器件的8086）將是比較合適的選擇。同時(shí)為了提高共享內存的數據通信帶寬，使其不成為整個(gè)系統的瓶頸，本文提出了一個(gè)用ASIC設計一個(gè)共享總線(xiàn)開(kāi)關(guān)網(wǎng)絡(luò )（簡(jiǎn)稱(chēng)SBSN，下同），組合成Omega網(wǎng)絡(luò )的方案，以消除對某一組內存的總線(xiàn)競爭，實(shí)現多CPU對共享分組存儲系統的低位交叉并行訪(fǎng)問(wèn)。
- 關(guān)鍵字： 并行存儲器 多CPU共享內存 FPGA
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