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高速狀態(tài)下使用CPLD實(shí)現狀態(tài)機的辦法
- 本文給出了采用這些技術(shù)的高速環(huán)境狀態(tài)機設計的規范及分析方法和優(yōu)化方法，并給出了相應的示例。為了使FPGA或CPLD中的狀態(tài)機設計滿(mǎn)足高速環(huán)境要求，設計工程師需要認識到以下幾點(diǎn)：寄存器資源和邏輯資源已經(jīng)不是問(wèn)題
- 關(guān)鍵字： CPLD
Xilinx公司介紹
- Xilinx(賽靈思)是全球領(lǐng)先的可編程邏輯完整解決方案的供應商。Xilinx研發(fā)、制造并銷(xiāo)售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP(Intellectual Property)核?？蛻?hù)使用Xilinx及其合作伙伴的自動(dòng)化軟件工具和IP核對器件進(jìn)行編程，從而完成特定的邏輯操作。Xilinx公司成立于 1984年，Xilinx首創(chuàng )了現場(chǎng)可編程邏輯陣列(FPGA)這一創(chuàng )新性的技術(shù)，并于1985年首次推出商業(yè)化產(chǎn)品。
- 關(guān)鍵字： Xilinx 半導體 CPLD
一種基于計算機總線(xiàn)的CPLD加密電路設計
- 計算機硬件技術(shù)在不斷進(jìn)步，例如CPU的運行速度由初期的216MHz，到如今的1GHz以上，內存由原來(lái)的1Mbit到現在的256512Mbit，這些都給軟件運行提供了良好的環(huán)境，同時(shí)也帶動(dòng)了計算機軟件行業(yè)的大力發(fā)展。隨著(zhù)軟件產(chǎn)品
- 關(guān)鍵字： CPLD 計算機總線(xiàn) 電路設計 加密
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