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Cadence Virtuoso定制IC設計平臺助力WillSemi提升模擬IC設計的穩健性和交付速度

  •   楷登電子(美國Cadence公司)今日宣布,WillSemi采用Cadenceò Virtuosoò 定制集成電路設計平臺,增強了模擬集成電路設計的可靠性,并縮短了產(chǎn)品的總體上市時(shí)間。較此前部署的行業(yè)解決方案,WillSemi采用Cadence定制集成電路設計流程不僅將模擬設計和實(shí)現時(shí)間減半,總設計周期時(shí)間也縮短了三分之一?! adence定制設計流程工具幫助WillSemi集成電路設計團隊實(shí)現了如下目標:  · 采用Virtuoso電路原理圖編輯器與Virtuoso版
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日月光2017年營(yíng)收增長(cháng)12%,預計Q2營(yíng)收將逐季成長(cháng)

  •   封測大廠(chǎng)日月光2月1日召開(kāi)法說(shuō)會(huì ),展望2018年首季營(yíng)運,日月光預期以美元計價(jià)的封測營(yíng)收,將略高于去年同期12.3億美元,毛利率將略高于去年同期的23%。電子代工(EMS)合并營(yíng)收將略低于去年第三季331億元,毛利率將略高于上季9.2%。   2017年日月光集團自結合并營(yíng)收創(chuàng )2904.41億元新臺幣新高,年增6%。毛利率18.2%、營(yíng)益率8.7%,低于前年19.3%、9.7%。歸屬業(yè)主稅后凈利229.88億元新臺幣,年增6%,創(chuàng )歷史次高,受股本膨脹影響,每股盈余2.82元新臺幣,與前年追溯調整后相
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Cadence推出業(yè)界首款PCI Express 5.0驗證IP 現可供貨

  •   楷登電子(美國Cadence 公司)今日宣布,業(yè)界首款支持全新 PCI Express ? (PCIe?)5.0 架構的驗證 IP(VIP)正式可用。結合 TripleCheck? 技術(shù),Cadence? VIP 旨在幫助設計師快速執行基于 PCIe 5.0 標準的服務(wù)器和存儲器的系統級芯片(SoC)設計的完整功能性驗證,確保產(chǎn)品功能符合設計初衷?! ∪缧柽M(jìn)一步了
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Cadence推出業(yè)界首款PCI Express 5.0驗證IP 現可供貨

  •   楷登電子(美國Cadence 公司, NASDAQ:CDNS)今日宣布,業(yè)界首款支持全新 PCI Express ® (PCIe®)5.0 架構的驗證 IP(VIP)正式可用。結合 TripleCheck™ 技術(shù),Cadence® VIP 旨在幫助設計師快速執行基于 PCIe 5.0 標準的服務(wù)器和存儲器的系統級芯片(SoC)設計的完整功能性驗證,確保產(chǎn)品功能符合設計初衷。   如需進(jìn)一步了解基于PCIe 5.0架構并采用TripleCheck技術(shù)的Cadence
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Cadence本土化公司落戶(hù)南京 EDA產(chǎn)業(yè)正發(fā)生什么變化?

  •   中國的半導體產(chǎn)業(yè)持續呈現超過(guò)20%的成長(cháng)率,而全球只有約5%。在中國建立本土化的公司,這對Cadence來(lái)說(shuō)是個(gè)很重要的決定,從一年前開(kāi)始討論這個(gè)問(wèn)題,最后決定選址南京...   2017年11月13日,江蘇南京,Cadence與南京市浦口區人民政府簽署了為建立Cadence (中國)半導體產(chǎn)業(yè)基地的戰略合作備忘錄及中國IC知識產(chǎn)權(IP)開(kāi)發(fā)與服務(wù)平臺的正式投資協(xié)定。   此次簽約儀式受到中國半導體業(yè)界的廣泛關(guān)注,100多位嘉賓現場(chǎng)出席和見(jiàn)證了儀式。   江蘇省省委常委、南京市市委書(shū)記張敬華代
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Cadence落戶(hù)南京市浦口區,成為繼引進(jìn)臺積電后的又一龍頭項目

  •   11月13日,電子設計自動(dòng)化(EDA)與半導體知識產(chǎn)權(IP)的領(lǐng)先供應商美國楷登電子(Cadence)與南京市浦口區人民政府正式簽署戰略合作備忘錄以及投資協(xié)議。據悉,Cadence 項目是南京市浦口區繼引進(jìn)臺積電之后在集成電路設計領(lǐng)域引進(jìn)的又一個(gè)龍頭性項目,歷經(jīng)兩年的洽談,在多方的共同努力下,今天終于簽約落地。   南京市江北新區管委會(huì )常務(wù)副主任、浦口區區委書(shū)記瞿為民先生致辭表示,此次簽約儀式標志著(zhù)南京市浦口區與 Cadence 雙方的戰略投資進(jìn)入實(shí)質(zhì)性階段。南京江北新區是江蘇省唯一的國家級新區,
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Cadence攜手Arm交付首個(gè)基于低功耗、高性能Arm服務(wù)器的SoC驗證解決方案

  •   楷登電子(美國Cadence 公司)今日與Arm聯(lián)合發(fā)布基于A(yíng)rm? 服務(wù)器的Xcelium? 并行邏輯仿真平臺,這是電子行業(yè)內首個(gè)低功耗高性能的仿真解決方案?! ≡谛酒圃熘?, SoC芯片功能正確性驗證占用了整個(gè)項目70%的EDA軟件使用資源,這一需求促進(jìn)了數據中心的增長(cháng)。運行于A(yíng)RM服務(wù)器的Xcelium仿真可帶來(lái)功耗顯著(zhù)降低和仿真容量的顯著(zhù)提升,可執行高吞吐和長(cháng)周期測試,縮減了整個(gè)SoC驗證的時(shí)間和成本?! ∽鳛镃adence驗證套件(Cadence&n
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Cadence優(yōu)化全流程數字與簽核及驗證套裝,支持Arm Cortex-A75、Cortex-A55 CPU及Arm Mali-G72 GPU

  •   楷登電子(美國Cadence公司)今日宣布,其全流程數字簽核工具和Cadence? 驗證套裝的優(yōu)化工作已經(jīng)發(fā)布,支持最新Arm? Cortex?-A75和Cortex-A55 CP,基于A(yíng)rm DynamIQ?技術(shù)的設計,及Arm Mali?-G72 GPU,可廣泛用于最新一代的高端移動(dòng)應用、機器學(xué)習及消費電子類(lèi)芯片。為加速針對Arm最新處理器的設計,Cadence為Cortex-A75和Cortex-A55 CPU量身開(kāi)發(fā)全新7n
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千人盛會(huì )開(kāi)幕,2017 Cadence全球用戶(hù)大會(huì ) CDNLive登陸上海

  •   楷登電子(美國Cadence公司)宣布即將于8月22日(星期二)在上海浦東嘉里大酒店舉辦一年一度的中國用戶(hù)大會(huì )——CDNLive China 2017。以“聯(lián)結,分享,啟發(fā)!”為主題的CDNLive大會(huì )將集聚超過(guò)1000位IC行業(yè)從業(yè)者,包括IC設計工程師、系統開(kāi)發(fā)者與業(yè)界專(zhuān)家,將分享重要半導體設計領(lǐng)域的解決方案和成功經(jīng)驗,讓參與者獲得知識、靈感與動(dòng)力,并為實(shí)現高階半導體芯片、SoC設計和系統挑戰提供解決方案。詳細的會(huì )議信息及報名請瀏覽www.cdnlive.com  CDNLiv
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Cadence推出針對最新移動(dòng)和家庭娛樂(lè )應用的Tensilica HiFi 3z DSP架構

  •   楷登電子(美國 Cadence 公司)今天宣布推出針對最新移動(dòng)和家庭娛樂(lè )應用中系統級芯片(SoC)設計的Cadence? Tensilica? HiFi 3z DSP IP內核 。其應用包括智能手機、增強現實(shí)(AR)/ 3D眼鏡、數字電視和機頂盒(STB)等。比較在業(yè)界音頻DSP內核發(fā)貨量站主導地位的前一代產(chǎn)品HiFi 3 DSP ,新的HiFi 3z架構將可提供超過(guò)1.3
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【E問(wèn)E答】設計自己專(zhuān)用處理器該怎么完成?

  •   做芯片設計的各位,在某個(gè)時(shí)刻,你也許會(huì )產(chǎn)生一個(gè)想法,“為什么不自己設計一個(gè)處理器呢?”或許是手頭的處理器并不好用;或許是想用的處理器貴的離譜;或許是你希望做出差異化的產(chǎn)品;又或者僅僅因為它是個(gè)誘人的挑戰,你想嘗試一下...既然如此,我很高興能和你討論一下怎么完成這個(gè)任務(wù)?! 〗桓段铩 ∥覀兿葟慕Y果說(shuō)起,也就是這項任務(wù)的最終交付物。這里不妨參考ARM處理器核的deliverables。當然,如果只是一個(gè)自己用的專(zhuān)用處理器,不一定要有這么完整的交付物?! ∮布?主要是處理器相關(guān)的RTL代碼,驗證環(huán)境,ED
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Cadence針對Palladium Z1仿真平臺發(fā)布VirtualBridge適配器,軟件初啟時(shí)間最高可縮短三個(gè)月

  •   楷登電子(美國Cadence公司)今日正式發(fā)布全新VirtualBridge?適配器。較傳統RTL仿真,基于虛擬仿真技術(shù)的VirtualBridge?適配器可以加速硅前驗證階段的軟件初啟。同時(shí),VirtualBridge適配器與傳統在線(xiàn)(In-Circuit)仿真應用模式互為補充,通過(guò)Cadence? Palladium? Z1企業(yè)級仿真平臺,可以讓軟件設計師提前3個(gè)月開(kāi)始進(jìn)行硅前軟件驗證工作。如需了解更多內容,請訪(fǎng)問(wèn)www.cadence.com/go/virtualbridge
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全新Cadence Virtuoso系統設計平臺幫助實(shí)現IC、封裝和電路板無(wú)縫集成的設計流程

  •   楷登電子(美國Cadence公司)今日發(fā)布全新Cadence? Virtuoso? System Design Platform(Virtuoso系統設計平臺),結合Cadence Virtuoso平臺與Allegro? 及Sigrity?技術(shù),打造一個(gè)正式的、優(yōu)化的自動(dòng)協(xié)同設計與驗證流程。多項跨平臺技術(shù)的高度集成幫助設計工程師實(shí)現芯片、封裝和電路板的同步和協(xié)同設計。這一過(guò)程在此之前只能通過(guò)手動(dòng)完成,全新Virtuoso系統設計平臺可以實(shí)現流
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Cadence擴展JasperGold平臺用于高級形式化RTL簽核

  •   楷登電子(美國Cadence公司)今日正式發(fā)布JasperGold? 形式驗證平臺擴展版,引入高級形式化驗證技術(shù)的JasperGold Superlint和Clock Domain Crossing (CDC)應用,以滿(mǎn)足JasperGold形式驗證技術(shù)在RTL設計領(lǐng)域的簽核要求。較現有驗證解決方案,Superlint和CDC應用提高了IP設計質(zhì)量,后期RTL變更最高減少80%, IP開(kāi)發(fā)時(shí)間縮短4周。如需了解更多關(guān)于JasperGold技術(shù)
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Cadence數字、簽核與定制/模擬工具助力實(shí)現三星7LPP和8LPP工藝技術(shù)

  •   楷登電子(美國 Cadence 公司) 今日宣布其數字、簽核與定制/模擬工具成功在三星電子公司7LPP和8LPP工藝技術(shù)上實(shí)現。較前代高階工藝節點(diǎn)FinFET技術(shù),7LPP和8LPP工藝技術(shù)不僅進(jìn)一步優(yōu)化了功耗、性能和面積特性,擴展能力也更為出色。目前,客戶(hù)已經(jīng)可以應用下一代技術(shù)開(kāi)始早期設計?! adence定制/模擬、數字和簽核工具全面滿(mǎn)足三星工藝需求,支持實(shí)現7LPP和8LPP工藝技術(shù);三星客戶(hù)可開(kāi)發(fā)各類(lèi)復雜的高階節點(diǎn)設計,充分滿(mǎn)足移動(dòng)市場(chǎng)和其他垂直市場(chǎng)的應用需求。
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