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基于FPGA的通用位同步器設計方案(一)

作者： 時(shí)間：2013-11-05 來(lái)源：網(wǎng)絡(luò ) 收藏
; PADDING-RIGHT: 0px; FONT: 14px/25px 宋體, arial; WHITE-SPACE: normal; ORPHANS: 2; LETTER-SPACING: normal; COLOR: rgb(0,0,0); WORD-SPACING: 0px; PADDING-TOP: 0px; -webkit-text-size-adjust: auto; -webkit-text-stroke-width: 0px">　　根據式（2）和（3），內插濾波器程序實(shí)現結構如圖4所示。

　　從圖4可以看到，該結構由1個(gè)移位器、5個(gè)觸發(fā)器、 8個(gè)相加器、2個(gè)乘法器組成，比直接型FIR節省10個(gè)乘法器、4個(gè)相加器的資源。其中，除以2的運算采用數據移位實(shí)現，避免使用除法器。輸入的8位數據 x，計算后得到10位的內插值y 輸出。由于內部所有寄存器經(jīng)計算后，均采用最小位數，有效地減少了Logic Elements資源的占用。

　　Farrow結構實(shí)現圖

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