基于FPGA和DSP的高速圖像處理系統
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2 系統硬件電路設計
2．1 圖像采集模塊
本系統圖像采集模塊采用的攝像頭為CMOS圖像傳感器，型號為MT9M011。CMOS圖像傳感器與CCD傳感器相比，雖然采集出來(lái)的圖像效果弱差一點(diǎn)，但是CMOS的成本遠遠低于CCD產(chǎn)品，而且CMOS傳感器的功耗較低。圖像采集模塊具體設計如圖2所示。
2．2 圖像顯示模塊
圖像顯示模塊主要作用是將FPGA采集到的數字圖像，實(shí)時(shí)地轉換成模擬圖像數據，并輸出到帶VGA接口的顯示器上。圖像顯示接口電路包括圖像編碼電路和VGA接口電路，其電路如圖3所示。本電路中選用的圖像編碼芯片為AD(Analog Devices)公司的高速視頻數模轉換芯片，其具體型號為ADV7123KST140。該芯片具有3組獨立的十位寬RGB數字輸入接口和3個(gè)相對的RGB模擬輸出接口，5 V或3．3 V供電都行，速度為140 MHz，低功耗。本文引用地址：http://dyxdggzs.com/article/190285.htm
2．3 DSP外部存儲器接口電路設計
本系統中選用TI公司的超低功耗DSP(TMS320VC5502)，主要是來(lái)完成圖像處理算法的實(shí)現。在對外部存儲器接口設計上，該DSP采用外部存儲器接口(EMIF)來(lái)進(jìn)行對外部存儲器的擴展，具體擴展如圖3所示。
TMS320VC5502的EMIF可以訪(fǎng)問(wèn)的存儲空間大小為16 MB，該系統中通過(guò)配置把空間平分為4部分，EMIF的片選信號線(xiàn)CE3～CE0分別對應著(zhù)這4個(gè)空間的選通控制。另外EMIF的組成還包括數據線(xiàn)D[31：0]、地址線(xiàn)A[21：2]、字節使能線(xiàn)：BE[3：0]及各類(lèi)存儲器的讀／寫(xiě)控制信號線(xiàn)等。
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