Flash編程器的FPGA實(shí)現

Flash編程器的關(guān)鍵是要保證Flash地址和數據信號在時(shí)序上的嚴格要求，由SST39SF010的編程和擦除周期時(shí)序參數得知，它的地址或數據信號的建立和保持時(shí)間的最小時(shí)鐘周期僅為30ns。為此，我們采用了40MHz的晶振作為FPGA的驅動(dòng)時(shí)鐘，它的最小時(shí)鐘周期為25ns，完全可滿(mǎn)足最小的時(shí)間周期要求。

采用FPGA來(lái)實(shí)現Flash編程器，主要是如何對Flash進(jìn)行寫(xiě)操作，利用VHDL語(yǔ)言編寫(xiě)的寫(xiě)操作進(jìn)程表示如下：

實(shí)現一個(gè)控制功能，可以用有限狀態(tài)機實(shí)現，也可以用CPU實(shí)現，二者相比，前者性能遠高于后者。因為，在Von Neumann結構的CPU中，需要許多操作（例如取數和執行）和部件（例如數據通路和ALU寄存器）。而狀態(tài)機中，狀態(tài)存儲在多個(gè)觸發(fā)器中，表示行為的代碼存儲在門(mén)級網(wǎng)絡(luò )中。對于通常的一條選擇判斷語(yǔ)句，如果用CPU實(shí)現，一般需要10～20條機器指令，其執行時(shí)間與CPU的速度有關(guān)。如果由門(mén)和觸發(fā)器實(shí)現，則執行時(shí)間為一個(gè)時(shí)鐘周期。因此用VHDL實(shí)現的狀態(tài)機的控制性能要優(yōu)于CPU實(shí)現的方案。

如上述程序，在編程器的寫(xiě)操作進(jìn)程中，我們使用Moore型狀態(tài)機，它最大的特點(diǎn)是輸出僅是狀態(tài)向量的函數，即Moore狀態(tài)機的輸出僅和當前狀態(tài)（現態(tài)）有關(guān)。在寄存器轉移級的有限狀態(tài)機中包括狀態(tài)進(jìn)程和組合進(jìn)程兩部分。

狀態(tài)進(jìn)程：狀態(tài)進(jìn)程對狀態(tài)機的時(shí)鐘信號敏感，當時(shí)鐘發(fā)生有效跳變時(shí)，狀態(tài)機的狀態(tài)發(fā)生變化，由次態(tài)變?yōu)楝F態(tài)。本例中，將寫(xiě)操作分成900個(gè)狀態(tài)，狀態(tài)0初始化各輸出信號，狀態(tài)1～5執行第一個(gè)控制命令，狀態(tài)7—10執行如第二個(gè)控制命令，狀態(tài)12～15執行第三個(gè)控制命令，狀態(tài)17～ 20給出要寫(xiě)入的地址和數據，狀態(tài)21～900保持控制信號，是芯片內部編程時(shí)間。 組合進(jìn)程：組合進(jìn)程就根據當前狀態(tài)（現態(tài)）給輸出信號賦值，并決定下一狀態(tài)（次態(tài)）。在本例中，狀態(tài)機根據不同的狀態(tài)對CE#、OE#、 WE、地址、數據等Flash控制信號進(jìn)行賦值，從而實(shí)現對Flash的控制功能。

但是每執行一次寫(xiě)操作，只能寫(xiě)入一個(gè)地址單元里的8bit數據，如果按照這個(gè)方法，完成整個(gè)Flash芯片1Mbit數據的寫(xiě)入就需要重復執行寫(xiě)操作 128K次，這樣既麻煩又浪費時(shí)間。我們選用的Xilinx公司SpartanⅡ系列FPGA，提供片上雙端口同步讀/寫(xiě)RAM塊，每塊RAM容量為4096bit。塊RAM的每個(gè)端口可獨立配置為讀/寫(xiě)端口、讀端口或寫(xiě)端口，同時(shí)還能配置為任何想要的數據帶寬。因此塊RAM可使FPGA設計者的設計更加簡(jiǎn)單，可以把塊RAM配置成ROM、RAM、FIFO等多種元件，具有使用方便、性能優(yōu)越等特點(diǎn)，是一種十分高效的內部存儲器解決方案。因此我們采用FPGA的塊RAM作為內部數據緩沖器，以提高 Flash寫(xiě)操作的速度和效率。

在本例中，使用內部塊RAM產(chǎn)生一個(gè)32Kbit 的ROM 元件，程序當中直接引用和映射該元件，將要寫(xiě)入Flash的數據先寫(xiě)入該ROM元件中，然后在每次寫(xiě)操作中將ROM中的數據按地址順序逐一寫(xiě)入Flash中的一個(gè)連續32Kbit的扇區當中，這樣編程器的一次寫(xiě)操作就可以寫(xiě)入32Kbit數據，因為32K×32=1Mbit，則依次改變Flash的高5位地址，重復32次上述的寫(xiě)操作，這樣1Mbit的數據就寫(xiě)入了整片Flash中，大大提高了編程器寫(xiě)操作的效率。至于ROM元件中的數據，則以ASCⅡ碼的形式存在以.

CoeGenerator是一個(gè)元件生成軟件，它給用戶(hù)提供了一個(gè)通用化的設計界面，提供RAM、ROM、乘法器、各種標準接口等許多設計中常用的元件模型，這樣設計者不必自己動(dòng)手編寫(xiě)，而采用CoeGenerator即可生成自己需要的各種元件。這些元件都是經(jīng)過(guò)了最優(yōu)化設計，占用資源最少，性能最優(yōu)，還大大節省了設計時(shí)間，方便了設計者。產(chǎn)生的ROM元件將存儲在設計工程之中，需要在程序中加入引用語(yǔ)句，才可以使用。 VHDL程序中使用CoreGenerator產(chǎn)生的元件需要加入兩段語(yǔ)句，一是在實(shí)體部分對要引用的ROM元件進(jìn)行說(shuō)明，二是在結構體中對ROM元件例化，映射例化元件的輸入/輸出信號。 由于FPGA具有在線(xiàn)可再編程性能，因此當系統中FLASH 直接由FPGA存取時(shí)，我們可以用FPGA實(shí)現對Flash的編程，在編程操作之后，對FPGA 進(jìn)行再配置，實(shí)現其它
系統功能，達到一個(gè)FPGA器件實(shí)現多種應用的目的。

4 結束語(yǔ)

使用VHDL語(yǔ)言，由FPGA來(lái)實(shí)現Flash編程器的功能，不僅節約了專(zhuān)用編程器的采購開(kāi)支，更重要的是可以靈活、快速地實(shí)現專(zhuān)用Flash編程器的功能。隨著(zhù)微電子技術(shù)的發(fā)展，可編程器件的容量已經(jīng)達到千萬(wàn)門(mén)級，越來(lái)越多的過(guò)去必須由專(zhuān)用芯片或器件才能完成的工作現在都可以通過(guò)設計軟件，由FPGA來(lái)實(shí)現了。硬件的軟件化已經(jīng)成為電子行業(yè)中不可阻擋的趨勢。