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xilinx fpga 文章 進(jìn)入xilinx fpga技術(shù)社區
一種可靠的FPGA動(dòng)態(tài)配置方法及實(shí)現
- 現場(chǎng)可編程邏輯門(mén)陣列（FPGA）在通信系統中的應用越來(lái)越廣泛。隨著(zhù)通信系統的復雜化和功能多樣化,很多系統需要在不同時(shí)刻實(shí)現不同的功能,多數場(chǎng)合需要FPGA能夠支持在線(xiàn)動(dòng)態(tài)配置;在某些安全領(lǐng)域,需要對FPGA程序進(jìn)行加密存儲、動(dòng)態(tài)升級。這里根據應用趨勢提出了一種基于CPU＋CPLD的可靠的FPGA動(dòng)態(tài)加載方法。該方法具有靈活、安全、可靠的特點(diǎn),在通信電子領(lǐng)域具有一定的參考價(jià)值。
- 關(guān)鍵字： 動(dòng)態(tài)配置 FPGA CPLD
針對FPGA優(yōu)化的高分辨率時(shí)間數字轉換陣列電路
- 介紹一種針對FPGA優(yōu)化的時(shí)間數字轉換陣列電路。利用FPGA片上鎖相環(huán)對全局時(shí)鐘進(jìn)行倍頻與移相，通過(guò)時(shí)鐘狀態(tài)譯碼的方法解決了FPGA中延遲的不確定性問(wèn)題，完成時(shí)間數字轉換的功能。
- 關(guān)鍵字： 時(shí)間數字轉換 鎖相環(huán) FPGA
多項式擬合在log-add算法單元中的應用及其FPGA實(shí)現
- 綜合考慮面積和速度等因素，采用一次多項式擬合實(shí)現了簡(jiǎn)單快速的log-add算法單元。實(shí)驗結果表明，在相同的精度要求下，其FPGA實(shí)現資源占用合理，硬件開(kāi)銷(xiāo)好于其他次數的多項式擬合實(shí)現方案。
- 關(guān)鍵字： log-add算法單元 多項式擬合 FPGA
Canny算法的改進(jìn)及FPGA實(shí)現
- 通過(guò)對傳統Canny邊緣檢測算法的分析提出了相應的改進(jìn)方法。通過(guò)模板代替卷積、適當的近似變換、充分利用并行處理單元等使其能夠用FPGA實(shí)現。
- 關(guān)鍵字： Canny邊緣檢測算法 卷積 FPGA
基于FPGA的三相PWM發(fā)生器
- 介紹了基于FPGA設計的三相PWM發(fā)生器。該發(fā)生器具有靈活和可編程等優(yōu)點(diǎn),可應用于交流電機驅動(dòng)用的三相電壓源逆變器。實(shí)驗結果驗證了本設計的有效性。
- 關(guān)鍵字： PWM發(fā)生器 三相逆變器 FPGA
基于FPGA的雙振蕩電路定時(shí)器設計
- 考慮沖擊環(huán)境下定時(shí)器會(huì )遇到的問(wèn)題,并分析了單一的晶體振蕩器和諧振振蕩器都不能很好地滿(mǎn)足抗沖擊性和高精度兩方面要求,因此提出了一種基于FPGA設計的雙振蕩定時(shí)器。此定時(shí)器能有效地解決爆破作業(yè)中延時(shí)雷管起爆精度和抗沖擊性能之間的矛盾。更主要的是CPLD的時(shí)序比集成芯片更加容易控制。在FPGA實(shí)現,該設計的定時(shí)精度達到納秒級,很好地滿(mǎn)足系統性能要求。本方法具有結構簡(jiǎn)單、成本低、可靠性高、精度高等優(yōu)點(diǎn)。
- 關(guān)鍵字： 定時(shí)器 納秒級 FPGA
獨立式多分辨率VGA/DVI壓縮存儲系統
- 一種獨立式多分辨率VGA/DVI壓縮存儲系統，該系統支持VGA/DVI輸入，同時(shí)支持SVGA、XGA、SXGA、UXGA、1080p等任意分辨率圖像的連續壓縮和存儲。在100 MHz時(shí)鐘頻率下，系統可以對圖像SXGA和UXGA實(shí)時(shí)壓縮為(25幀/s)和(17幀/s)。實(shí)驗表明，在不同碼率下，系統的單幀圖像壓縮性能與JPEG2000標準近似，PSNR值優(yōu)于JPEG標準。
- 關(guān)鍵字： VGA/DVI壓縮存儲系統 圖像壓縮 FPGA
基于歐氏算法的RS硬件解碼方案的FPGA實(shí)現
- 在通信系統中應用廣泛。由于RS碼的譯碼復雜度高，數字運算量大，常見(jiàn)的硬件及軟件譯碼方案大多不能滿(mǎn)足高速率的傳輸需求，一般適用于10Mbps以下。本文提出的歐氏算法和頻譜結構分析相結合的RS硬件解碼方案，適用于FPGA單片實(shí)現，速率高、延遲小、通用性強、使用靈活。筆者在FPGA芯片上實(shí)現了GF（2 8）上符號速率為50Mbps的流式解碼方案，最大延時(shí)為640ns，參數可以根據需要靈活設置。
- 關(guān)鍵字： RS編譯碼 差錯控制編碼技術(shù) FPGA
一種改進(jìn)型surendra背景更新算法的FPGA實(shí)現
- 針對現有的動(dòng)態(tài)背景提取運動(dòng)目標物體算法復雜且難以在硬件上實(shí)現的問(wèn)題，研究了改進(jìn)型surendra背景更新算法原理的特點(diǎn)，提出了改進(jìn)型surendra背景更新算法的硬件結構，并對硬件結構進(jìn)行綜合、仿真后，在FPGA芯片上實(shí)現。
- 關(guān)鍵字： 運動(dòng)目標提取 surendra背景更新算法 FPGA
基于FPGA+DSP的智能車(chē)全景視覺(jué)系統
- 為實(shí)現智能車(chē)全景視覺(jué)系統的應用研究平臺，設計了一種基于FPGA+雙DSP的實(shí)時(shí)6通道數字圖像采集與處理系統。該系統由兩片FPGA與兩個(gè)DSP組成。第一個(gè)FPGA進(jìn)行多通道視覺(jué)圖像采集的同步控制、邏輯處理，第二片FPGA輔助DSP進(jìn)行海量圖像數據的高速并行處理。
- 關(guān)鍵字： 全景視覺(jué)系統 FPGA+DSP 數字圖像采集與處理系統
基于FPGA的嵌入式圖像監控系統設計
- 本文主要完成了嵌入式圖像監控系統的設計，該系統克服了模擬圖像監控技術(shù)具有的弊端，在普通家庭、臨時(shí)性作業(yè)場(chǎng)所中具有很強的應用前景。這些領(lǐng)域一般對視頻傳輸指標的要求不一定很高，但要求便于攜帶，同時(shí)功耗較小(例如臨時(shí)性場(chǎng)合等)，具有體積小、功耗低、成本低、速度快、穩定性好等特點(diǎn)，可以有效地克服傳統的基于計算機的監控系統的缺點(diǎn)。系統可做為一個(gè)智能部件“嵌入”到各種應用系統中，如將其配上網(wǎng)絡(luò )接口接上計算機系統，即可構成一個(gè)監控網(wǎng)絡(luò )系統，是一種相對獨立的OEM部件。
- 關(guān)鍵字： 圖像監控系統 NiosII FPGA
xilinx fpga介紹
Xilinx FPGA
Xilinx FPGA主要分為兩大類(lèi)，一種側重低成本應用，容量中等，性能可以滿(mǎn)足一般的邏輯設計要求，如Spartan系列；還有一種側重于高性能應用，容量大，性能能滿(mǎn)足各類(lèi)高端應用，如Virtex系列，用戶(hù)可以根據自己實(shí)際應用要求進(jìn)行選擇。 在性能可以滿(mǎn)足的情況下，優(yōu)先選擇低成本器件。
Xilinx FPGA可編程邏輯解決方案縮短了電子設備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細 ]
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