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xilinx fpga 文章 進(jìn)入xilinx fpga技術(shù)社區
基于FPGA的毫米波多目標信號形成技術(shù)的研究
- 毫米波多目標信號發(fā)生器通過(guò)模擬的方法產(chǎn)生多種類(lèi)型高精度的雷達多目標回波信號，在實(shí)際雷達系統前端不具備的條件下對雷達系統后級進(jìn)行調試，便于制導武器的性能測試，大大加快新武器的研制進(jìn)程。毫米波多目標信號產(chǎn)生的關(guān)鍵是要求回波信號距離分辨率極高，常規的多目標信號產(chǎn)生方法如使用數字延時(shí)線(xiàn)產(chǎn)生多目標之間的延時(shí)，其控制不靈活，并且有些延時(shí)線(xiàn)需要接ECL電源，使用不方便也增加了設計的復雜度。使用分立元件實(shí)現延時(shí)則使電路元件過(guò)多，電路的穩定性及延時(shí)的精確性也會(huì )大大降低。本文介紹一種新的產(chǎn)生毫米波雷達模擬器的多目標信號的方法
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大型設計中FPGA的多時(shí)鐘策略
- 利用FPGA 實(shí)現大型設計時(shí)，可能需要FPGA 具有以多個(gè)時(shí)鐘運行的多重數據通路，這種多時(shí)鐘FPGA 設計必須特別小心，需要注意最大時(shí)鐘速率、抖動(dòng)、最大時(shí)鐘數、異步時(shí)鐘設計和時(shí)鐘/數據關(guān)系。設計過(guò)程中最重要的一步是確定要用多少個(gè)不同的時(shí)鐘，以及如何進(jìn)行布線(xiàn)，本文將對這些設計策略深入闡述。 FPGA 設計的第一步是決定需要什么樣的時(shí)鐘速率，設計中最快的時(shí)鐘將確定FPGA 必須能處理的時(shí)鐘速率。最快時(shí)鐘速率由設計中兩個(gè)觸發(fā)器之間一個(gè)信號的傳輸時(shí)間P 來(lái)決定，如果P 大于時(shí)鐘周期T，則當信號在一個(gè)觸發(fā)
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自適應算術(shù)編碼的FPGA實(shí)現
- 算術(shù)編碼是一種無(wú)失真的編碼方法，能有效地壓縮信源冗余度，屬于熵編碼的一種。算術(shù)編碼的一個(gè)重要特點(diǎn)就是可以按分數比特逼近信源熵，突破了Haffman編碼每個(gè)符號只不過(guò)能按整數個(gè)比特逼近信源熵的限制。對信源進(jìn)行算術(shù)編碼，往往需要兩個(gè)過(guò)程，第一個(gè)過(guò)程是建立信源概率表，第二個(gè)過(guò)程是對信源發(fā)出的符號序列進(jìn)行掃描編碼。而自適應算術(shù)編碼在對符號序列進(jìn)行掃描的過(guò)程中，可一次完成上述兩個(gè)過(guò)程，即根據恰當的概率估計模型和當前符號序列中各符號出現的頻率，自適應地調整各符號的概率估計值，同時(shí)完成編碼。盡管從編碼效率上看不如已
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基于C的設計方式簡(jiǎn)化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設計
- 基于C的設計方式簡(jiǎn)化FPGA/協(xié)處理器混合平臺軟硬件協(xié)同設計 在最近幾年中日益流行在高性能嵌入式應用中使用現場(chǎng)可編程門(mén)陣列（FPGA）。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù)，從相對簡(jiǎn)單的控制功能到更加復雜的算法操作。雖然FPGA在某些功能上比設計專(zhuān)用ASIC硬件具有時(shí)間和成本上的優(yōu)勢，但在面向軟件應用中FPGA比傳統處理器和DSP的優(yōu)勢并沒(méi)有體現出來(lái)。這很大程度上是由于過(guò)去割裂了硬件和軟件開(kāi)發(fā)工具和方法之間的關(guān)系?！ ∪欢罱麱PGA在面向軟件設計工具方面的發(fā)展，及器件容量的持續增
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FPGA紅了，工具廠(chǎng)商笑了
- FPGA紅了，工具廠(chǎng)商笑了Cool FPGAs Make Tool Vendors Laugh據Gartner Dataquest在去年美國DAC(設計自動(dòng)化年會(huì ))期間公布的數據，每年采用ASIC開(kāi)始進(jìn)行設計的數量在逐年下降，取而代之的是ASSP（特殊應用標準產(chǎn)品），如圖1。由于深亞微米（DSM）制程以后，ASIC的開(kāi)發(fā)成本不斷上升，因此標準產(chǎn)品中的FPGA是理想的選擇之一（如圖2）。FPGA的應用領(lǐng)域不斷擴大，未來(lái)，消費電子（例如HDTV、無(wú)線(xiàn)路由器）和汽車(chē)電子是所有應用中成長(cháng)最快的（如圖3）。人們期盼
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平臺 FPGA 的發(fā)展帶來(lái)了什么？
- 平臺 FPGA 的發(fā)展帶來(lái)了什么？ Will The Evolution of Platform FPGAs? 當今多平臺 FPGA 動(dòng)搖 ASIC/ASSP 供應商。 作者 Richard Sevcik 賽靈思公司可編程邏輯系統與知識產(chǎn)權/內核及軟件解決方案部執行副總裁 有關(guān) FPGA 是否是 ASIC 和 ASSP 可行替代品的爭論已經(jīng)持續了近十年。iSupply、Gartner Dataquest 及其它業(yè)界分析師的研究表明當前正處在 ASIC 設計新客戶(hù)不斷減少，FPGA 設計新客戶(hù)
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XILINX 向客戶(hù)發(fā)貨具有業(yè)界首個(gè) 622Mbps - 10.3125Gbps 串行收發(fā)器的 VIRTEX-4 FX60 FPGA
- 2005 年 6 月 30 日，中國北京 – 賽靈思公司 (NASDAQ:XLNX) 今天宣布向客戶(hù)發(fā)貨首批帶有集成 622Mbps – 10.3125Gbps 串行收發(fā)器的 Virtex™-4 FX60 90nm FPGA，該款 FPGA 可比業(yè)界其他競爭高速串行 I/O 解決方案提供更佳的設計余量和靈活性。賽靈思設計 Virtex-4 RocketIO 收發(fā)器旨在為客戶(hù)提供充分的高端性能和最多的設計余量。對于運行速度低于 10.3125Gbps 的設計，它可保證設計人員在需要時(shí)獲得更高帶寬
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XILINX新MICROBLAZE 軟處理器提高時(shí)鐘頻率達25%
- MicroBlaze 4.00具有緊密耦合的浮點(diǎn)單元選項 2005年6月16日，中國北京 - 賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）今天宣布推出性能優(yōu)化的MicroBlaze™ 軟處理器4.00版?，F在，MicroBlaze™ 軟處理器在Virtex™-4 FPGA中的工作頻率可達到200 MHz，核心性能比前一版本提高多達25%。此外，新的浮點(diǎn)單元（F
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XILINX通過(guò)ISO/TS 16949汽車(chē)行業(yè)標準認證進(jìn)一步提升產(chǎn)品質(zhì)量領(lǐng)導地位
- 執行積極的產(chǎn)品質(zhì)量發(fā)展路線(xiàn)圖，唯一一家完全獲得ISO 9001、TL 9000、QML、ISO 14001和ISO/TS 16949質(zhì)量標準認證的PLD供應商全球領(lǐng)先的可編程邏輯解決方案供應商賽靈思公司（NASDAQ:XLNX）今天宣布獲得汽車(chē)行業(yè)質(zhì)量標準ISO/TS 16949認證。ISO/TS 16949標準使賽靈思公司能夠為整個(gè)汽車(chē)供應鏈提供質(zhì)量和可靠性最高的電子元器件。賽靈思公司在此之前已經(jīng)滿(mǎn)足了其它世界級質(zhì)量標準的嚴格要求，包括ISO 9001、TL 9000和QML。"賽靈思認為符合ISO/T
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XILINX通過(guò)ISO/TS 16949汽車(chē)行業(yè)標準認證
- 進(jìn)一步提升產(chǎn)品質(zhì)量領(lǐng)導地位 執行積極的產(chǎn)品質(zhì)量發(fā)展路線(xiàn)圖，唯一一家完全獲得ISO 9001、TL 9000、QML、ISO 14001和ISO/TS 16949質(zhì)量標準認證的PLD供應商 2005年6月8日，中國北京 - 全球領(lǐng)先的可編程邏輯解決方案供應商賽靈思公司（NASDAQ:XLNX）今天宣布獲得汽車(chē)行業(yè)質(zhì)量標準ISO/TS 16949認證。ISO/TS 16949標準使賽靈思公司能夠為整個(gè)汽車(chē)供應鏈提供質(zhì)量和可靠性最高的電子元器件。賽靈思公司在此之前已經(jīng)滿(mǎn)足了其
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Xilinx FPGA
Xilinx FPGA主要分為兩大類(lèi)，一種側重低成本應用，容量中等，性能可以滿(mǎn)足一般的邏輯設計要求，如Spartan系列；還有一種側重于高性能應用，容量大，性能能滿(mǎn)足各類(lèi)高端應用，如Virtex系列，用戶(hù)可以根據自己實(shí)際應用要求進(jìn)行選擇。 在性能可以滿(mǎn)足的情況下，優(yōu)先選擇低成本器件。
Xilinx FPGA可編程邏輯解決方案縮短了電子設備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細 ]
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