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用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程
- 用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程,用VHDL/VerilogHD語(yǔ)言開(kāi)發(fā)PLD/FPGA的完整流程為: 1.文本編輯:用任何文本編輯器都可以進(jìn)行,也可以用專(zhuān)用的HDL編輯環(huán)境。通常VHDL文件保存為.vhd文件,Verilog文件保存為.v文件 2.功能仿真:將文件調入HDL仿真
- 關(guān)鍵字: 完整 流程 PLD/FPGA 開(kāi)發(fā) 語(yǔ)言 VHDL/VerilogHD
基于PLD與AVR總線(xiàn)通信接口VHDL設計與實(shí)現
- 1、引言嵌入式系統在日常生活中的大量使用,人們也對其性能和速度提出了更高的要求。微控制器和可編程邏輯器 ...
- 關(guān)鍵字: PLD AVR 總線(xiàn)通信 VHDL
pld介紹
一、概述
PLD(programmable logic device)--可編程邏輯器件:PLD是做為一種通用集成電路生產(chǎn)的,他的邏輯功能按照用戶(hù)對器件編程來(lái)高定。一般的PLD的集成度很高,足以滿(mǎn)足設計一般的數字系統的需要。這樣就可以由設計人員自行編程而把一個(gè)數字系統“集成”在一片PLD上,而不必去請芯片制造廠(chǎng)商設計和制作專(zhuān)用的集成電路芯片了。
二、分類(lèi)
目前和平和使用的P [ 查看詳細 ]
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