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基于CPLD的移相全橋軟開(kāi)關(guān)電源數字控制器
- 1引言近年來(lái)，隨著(zhù)大功率開(kāi)關(guān)電源的發(fā)展，對控制器的要求越來(lái)越高，開(kāi)關(guān)電源的數字化和智能化也將成為...
- 關(guān)鍵字： CPLD DSP FPGA 開(kāi)關(guān)電源控制器
基于CPLD的直流無(wú)刷電機驅動(dòng)電路設計
- 直流無(wú)刷電機廣泛應用于計算機外圍設備、數控機床、機器人、伺服系統、汽車(chē)、家電等領(lǐng)域。本文介紹的電機驅動(dòng)電路就是某穩定平臺的角度伺服控制回路的驅動(dòng)部分。本文中設計的基于CPLD的電機驅動(dòng)電路，充分利用cPLD的硬件可編程和實(shí)現邏輯運算方便的特點(diǎn)，用一片CPLD代替原有十幾片邏輯門(mén)和一部分模擬電路。采用VHDL語(yǔ)言編程實(shí)現相關(guān)邏輯。利用CPLD在線(xiàn)可編程的特點(diǎn)，可以很方便的對系統進(jìn)行調試。 1 無(wú)刷直流電機的驅動(dòng)原理 直流無(wú)刷電動(dòng)機是由電動(dòng)機本體、轉子位置傳感器和電子開(kāi)關(guān)電路組成一個(gè)閉環(huán)系統。與一
- 關(guān)鍵字： CPLD
基于CPLD和89S51的多功能信號測量?jì)x
- 1 引言 測頻是最基本的電子測量技術(shù)。常用的測頻方法有較大的局限性，其測量精度是隨被測信號頻率的下降而降低的，并且被測信號計數則產(chǎn)生±1個(gè)數字誤差。而采用等精度頻率測量方法測量精確，測量精度保持恒定；并且與CPLD(復雜可編程邏輯器件)相結合可使測頻范圍達到0.1 Hz～100 MHz，測頻全域相對誤差恒為1／1000。 智能化儀器通常以單片機為核心，而一般單片機自身計數器／定時(shí)器的計數／定時(shí)范圍或精度有時(shí)無(wú)法滿(mǎn)足系統要求。以89C51單片機為例，當其內部?jì)蓚€(gè)16位計數器／定時(shí)器
- 關(guān)鍵字： CPLD
基于MCU+CPLD的相位差和頻率的測量方法研究及實(shí)現
- 關(guān)鍵字： 測試 測量 CPLD MCU
2008年9月26日，派睿與Altera簽署亞太地區分銷(xiāo)協(xié)議
- 全球領(lǐng)先的多渠道、提供高品質(zhì)服務(wù)的電子元器件分銷(xiāo)商派睿電子日前宣布其姊妹公司Farnell-Newark與Altera® 公司簽署亞太地區分銷(xiāo)協(xié)議，在中國大陸、香港、臺灣地區、新加坡、印尼、馬來(lái)西亞、菲律賓、越南、泰國、文萊、老撾、緬甸、柬埔寨和印度等國家和地區提供庫存和本地技術(shù)支持。派睿電子將對Altera全線(xiàn)產(chǎn)品在大中華區的展開(kāi)分銷(xiāo)業(yè)務(wù)，為中國本土工程師提供最領(lǐng)先的FPGA技術(shù)。 派睿電子將通過(guò)其多渠道分銷(xiāo)模式提供全線(xiàn)的Altera® FPGA和CPLD設備和開(kāi)發(fā)工具包，包括
- 關(guān)鍵字： Altera FPGA CPLD
派睿電子攜手Altera，助力中國電子設計工程師提升FPGA設計能力
- 電子元器件分銷(xiāo)商派睿電子日前宣布其姊妹公司Farnell-Newark與Altera 公司簽署亞太地區分銷(xiāo)協(xié)議，在中國大陸、香港、臺灣地區、新加坡、印尼、馬來(lái)西亞、菲律賓、越南、泰國、文萊、老撾、緬甸、柬埔寨和印度等國家和地區提供庫存和本地技術(shù)支持。派睿電子將對Altera全線(xiàn)產(chǎn)品在大中華區展開(kāi)分銷(xiāo)業(yè)務(wù)，為中國本土工程師提供最領(lǐng)先的FPGA技術(shù)。 派睿電子將通過(guò)其多渠道分銷(xiāo)模式提供全線(xiàn)的Altera FPGA和CPLD設備和開(kāi)發(fā)工具包，包括高密度、高性能的Stratix FPGA系列、低成本的C
- 關(guān)鍵字： 派睿電子 Altera FPGA CPLD
基于CPLD的電器定時(shí)開(kāi)關(guān)控制系統設計
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò )家園
- 關(guān)鍵字： 電器 開(kāi)關(guān) CPLD 控制
基于單片機和CPLD的數字頻率計的設計
- 引言 在傳統的控制系統中，通常將單片機作為控制核心并輔以相應的元器件構成一個(gè)整體。但這種方法硬件連線(xiàn)復雜、可靠性差，且在實(shí)際應用中往往需要外加擴展芯片，這無(wú)疑會(huì )增大控制系統的體積，還會(huì )增加引入干擾的可能性。對一些體積小的控制系統，要求以盡可能小的器件體積實(shí)現盡可能復雜的控制功能，直接應用單片機及其擴展芯片就難以達到所期望的效果。 復雜可編程邏輯器件（CPLD）具有集成度高、運算速度快、開(kāi)發(fā)周期短等特點(diǎn)，它的出現，改變了數字電路的設計方法、增強了設計的靈活性?；诖?，本文提出了一種采用Alt
- 關(guān)鍵字： CPLD 開(kāi)發(fā)環(huán)境 單片機 元器件 VHDL ASIC
基于TMS320F2812的視頻圖像采集系統的設計
- 快速發(fā)展的汽車(chē)產(chǎn)業(yè)為車(chē)載電子產(chǎn)品提供了廣闊的應用市場(chǎng)，如車(chē)載的“紅外監視”、“倒車(chē)雷達”等視頻監視設備，為駕駛員既帶來(lái)了方便，也帶來(lái)了安全。這些監視設備離不開(kāi)視頻圖像采集，而視頻圖像采集的關(guān)鍵環(huán)節就是視頻信號的AD轉換。傳統的視頻圖像采集系統一般采用專(zhuān)門(mén)的圖像采集芯片，如SAA7110視頻解碼芯片，自動(dòng)完成圖像的采集；缺點(diǎn)是電路復雜、成本高，不方便對其進(jìn)行軟件編程和升級，進(jìn)而其采集圖像的精度和速度也受到制約，對非標準視頻信號適應性不好。 本設計采用
- 關(guān)鍵字： DSP ADC CPLD 視頻監視
采用EEPROM對大容量FPGA芯片數據實(shí)現串行加載
- 自大規?，F場(chǎng)可編程邏輯器件問(wèn)世以來(lái)，先后出現了兩類(lèi)器件，一類(lèi)是基于SRAM體系結構的FPGA系列，如XILINX公司的4000系列和最新的Virtex系列；另一類(lèi)是基于faxtFLASH技術(shù)的CPLD器件，如XILINX公司的9500系列和Lattice公司的ispLSxx系列芯片。FPGA具有容量大、設計資源豐富、片內ROM及RAM設計靈活等特點(diǎn)1，但是它們需要在每次上電時(shí)進(jìn)行數據加載。目前實(shí)現加載的方法有以下三種：①采用PROM并行加載；②采用專(zhuān)用SROM串行加載；③采用單片機控制實(shí)現加載。
- 關(guān)鍵字： FPGA XILINX CPLD 數據加載 EEPROM
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