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有限狀態(tài)機的FPGA設計
- 有限狀態(tài)機是一種常見(jiàn)的電路，由于時(shí)序電路和組合電路組成，設計有限狀態(tài)機的第一步是確定采用Moore狀態(tài)機還是采用Mealy狀態(tài)機。Mealy狀態(tài)機的狀態(tài)轉變不僅和當前狀態(tài)有關(guān)，而且和各輸入信號有關(guān)；Moore狀態(tài)機的轉變只和當前狀態(tài)有關(guān)。從電路實(shí)現功能上來(lái)講，任何一種都可以實(shí)現同樣的功能。但他們的輸出時(shí)序不同，所以選擇使用哪種狀態(tài)機是要根據具體情況來(lái)定。
- 關(guān)鍵字： Moore狀態(tài)機 Mealy狀態(tài)機 FPGA
H.264/AVC中CAVLC編碼器的硬件設計與實(shí)現
- 設計了一種H.264標準的CAVLC編碼器，對原有軟件流程進(jìn)行部分改進(jìn)，提出了并行處理各編碼子模塊的算法結構。
- 關(guān)鍵字： 變長(cháng)編碼 非零系數級編碼 FPGA
基于FPGA的帶Cache的嵌入式CPU的設計與實(shí)現
- MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統領(lǐng)域中得到廣泛的應用。MIPS32TM指令集開(kāi)放，指令格式規整，易于流水線(xiàn)設計，大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比，RISC具有設計更簡(jiǎn)單、設計周期更短等優(yōu)點(diǎn)，并可以應用更多先進(jìn)的技術(shù)，開(kāi)發(fā)更快的下一代處理器。
- 關(guān)鍵字： 流水線(xiàn)CPU 時(shí)序設計 FPGA
利用FPGA實(shí)現外設通信接口之： 典型實(shí)例-字符LCD接口的設計與實(shí)現
- 本節旨在設計實(shí)現FPGA與字符LCD的接口，幫助讀者進(jìn)一步了解字符液晶的工作原理和設計方法。
- 關(guān)鍵字： 字符LCD接口 char_ram模塊 FPGA ModelSim
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