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多核處理器可替代FPGA

  • Peter認為,鑒于其高性能、易編程及低成本特點(diǎn),GPGPU技術(shù)在許多情況下能夠替代FPGA和DSP。盡管沒(méi)有針腳,諸如圖形處理器(GPU)和Tilera處理器等多核處理器在某些應用中正逐步替代現場(chǎng)可編程門(mén)陳列(FPGA)。開(kāi)發(fā)人員表
  • 關(guān)鍵字: FPGA  處理能力  圖形處理器  

基于雙麥克風(fēng)聲源定位的視頻跟蹤

  • 摘要:聲源定位跟蹤技術(shù)在當今社會(huì )有著(zhù)越來(lái)越廣泛的應用。在此使用兩個(gè)高靈敏度麥克風(fēng)作為傳感器,配以音頻信號處理芯片,接收音頻信號并進(jìn)行模數轉換,使用FPGA器件作為核心控制器,結合TDOA算法和ILD算法,實(shí)現在室
  • 關(guān)鍵字: 雙麥克風(fēng)  聲源定位  FPGA  NiosⅡ  

嵌入式系統的自適應前照燈系統設計

  • 摘要:為了改善駕駛員在夜間或能見(jiàn)度較低環(huán)境下的視野范圍,提高行駛的安全性,介紹了一種基于嵌入式系統的汽車(chē)自適應前照燈系統的設計方案。此系統中的前照燈控制器采用FPGA來(lái)控制CAN總線(xiàn)控制器、數/模轉換器和全橋
  • 關(guān)鍵字: 步進(jìn)電機  FPGA  MCP2510  LMD18245  

單片機,ARM,FPGA,嵌入式這些有什么區別,各自特點(diǎn)是什么?

  • 單片機的特點(diǎn):(1)受集成度限制,片內存儲器容量較小,一般內ROM:8KB以下;(2)內RAM:256KB以?xún)取?3)可靠性高(4)易擴展(5)控制功能強(6)易于開(kāi)發(fā)ARM的特點(diǎn):(1) 自帶廉價(jià)的程序存儲器(FLASH)和非易失的數據存儲器(E
  • 關(guān)鍵字: 單片機  嵌入式  FPGA  ARM  

基于CPLD的FPGA從并快速加載方案

  • 現場(chǎng)可編程門(mén)陣列(FPGA)作為專(zhuān)用集成電路(ASIC)領(lǐng)域的一種半定制電路,可以根據設計的需要靈活實(shí)現各種接口或者總線(xiàn)的輸出,在設備端的通信產(chǎn)品中已得到越來(lái)越廣泛的使用。FPGA 是基于靜態(tài)隨機存儲器(SRAM)結構的,
  • 關(guān)鍵字: FPGA    CPLD    控制器    從并    加載  

基于FPGA的多路視頻收發(fā)系統的設計與實(shí)現

  • 摘要:為了實(shí)現對多路視頻和數據信號的同步傳輸,提出了一種基于FPGA的視頻數據綜合傳輸系統設計方案,并完成系統的軟硬件設計。該系統的硬件部分主要由FPGA、CPLD芯片及光模塊等設備組成,軟件部分采用VHDL語(yǔ)言進(jìn)行
  • 關(guān)鍵字: 視頻傳輸  FPGA  數據傳輸  光模塊  

智原發(fā)表PowerSlash(TM)硅智財于聯(lián)電55奈米超低功耗製程支援物聯(lián)網(wǎng)應用開(kāi)發(fā)

  •   聯(lián)華電子今(12日)與ASIC設計服務(wù)暨IP研發(fā)銷(xiāo)售廠(chǎng)商智原科技(Faraday Technology Corporation,TWSE:3035)共同發(fā)表智原科技于聯(lián)電55奈米超低功耗製程(55ULP)的PowerSlash™基礎IP方案。智原PowerSlash™與聯(lián)電製程技術(shù)相互結合設計,為超低功耗的無(wú)線(xiàn)應用需求技術(shù)進(jìn)行優(yōu)化,滿(mǎn)足無(wú)線(xiàn)物聯(lián)網(wǎng)產(chǎn)品的電池長(cháng)期壽命需求。   智原科技行銷(xiāo)暨投資副總于德旬表示:「物聯(lián)網(wǎng)應用建構過(guò)程中,效能往往受制于低功耗技術(shù)。而今透過(guò)聯(lián)電55奈
  • 關(guān)鍵字: 聯(lián)華電子  ASIC  

FPGA實(shí)現的FIR算法在汽車(chē)動(dòng)態(tài)稱(chēng)重儀中的應用

  •   引言   車(chē)輛在動(dòng)態(tài)稱(chēng)重時(shí),作用在平臺上的力除真實(shí)軸重外,還有許多因素產(chǎn)生的干擾力,如:車(chē)速、車(chē)輛自身諧振、路面激勵、輪胎驅動(dòng)力等,給動(dòng)態(tài)稱(chēng)重實(shí)現高精度測量造成很大困難。若在消除干擾的過(guò)程中采用模擬方法濾波,參數則不能過(guò)大,否則將產(chǎn)生過(guò)大的延遲導致不能實(shí)現實(shí)時(shí)處理,從而造成濾波后的信號仍然含有相當一部分的噪聲。所以必須采用數字濾波消除干擾。   FIR濾波的原理及實(shí)現   本文采用FIR數字濾波,其原理如公式1所示。   Y(n)= (1)   其中h(k)為系統濾波參數,x(n)為采集的信
  • 關(guān)鍵字: FPGA  FIR  

基于USB2.0協(xié)議的通用測控通信接口設計

  • 隨著(zhù)我國航空航天技術(shù)的迅速發(fā)展,對地面遙控遙測接收機的實(shí)時(shí)性和高速數據傳輸性能的要求越來(lái)越高。越來(lái)越多的遙測遙控地面信道處理器都采用了實(shí)時(shí)能力更強的高速DSP/FPGA架構設計方案?;贒SP/FPGA架構的設計方案
  • 關(guān)鍵字: CY7C68013A  測控通信  FPGA  USB固件設計  

ARM與神經(jīng)網(wǎng)絡(luò )處理器的通信方案設計

  • 摘要:基于A(yíng)RM芯片和FPGA的特點(diǎn),設計了一種ARM與FPGA人工神經(jīng)網(wǎng)絡(luò )處理器之間的通信方案。該方案采用ARM的ZDMA控制器對數據傳輸進(jìn)行控制,完成ARM與神經(jīng)網(wǎng)絡(luò )處理器的控制寄存器組、分布式存儲器、樣本存儲器等存儲體
  • 關(guān)鍵字: 神經(jīng)網(wǎng)絡(luò )  嵌入式  通信  ARM  FPGA  S3C44BOX  ZDMA  

基于雙口RAM核監測數字示波器設計研究

  • 摘要:在核監測中,常將各種傳感器輸出的信號通過(guò)A/D轉換器轉換為數字信號,然后利用數字信號處理技術(shù)對各種核信號進(jìn)行數字處理。為了準確測量核信號數字波形的各種參數,對基于FPGA雙口RAM的數字示波器進(jìn)行了設計和
  • 關(guān)鍵字: 核脈沖  數字示波器  數字波形  FPGA  雙口RAM  

基于FPGA的數字通信實(shí)訓平臺的設計與實(shí)現

  • 摘要:本實(shí)訓平臺著(zhù)眼于提升高職層次學(xué)生的職業(yè)能力,圍繞典型的數字通信系統模型,設計了擴展性強、可測性好的FPGA核心板,并開(kāi)發(fā)了多個(gè)配套的功能模塊。憑借著(zhù)FPGA強大的硬件可編程能力,創(chuàng )設了分層遞進(jìn)的實(shí)驗模式
  • 關(guān)鍵字: FPGA  數字通信系統  EP1C3T144  QuartusⅡ9.0  片上通信系統  

基于FPGA IP核的FFT實(shí)現與改進(jìn)

  • 摘要 利用FPGA IP核設計了一種快速、高效的傅里葉變換系統。針對非整數倍信號周期截斷所導致的頻譜泄露問(wèn)題,提出了一種通過(guò)時(shí)輸入信號加窗處理來(lái)抑制頻譜泄露的方法。利用Modelsim和Matlab對設計方案進(jìn)行了仿真,同
  • 關(guān)鍵字: FFT  FPGA  IP核  加窗處理  

基于FPGA的多路數字信號復接系統設計與實(shí)現

  • 摘要 數字復分接技術(shù)是數字通信網(wǎng)中的一項重要技術(shù),能將若干路低速信號合并為一路高速信號,以提高帶寬利用率和數據傳輸效率。文中在介紹數字復接系統的基礎上,采用VHDL對數字復分接系統進(jìn)行建模設計和實(shí)現。并利
  • 關(guān)鍵字: 數字復接系統  乒乓操作  先進(jìn)先出存儲器  FPGA  

JPEG2000數據壓縮的FPGA實(shí)現

  • 高性能的數據壓縮可以有效的減少數據對存儲空間和通信帶寬的要求,降低通信成本。為解決圖像數據的高壓縮性能問(wèn)題,本文提出了基于JPEG2000標準的數據壓縮系統的FPGA實(shí)現方案。相對于軟件算法實(shí)現和其他硬件方法,采用FPGA硬件實(shí)現可降低系統復雜度提高性能。最終設計的IP核具有資源占用少,性能良好和便于擴展等優(yōu)點(diǎn),能夠滿(mǎn)足通信傳輸和照相設備等應用需求。
  • 關(guān)鍵字: JPEG2000  數據壓縮  FPGA  DWT  
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