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鎖相環(huán)
鎖相環(huán) 文章 進(jìn)入鎖相環(huán)技術(shù)社區
燦芯半導體發(fā)布通用高性能小數分頻鎖相環(huán)IP及相關(guān)解決方案
- 一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司近日宣布成功研發(fā)出一款通用高性能小數分頻鎖相環(huán)（fractional-N PLL） IP，支持24bits高精度小數分頻，最高輸出頻率4.5Ghz，另外還支持擴頻時(shí)鐘（SSC）功能，可以為客戶(hù)提供多功能的小數分頻 PLL解決方案。PLL電路一般用于產(chǎn)生輸出頻率，輸出頻率值與PLL的參考輸入頻率呈倍數關(guān)系。小數分頻PLL通過(guò)頻率乘法比例的小數值，實(shí)現更精確的輸出頻率控制，從而提供更高精度和準確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內調制時(shí)鐘信號
- 關(guān)鍵字： 燦芯半導體 小數分頻 鎖相環(huán) IP
鎖相環(huán)技術(shù)解析（下）
- 以下方案ARROW均有代理，被廣泛應用于多載波全球移動(dòng)通信系統 (MC-GSM)、5G和毫米波無(wú)線(xiàn)基礎設施 、 微波回程連線(xiàn) 、測試和測量設備、高速數據轉換器計時(shí)、衛星通信等領(lǐng)域的頻率合成、時(shí)鐘產(chǎn)生和相位管理。同時(shí)ARROW可提供配套的底噪聲、高可靠性電源方案, 以及配套的高Q值感阻容器件，主要品牌有TI、ADI、NXP、ON、ST等。電路實(shí)解1. 鑒相器鑒相器是鎖相環(huán)路的關(guān)鍵部件。在頻率合成器中所采用的鑒相器主要有正弦波相位檢波器與脈沖取樣保持相位比較器兩種。1) 正弦波相位檢波器這種鑒相器實(shí)際上是一個(gè)
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基于高頻信號注入的永磁同步電機無(wú)傳感器控制策略研究*
- 永磁同步電機無(wú)傳感器控制方法由于具有降低成本、減小系統體積和提高可靠性等優(yōu)勢，廣泛應用于軍工和民用等各個(gè)領(lǐng)域。本文介紹了用于零和低速下的永磁同步電機無(wú)傳感器控制技術(shù)。針對傳統的脈振高頻信號注入法轉子初始位置估計不準確的問(wèn)題，提出一種基于磁極飽和凸機性的方法來(lái)正確判斷磁極極性。并通過(guò)數學(xué)算法將濾波環(huán)節進(jìn)行簡(jiǎn)化，減少低通濾波器的使用。通過(guò)仿真分析，驗證了所設計的脈振高頻電壓注入法在零和低速段的可行性。
- 關(guān)鍵字： 永磁同步電機 無(wú)傳感器控制 高頻信號注入法 鎖相環(huán) 202109 PMSM
基于tanh函數的永磁同步電機無(wú)位置傳感器控制研究
- 鳳志民，杭孟荀（奇瑞新能源汽車(chē)股份有限公司，安徽 蕪湖 241002） 摘 要：為削弱傳統滑膜觀(guān)測器（Sliding Mode Observer, SMO）中由于控制函數的不連續性而引起的系統抖振，設計一種基于雙曲正切函數tanh的改進(jìn)型SMO，采用截止頻率可變的策略對轉子位置角進(jìn)行相位補償并且結合鎖相環(huán)估計轉子位置，在同步旋轉d - p 軸坐標系下建立和分析了改進(jìn)型SMO，利用MATLAB/Simulink工具搭建改進(jìn)SMO的仿真模型。仿真實(shí)驗結果表明：改進(jìn)型SMO能有效削弱系統抖振，提高了轉子估
- 關(guān)鍵字： 202007 永磁同步電機 滑模觀(guān)測器 tanh函數 鎖相環(huán) PMSM
鎖相環(huán)中的相位檢測和控制原理分析
- 顧名思義，鎖相環(huán)(PLL)使用鑒相器比較反饋信號與參考信號， 將兩個(gè)信號的相位鎖定在一起。雖然這種特性有許多用武之地，但是 PLL 如今最常用于頻率合成，通常充當上變頻器/下變 頻器中的本振(LO)，或者充當高速 ADC 或 DAC 的時(shí)鐘?！ 』蛟S，我們很少注意這些電路中的相位行為。但隨著(zhù)對效率、帶寬和性能的需求日益增長(cháng)，RF 工程師必須推出新技術(shù)來(lái)提高頻譜和功率效率。信號相位的重復性、可預測性和可調性在現代通信和儀器儀表應用中均起到日益重要的作用?！ ∫磺卸际窍鄬Φ摹 ￡P(guān)于相位測量，如果不
- 關(guān)鍵字： 鎖相環(huán) 相位檢測
FPGA系統設計原則和技巧之：FPGA系統設計的3種常用IP模塊
- FPGA的開(kāi)發(fā)工具軟件，如Quartus II、ISE等，一般都會(huì )提供一些經(jīng)過(guò)驗證的IP模塊。這些IP模塊是芯片廠(chǎng)家提供的，所以只能用于該廠(chǎng)家的FPGA芯片設計中。這些IP主要包括以下幾類(lèi)。
- 關(guān)鍵字： FPGA系統設計 存儲器 IP模塊 鎖相環(huán) 高速串行收發(fā)器
針對FPGA優(yōu)化的高分辨率時(shí)間數字轉換陣列電路
- 介紹一種針對FPGA優(yōu)化的時(shí)間數字轉換陣列電路。利用FPGA片上鎖相環(huán)對全局時(shí)鐘進(jìn)行倍頻與移相，通過(guò)時(shí)鐘狀態(tài)譯碼的方法解決了FPGA中延遲的不確定性問(wèn)題，完成時(shí)間數字轉換的功能。
- 關(guān)鍵字： 時(shí)間數字轉換 鎖相環(huán) FPGA
基于DSP的軟件鎖相環(huán)的實(shí)現
- 0 引言 準確獲取電網(wǎng)基波及諧波電壓的相位角，在變頻器、有源濾波器等電力電子裝置中具有重要的意義，通常需要采用鎖相環(huán)得以實(shí)現。傳統鎖相環(huán)電路一般由鑒相器、環(huán)路濾波器、壓控振蕩器及分頻器組成，其工作原理是通過(guò)鑒相器將電網(wǎng)電壓和控制系統內部同步信號的相位差轉變成電壓信號，經(jīng)環(huán)路濾波器濾波后控制壓控振蕩器，從而改變系統內部同步信號的頻率和相位，使之與電網(wǎng)電壓一致。傳統鎖相環(huán)存在硬件電路復雜、易受環(huán)境干擾及鎖相精度不高等問(wèn)題，隨著(zhù)大規模集成電路及數字信號處理器的發(fā)展，通過(guò)采用高速DSP
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鎖相環(huán)介紹
能使受控振蕩器的頻率和相位均與輸入信號保持確定關(guān)系的閉環(huán)電子電路。鎖相環(huán)的基本結構如圖1，其中鑒相器用來(lái)鑒別輸入信號ui與輸出信號u0之間的相位差,并輸出誤差電壓ud。ud中的噪聲和干擾成分被低通性質(zhì)的環(huán)路濾波器濾除，形成壓控振蕩器(VCO)的控制電壓uC。uC作用于壓控振蕩器的結果是把它的輸出振蕩頻率f0拉向環(huán)路輸入信號頻率fi,當二者相等時(shí)，環(huán)路被鎖定，稱(chēng)為入鎖。維持鎖定的直流控制電壓由鑒相器 [ 查看詳細 ]
鎖相環(huán)電路
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