約束設置與邏輯綜合在SoC設計中的應用
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從報告中看到，該路徑起點(diǎn)是i_ZSU32_top/i_eth2_top/miim1/clkgen/U42/Y，終點(diǎn)是i_ZSU32_top/i_eth2_top/miim1/shftrg/ShiftReg_reg_1_，路徑的時(shí)序裕量是2.96 ns。
ZSU32采用中芯國際0.18 μm CMOS標準單元庫進(jìn)行了邏輯綜合和版圖設計實(shí)現，6層金屬布線(xiàn)，已成功流片。電路綜合規模為200萬(wàn)門(mén)，所有cell的面積為19 195 460 μm2，芯片總面積小于5 mm×5 mm。
參考文獻
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