雷達視頻積累算法在FPGA上的實(shí)現

小滑窗檢測器是一種窗孔長(cháng)度L(累加的脈沖數為L(cháng))小于天線(xiàn)波束掃過(guò)目標時(shí)收到回波脈沖數N的檢測器。L一般比N小很多，例如N在10～20以上，而L取5～7。小滑窗檢測方法進(jìn)行視頻積累的原理框圖如圖2所示。

在本設計中，通過(guò)FPGA軟件編程采用FPGA+SRAM的方式來(lái)實(shí)現視頻積累。小滑窗檢測器的延時(shí)主要通過(guò)將信號量化后存儲在高速SRAM的方式完成。FPGA軟件編程實(shí)現視頻積累的原理圖如圖3所示。

圖3中的clk為系統主時(shí)鐘；count_dist為距離計數器；acc_en為視頻積累的使能信號，acc_en為高電平時(shí)有效；count_dist，clk與acc_en為控制時(shí)序關(guān)系的主要系統變量；acc_data為求模后輸入的非相參信號，系統的視頻信號實(shí)時(shí)不斷地輸入到FPGA中。

FPGA通過(guò)時(shí)序控制將acc_data信號量化后為RAM_data信號；當RAM的讀信號RAM_we為高電平時(shí)，RAM_data寫(xiě)入SRAM地址中，通過(guò)時(shí)序控制將前面L-1個(gè)周期的量化信號存儲在高速SRAM中，待信號在SRAM中存滿(mǎn)后，即RAM_rd為高電平；RAM_we為低電平時(shí)，通過(guò)時(shí)序控制，將存入SRAM中的同一距離單元上的前L-1個(gè)信號讀出，并與當前輸入信號在FPGA中進(jìn)行累加完成窗孔長(cháng)度為L(cháng)的小滑窗檢測，從而實(shí)現對非相參視頻信號的視頻積累。

4 仿真驗證

為了驗證本文原理以及本系統的實(shí)現效果，首先模擬產(chǎn)生雷達信號處理中經(jīng)過(guò)求模以后的相參視頻信號，該信號僅含有幅度信息和雜波(根據參數設置直接在FPGA芯片中利用軟件編程產(chǎn)生)，對該模擬信號進(jìn)行視頻積累，經(jīng)D／A變換送給示波器顯示。將編譯綜合后的BIT文件下載到FPGA芯片中進(jìn)行系統聯(lián)調，最后在示波器上查看仿真的結果。圖4為經(jīng)過(guò)求模后的雷達相參視頻信號在示波器上的截圖，該信號的雜波為近似服從均值為0的均勻分布；圖5為對該模擬信號進(jìn)行視頻積累后在示波器上的截圖。

從仿真的結果可以看出，利用本系統對經(jīng)過(guò)求模后的信號進(jìn)行視頻積累取得了比較理想的效果。

5 結語(yǔ)

本文著(zhù)重介紹了利用FPGA芯片實(shí)現視頻積累的原理和過(guò)程。利用FPGA進(jìn)行雷達視頻積累，可使系統具有更大的靈活性，減少了系統的體積，提高了系統的可靠性，大大縮短了系統開(kāi)發(fā)的周期。隨著(zhù)FPGA芯片以及設計更新軟件的更新與快速發(fā)展，FPGA芯片將具有更高速的重復復雜計算的能力，同時(shí)又具有軟件的靈活性，并可以重復利用硬件來(lái)降低成本，模糊了硬件與軟件之間的界限，使硬件系統具有更大的靈活性以及通用性。

本文最后利用FPGA軟件編程模擬實(shí)現了一個(gè)經(jīng)過(guò)求模后的雷達相參視頻信號，并利用本系統對該信號進(jìn)行了視頻積累，取得了較好的效果。