具有低功耗意識的FPGA設計方法 作者： 時(shí)間：2011-01-13 來(lái)源：網(wǎng)絡(luò ) 加入技術(shù)交流群 掃碼加入和技術(shù)大咖面對面交流海量資料庫查詢(xún) 收藏 <a target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=88&cb=INSERT_RANDOM_NUMBER_HERE&n=a635e61e' border='0' alt='' /></a> <a target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=87&cb=INSERT_RANDOM_NUMBER_HERE&n=a576c0a2' border='0' alt='' /></a> 圖7 時(shí)鐘樹(shù)功耗概括表圖8 邏輯功耗概括表 在對照概括表之前，只要時(shí)序允許，可以修改RTL代碼；保證修改以后的功能和時(shí)序有效性；也可以嘗試調整綜合選項以及使用基于功耗優(yōu)先的策略來(lái)進(jìn)行布局布線(xiàn)。 上一頁(yè) 1 2 3 下一頁(yè)
加入技術(shù)交流群
評論