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EEPW首頁(yè) >> 主題列表 >> 乘法器

使用模擬乘法器的同步解調與基于開(kāi)關(guān)的乘法器

  • 在之前的文章中，我們了解了同步解調技術(shù)的基礎知識。該技術(shù)有助于測量隱藏在閃爍噪聲中的低頻信號。它試圖以比電路的 1/f 拐角頻率高得多的頻率運行電路，以便閃爍噪聲不再是限制因素。在之前的文章中，我們了解了同步解調技術(shù)的基礎知識。該技術(shù)有助于測量隱藏在閃爍噪聲中的低頻信號。它試圖以比電路的 1/f 拐角頻率高得多的頻率運行電路，以便閃爍噪聲不再是限制因素。同步解調技術(shù)可以使用模擬乘法器或基于開(kāi)關(guān)的乘法器來(lái)實(shí)現。從實(shí)現的角度來(lái)看，基于開(kāi)關(guān)的乘法更方便。在本文中，我們將探討使用此類(lèi)乘法器的優(yōu)缺點(diǎn)。使用模擬乘法器
  • 關(guān)鍵字： 乘法器  

基于嵌入式算法容噪技術(shù)的低功耗近似乘法器

  • 　　何?進(jìn)，衣溪琳，張子驥，賀雅娟（電子科技大學(xué)?電子科學(xué)與工程學(xué)院，四川?成都?610054）　　摘?要:本文提出一種可靠的低功耗近似乘法器設計方案，該方案基于嵌入式算法容噪技術(shù)，并且通過(guò)閾值的合理選擇簡(jiǎn)化了傳統嵌入式容噪方案中的檢錯糾錯模塊。我們根據這樣的思路基于SMIC 180 nm工藝設計了相應的8比特乘8比特的近似乘法器。該乘法器在450 MHz的工作頻率最低可以工作在1.2 V的電源電壓下。與傳統的陣列乘法器相比，在相同的工作頻率和MSE條件下，傳統乘法器可以工作在1.6 V左右，該乘法器可以
  • 關(guān)鍵字： 201908  低功耗  低壓  乘法器  算法容噪技術(shù)  閾值選擇  

一種基于存儲的乘法器查找表的近似優(yōu)化方法

  • 　　萬(wàn)晨雨，賀雅娟　?。娮涌萍即髮W(xué)電子科學(xué)與工程學(xué)院，成都 610054)　　摘要：本文提出了一種近似高輸入結果存儲(approximate-most-significant-multiple-storage, AMMS)的查找表(LUT)優(yōu)化方法。該方法利用移位操作來(lái)替代部分存儲，并將存儲內容進(jìn)行截位使存儲位寬縮減，對基于存儲的乘法器中的查找表進(jìn)行了優(yōu)化。該方法在一個(gè)mm位的乘法器中，可以將查找表的規?？s減至傳統存儲方法的1/4，并明顯改善乘法器的面積延遲積(ADP)，不過(guò)與此同時(shí)，該方法也因截位而產(chǎn)
  • 關(guān)鍵字： 201907  存儲  乘法器  優(yōu)化  

基于絕熱邏輯的低功耗乘法器電路設計方案

  • 過(guò)去的40年中，MOS器件尺寸的持續縮小一直是促進(jìn)半導體工業(yè)發(fā)展的動(dòng)力。人們可以在越來(lái)越小的芯片上實(shí)現越來(lái)越復雜的功能，并且芯片的價(jià)格不斷下降，使得各種便攜式產(chǎn)品如筆記本電腦、筆跡識別儀。
  • 關(guān)鍵字： 絕熱邏輯  低功耗  乘法器  

數字圖像倍焦系統設計與實(shí)現綜合實(shí)例之：系統工作原理分析

  • 如前所述，本系統主要完成對輸入視頻圖像的兩倍放大。圖像的放大主要是通過(guò)插值算法來(lái)實(shí)現的，下面詳細分析如何應用雙線(xiàn)性插值算法來(lái)實(shí)現倍焦功能。
  • 關(guān)鍵字： 數字圖像倍焦系統  乘法器  FPGA  

采用乘法器的可變環(huán)寬比較器電路圖

  • 采用乘法器的可變環(huán)寬比較器電路圖圖采用乘法器的可變環(huán)寬比較器電路圖
  • 關(guān)鍵字： 乘法器  可變環(huán)寬  比較器  

使用跨導運算放大器的乘法器除法器

為什么不能將乘法器用作調制器或混頻器？

  • 為什么不能將乘法器用作調制器或混頻器?它們不是一回事嗎?并非如此，了解它們之間的區別十分重要。乘法器有兩個(gè)模擬輸入，輸出與兩個(gè)輸入幅度的乘積成比例。VOUT = K times; VIN1 times; VIN2其中，K是維數為1/V的
  • 關(guān)鍵字： 乘法器    調制器    混頻器  

FPGA基礎知識及其工作原理

  • 高端設計工具為少有甚是沒(méi)有硬件設計技術(shù)的工程師和科學(xué)家提供現場(chǎng)可編程門(mén)陣列(FPGA)。無(wú)論你使用圖形化設計程序，ANSI C語(yǔ)言還是VHDL語(yǔ)言，如此復雜的合成工藝會(huì )不禁讓人去想FPGA真實(shí)的運作情況。在這個(gè)芯片中的
  • 關(guān)鍵字： FPGA    乘法器    觸發(fā)器    DSP    RAM  

乘法器與調制器

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò )家園
  • 關(guān)鍵字： 調制器  乘法器  信號頻帶  諧波  基波  

采用靜態(tài)CMOS和單相能量回收電路的乘法器電路設計

  • O 引言　　電路中的功率消耗源主要有以下幾種：由邏輯轉換引起的邏輯門(mén)對負載電容充、放電引起的功率消耗;由邏輯門(mén)中瞬時(shí)短路電流引起的功率消耗;由器件的漏電流引起的消耗，并且每引進(jìn)一次新的制造技術(shù)會(huì )導致漏電流
  • 關(guān)鍵字： CMOS  單相  乘法器  能量回收  

基于改進(jìn)的布斯算法FPGA嵌入式18×18乘法器

  • 摘要：設計了一款嵌入FPGA的乘法器，該乘法器能夠滿(mǎn)足兩個(gè)18 b有符號或17 b無(wú)符號數的乘法運算。該設計基于改進(jìn)的布斯算法，提出了一種新的布斯譯碼和部分積結構，并對9-2壓縮樹(shù)和超前進(jìn)位加法器進(jìn)行了優(yōu)化。該乘法器
  • 關(guān)鍵字： FPGA  算法  嵌入式  乘法器    

脈沖-寬度-高度調制乘法器原理分析

  • 脈沖-寬度-高度調制乘法器雙稱(chēng)為時(shí)間分割乘法器。這類(lèi)乘法器電路原理圖如圖5.4-24A所示。圖中，三角波電壓UT和模擬輸入電壓UY相加，然后通過(guò)零電平比較器，得到不對稱(chēng)方波控制電壓U2。U2的工作周期取決于UY的大小和極
  • 關(guān)鍵字： 脈沖  調制  乘法器  分析    

測量高頻PWM實(shí)時(shí)功率的乘法器電路

  • 除了瞬時(shí)功率外，平均和RMS功率值也是非常重要的。所有全模擬電路可以實(shí)現這些指標的測量。對于電機或伺服器這些需要精確監視或調節負載耗散功率的產(chǎn)品來(lái)說(shuō)，可以通過(guò)計算負載電壓和電流的乘積來(lái)測量實(shí)際功率。但如果
  • 關(guān)鍵字： PWM  測量  高頻  乘法器    

高頻四象限電流乘法器電路設計

  • 本文提出了一種高頻四象限電流乘法器。該乘法器電路結構對稱(chēng)。提出的乘法器電路工作在±1．18 V的電源電壓下 ...
  • 關(guān)鍵字： 高頻  四象  限電流  乘法器  
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乘法器介紹

　　乘法器 　　乘法器（multiplier）是一種完成兩個(gè)互不相關(guān)的模擬信號相乘作用的電子器件。它可以將兩個(gè)二進(jìn)制數相乘。它是由更基本的加法器組成的。 　　目錄 　　1簡(jiǎn)介 　　2作用 　　3類(lèi)型 　　·模擬乘法器 　　·硬件乘法器 　　1簡(jiǎn)介 　　乘法器（multiplier）可以通過(guò)使用一系列計算機算數技術(shù)來(lái)實(shí)現。大多數的技術(shù)涉及了對部分積（partial product） [ 查看詳細 ]

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