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xilinx 文章 進(jìn)入xilinx技術(shù)社區
基于FPGA雷達成像方位脈沖壓縮系統的設計
- 合成孔徑雷達成像算法中較為成熟和應用廣泛的算法主要有距離-多普勒(R-D)算法和線(xiàn)性調頻變標(CS)算法。R-D算法復雜度相對較低，運算比較簡(jiǎn)單，雖然其成像質(zhì)量并不高，但是相比對穩定性、存儲空間、功耗與實(shí)時(shí)性要求都很高的實(shí)時(shí)SAR成像系統，其應用十分廣泛。在整個(gè)有距離-多普勒(R-D)算法中方位脈沖壓縮系統是設計的關(guān)鍵。隨著(zhù)FPGA芯片突飛猛進(jìn)的發(fā)展，實(shí)時(shí)雷達成像方位脈沖壓縮系統在FPGA上實(shí)現變成了可能。 1 脈沖壓縮及方位脈沖壓縮系統的結構 1．1 脈沖壓縮的基本原理 實(shí)現脈沖壓
- 關(guān)鍵字： Xilinx FPGA
用FPGA 嵌入式處理器實(shí)現高性能浮點(diǎn)元算
- 在采用數值處理技術(shù)創(chuàng )建嵌入式應用時(shí)，通常以整數或定點(diǎn)表示法來(lái)確保算術(shù)運算盡量簡(jiǎn)單，這一點(diǎn)至關(guān)重要。因其不僅有助于使成本和功耗降至最低，而且還能盡可能地加速硬件部署。FPGA 非常適用于執行定點(diǎn)運算，并能在邏輯或基于軟件或硬件處理器的實(shí)施方案中創(chuàng )建高度并行的數據路徑解決方案。Virtex®-5 FPGA 產(chǎn)品系列中 FXT 系列的最新硬件處理器 Xilinx® PowerPC® 440 可提供超標量功能，讓用戶(hù)能夠對器件編程，使其以高達 550 MHz 的時(shí)鐘速率并行執行一個(gè)或兩
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為什么嵌入式開(kāi)發(fā)人員要使用FPGA？
- 在一個(gè)領(lǐng)域中，如果唯一不變的是變化，那么不需要對電子技術(shù)和設計方法的發(fā)展變化做多少回顧，就能見(jiàn)證到變化是如何使設計工程師能夠創(chuàng )建出下一代創(chuàng )新產(chǎn)品。微處理器得到大規模應用后，價(jià)廉物美的新技術(shù)為基于軟件的革新性電子產(chǎn)品設計打開(kāi)了大門(mén)，這就是一個(gè)很好的例子。簡(jiǎn)言之，把設計的主要元素——在這兒是控制“智能”——轉入到軟領(lǐng)域后，設計工程師就可以在更短時(shí)間內創(chuàng )建出更好、更智能、更廉價(jià)的產(chǎn)品。 這個(gè)變化意味著(zhù)嵌入式軟件開(kāi)發(fā)人員是當今定義電
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FPGA如何改變改變嵌入設計格局？
- 由于經(jīng)濟下滑損及開(kāi)發(fā)預算減少，嵌入系統設計者正在轉向FPGA（現場(chǎng)可編程門(mén)陣列）技術(shù)，以縮減開(kāi)發(fā)周期、對抗設備老化以及簡(jiǎn)化產(chǎn)品升級。通過(guò)采用數量龐大且不斷增加的FPGA開(kāi)發(fā)工具、可重用邏輯單元以及市售商用模塊，設計者可以構思出高性能嵌入系統，并且能夠根據需求變化作重新配置，從而盡量減少對工程和制造的影響。過(guò)去，電路板設計者使用這些器件作系統元件之間的互連，但最新的高密度產(chǎn)品也可以替代一個(gè)典型嵌入項目中的處理器、內存、定制邏輯及很多外設。盡管它有能力改變嵌入架構，設計者仍應分析性能、功率和成本局限，以確
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FAE講堂：如何加快處理器的正弦計算
- 有很多種算法可對單精度浮點(diǎn)數字的正弦值進(jìn)行計算，但添加硬件加速器是功能最為強大的方法之一。之所以得出這一結論，是因為客戶(hù)的應用要求使用此類(lèi)正弦計算，而我們又針對能夠提供良好、快速且高效的解決方案進(jìn)行了多種方案的探索。 為了確定哪種實(shí)現方式最適合您的應用，首先需要對代碼進(jìn)行分析，以查找哪種功能需要改進(jìn);其次，由于修改軟件比修改硬件更簡(jiǎn)便、迅速，因而請檢查是否能通過(guò)修改軟件來(lái)實(shí)現您所需的高速度(有時(shí)可以)。但是如果您還需要更高的性能，那么請考慮在硬件中實(shí)現部分算法。在硬件加速的支持下，您可以輕松勝過(guò)
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FAE講堂：利用賽靈思FGPA實(shí)現降采樣FIR濾波器
- 過(guò)去半年有幾位客戶(hù)請我幫助他們設計和實(shí)現數字下變頻器所用的降采樣(即“抽取”)濾波器，這種濾波器在軟件無(wú)線(xiàn)電與數據采集類(lèi)應用中都很常見(jiàn)。這項工作即便對于經(jīng)驗豐富的設計師也不是一件小事。事實(shí)上，僅僅算出在FGPA中實(shí)現濾波器所需要的資源可能就是一個(gè)很大的問(wèn)題。雖然MATLAB?(MathWorks 開(kāi)發(fā))具有用于濾波器設計與分析 (FDA) 的絕妙工具箱，但是它提供太多濾波器設計方法，會(huì )讓新用戶(hù)無(wú)從下手。另外，您必須能夠根據DSP理論解釋MATLAB命令產(chǎn)生的結果，僅僅這
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FAE講堂：提升創(chuàng )造力的數字設計工具 FPGA Editor
- 工程師在設計過(guò)程中，經(jīng)常需要一定的創(chuàng )造力(你不妨稱(chēng)之為數字管道膠帶)才能夠保證設計的順利完成。過(guò)去8年時(shí)間里，我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地完成了許多工作，而他們采用的最主要工具就是 FPGA Editor。 利用FPGA Editor，你可以察看完成的設計并確定是否在FPGA構造一級真正實(shí)現了設計意圖 – 而這對于任何工程師或現場(chǎng)應用工程師來(lái)說(shuō)都是非常需要的。假設你拿到協(xié)作者的設計，需要對其進(jìn)行修改，但他們的 HDL源代碼非常難于理解，或者根本沒(méi)有任何注釋或文檔。也許你
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手把手課堂：擴展PowerPC的復數運算指令集
- 汽車(chē)多媒體系統面臨著(zhù)嚴峻的技術(shù)挑戰：如何在漫長(cháng)的整個(gè)產(chǎn)品壽命周期中實(shí)現系統的可升級性?轎車(chē)和卡車(chē)的壽命通常都在十年以上。這就使汽車(chē)多媒體系統難以跟上消費電子產(chǎn)品和移動(dòng)通信標準迅速變化的步伐。在大多數情況下，只更新多媒體軟件是不夠的，甚至是不可能的。 許多應用，尤其是多媒體編解碼器，還需要提高計算性能。然而，為將來(lái)的使用而設計具有“后備”計算能力的系統，既不經(jīng)濟，在技術(shù)上也不可行，因為許多技術(shù)變化是根本無(wú)法預見(jiàn)的。 一種解決方案是以某種方式隨軟件一起升級計算平臺，使系
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手把手課堂：簡(jiǎn)單MicroBlaze微控制器的理念
- 嵌入式微控制器對復雜程度各異的多種應用而言都很普遍。賽靈思 (Xilinx)自2000年以來(lái)始終致力于推出固化的（PowerPC® 405 和 PowerPC 440）以及基于構造 (MicroBlaze™) 的嵌入式微處理器。MicroBlaze 的顯著(zhù)優(yōu)勢在于能滿(mǎn)足復雜應用的需求，有些情況下除了運行簡(jiǎn)單的通用應用而外還能運行操作系統。 設計人員能夠在當前所有的賽靈思架構中實(shí)施 MicroBlaze 軟處理器，在不同產(chǎn)品系列間實(shí)現方便的轉換，獲得無(wú)與倫比的靈活性。但是，Mi
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在賽靈思FPGA設計中保留可重復結果
- 滿(mǎn)足設計的時(shí)序要求本身已非易事，而要實(shí)現某項設計的整體時(shí)序具有完全可重復性有時(shí)候卻是不可能的任務(wù)。幸運的是，設計人員可以借助有助于實(shí)現可重復時(shí)序結果的設計流程概念。影響最大的四個(gè)方面分別是 HDL 設計實(shí)踐、綜合優(yōu)化、平面布局和實(shí)施方案。 就獲得可重復結果而言，資源利用和頻率要求都很高的設計是最大的挑戰。它們也是可重復結果流程需求最高的設計。得到可重復結果的第一步是在 HDL設計階段運用設計合理的實(shí)踐。遵循出色的分層邊界實(shí)踐有助于保持邏輯整體性，而這在設計變更時(shí)有助于保持可重復結果。一條不錯的規
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基于賽靈思Virtex-5 FPGA的LTE仿真器實(shí)現
- 功能強大的可編程邏輯平臺使得Prisma Engineering公司能夠針對所有蜂窩網(wǎng)絡(luò )提供可重配置無(wú)線(xiàn)測試設備。長(cháng)期演進(jìn)(LTE)是移動(dòng)寬帶的最3GPP標準，它打破了現有蜂窩網(wǎng)絡(luò )的固有模式。LTE與前代UMTS和GSM標準相比，除采用高頻譜效率的射頻技術(shù)外，其架構還得到了大幅簡(jiǎn)化。LTE系統的無(wú)線(xiàn)接入部分Node-B，是連接無(wú)線(xiàn)電和整個(gè)互聯(lián)網(wǎng)協(xié)議核心網(wǎng)絡(luò )之間的邊緣設備。這種架構無(wú)法監測和測試等效于UMTS中間鏈路上的元件。必須通過(guò)無(wú)線(xiàn)電接口，才能有效地測試LTE網(wǎng)絡(luò )元件。 這正是Prisma
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以基于賽靈思 FPGA 的硬件加速技術(shù)打造高速系統
- 設計人員時(shí)常需要通過(guò)增加計算能力或額外輸入（或兩者）延長(cháng)現有的嵌入式系統的壽命。而可編程系統平臺在這里大有用武之地。我們曾經(jīng)希望用安全網(wǎng)絡(luò )連接功能升級一套網(wǎng)絡(luò )可編程系統。安全網(wǎng)絡(luò )連接功能需要加密才能運行安全外殼 (SSH)、傳輸層安全 (TLS)、安全套接層(SSL) 或虛擬專(zhuān)用網(wǎng) (VPN) 等協(xié)議。這種安全需求與把各種系統接入因特網(wǎng)的需求同步增長(cháng)，例如，為了啟用遠程管理與分布式控制系統。 因該領(lǐng)域仍在發(fā)展并且標準尚未固定，因此成本主要取決于一次性工程費用。所以，FPGA 技術(shù)能實(shí)現最高價(jià)值。
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賽靈思推出ISE 12.3設計套件，引入AMBA 4 AXI4 IP 核
- ISE12.3增強PlanAhead 設計與分析控制臺，并進(jìn)一步優(yōu)化功耗，標志著(zhù)支持 AXI4 接口IP的推出，和即插即用FPGA 設計的實(shí)現 賽靈思公司（Xilinx, Inc. ）宣布推出 ISE® 12.3設計套件，這標志著(zhù)這個(gè)FPGA 行業(yè)領(lǐng)導者針對片上系統設計的互聯(lián)功能模塊， 開(kāi)始推出滿(mǎn)足AMBA® 4 AXI4 規范的IP核，以及用于提高生產(chǎn)力的 PlanAhead™ 設計和分析控制臺，同時(shí)還推出了用于降低了Spartan®-6 FPG
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手把手課堂:Xilinx FPGA設計時(shí)序約束指南
- 作為賽靈思用戶(hù)論壇的定期訪(fǎng)客，我注意到新用戶(hù)往往對時(shí)序收斂以及如何使用時(shí)序約束來(lái)達到時(shí)序收斂感到困惑。為幫助 FPGA設計新手實(shí)現時(shí)序收斂，讓我們來(lái)深入了解時(shí)序約束以及如何利用時(shí)序約束實(shí)現FPGA 設計的最優(yōu)結果。 何為時(shí)序約束？ 為保證設計的成功，設計人員必須確保設計能在特定時(shí)限內完成指定任務(wù)。要實(shí)現這個(gè)目的，我們可將時(shí)序約束應用于連線(xiàn)中——從某 FPGA 元件到 FPGA 內部或 FPGA 所在 PCB 上后續元件輸入的一條或多條路徑。 在 FPGA 設計
- 關(guān)鍵字： Xilinx FPGA 設計時(shí)序
賽靈思變革生態(tài)系統加速可編程平臺主流應用進(jìn)程
- 日前， 全球可編程平臺領(lǐng)導廠(chǎng)商賽靈思公司 （Xilinx, Inc. (NASDAQ:XLNX)）宣布，為建立新的 FPGA 應用市場(chǎng)， 賽靈思公司將通過(guò)其開(kāi)放式平臺以及對業(yè)界重要標準的支持變革生態(tài)系統， 推動(dòng)賽靈思聯(lián)盟計劃向縱深層次發(fā)展。作為該計劃的一部分， 賽靈思將幫助 FPGA 用戶(hù)根據其具體的設計與開(kāi)發(fā)要求更方便快捷地找到理想的合作伙伴， 同時(shí)提升客戶(hù)與賽靈思聯(lián)盟計劃成員合作時(shí)的滿(mǎn)意度和質(zhì)量。 賽靈思合作伙伴生態(tài)系統及聯(lián)盟高級總監 Dave Tokic 指出： “客戶(hù)開(kāi)始越來(lái)
- 關(guān)鍵字： Xilinx ASIC ASSP
xilinx介紹
Xilinx ZYNQ技術(shù)中心
一、Xilinx公司介紹
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應商。Xilinx研發(fā)、制造并銷(xiāo)售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP（Intellectual Property）核?？蛻?hù)使用Xilinx及其合作伙伴的自動(dòng)化軟件工具和IP核對器件進(jìn)行編程，從而完成特定的邏輯操作。Xilinx公司成立于 1984年，Xilinx首創(chuàng )了現場(chǎng)可編程邏輯陣列 [ 查看詳細 ]
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