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數字差分BPSK擴頻接收機的設計與FPGA實(shí)現

利用FPGA實(shí)現UART的設計

  • 引 言   隨著(zhù)計算機技術(shù)的發(fā)展和廣泛應用,尤其是在工業(yè)控制領(lǐng)域的應用越來(lái)越廣泛,計算機通信顯的尤為重要。串行通信雖然使設備之間的連線(xiàn)大為減少,但隨之帶來(lái)串/并轉換和位計數等問(wèn)題,這使串行通信技術(shù)比并行通信技術(shù)更為復雜。串/并轉換可用軟件實(shí)現,也可用硬件實(shí)現。用軟件實(shí)現串行傳送大多采用循環(huán)移位指令將一個(gè)字節由高位到低位(或低位到高位)一位一位依次傳送,這種方法雖然簡(jiǎn)單但速度慢,而且大量占用CPU的時(shí)間,影響系統的性能。更為方便的實(shí)現方法是用硬件,目前微處理器串行接口常用的LSI 芯片是UART(通用異
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基于FPGA的八位RISC CPU的設計

  •     1  引 言   隨著(zhù)數字通信和工業(yè)控制領(lǐng)域的高速發(fā)展,要求專(zhuān)用集成電路(ASIC)的功能越來(lái)越強,功耗越來(lái)越低,生產(chǎn)周期越來(lái)越短,這些都對芯片設計提出了巨大的挑戰,傳統的芯片設計方法已經(jīng)不能適應復雜的應用需求了。SoC(System on a Chip)以其高集成度,低功耗等優(yōu)點(diǎn)越來(lái)越受歡迎。開(kāi)發(fā)人員不必從單個(gè)邏輯門(mén)開(kāi)始去設計ASIC,而是應用己有IC芯片的功能模塊,稱(chēng)為核(core),或知識產(chǎn)權(IP)宏單元進(jìn)行快速設計,效率大為提高。CPU 的IP
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PCI Express的市場(chǎng)、趨勢和應用

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò )家園
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Altera首次實(shí)現了對關(guān)鍵工業(yè)以太網(wǎng)協(xié)議的FPGA IP支持

  •   Altera公司日前宣布為工業(yè)自動(dòng)化應用中的以太網(wǎng)通信協(xié)議提供FPGA支持,這些應用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關(guān)鍵通信協(xié)議的知識產(chǎn)權(IP)內核現在可以在A(yíng)ltera低成本Cyclone®系列FPGA中實(shí)現。   設計人員利用工業(yè)以太網(wǎng)IP內核可以在一塊電路板上實(shí)現任何標準,這不但減小了外形尺寸,而且節省了時(shí)間。系統OEM能夠以高性?xún)r(jià)比方式在其自動(dòng)化產(chǎn)品中增加工業(yè)
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基于FPGA的智能控制器設計及測試方法研究

  • 摘要:通過(guò)模糊自整定PID控制器的設計,本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實(shí)現的智能控制器設計及測試新方法。首先,通過(guò)MATLAB仿真,得出智能控制器的結構和參數。然后,基于VHDL進(jìn)行智能控制器的數字化實(shí)現及其開(kāi)環(huán)測試。在此基礎上,通過(guò)分析一般智能控制器的測試特點(diǎn),采用DSP Builder構建閉環(huán)測試系統,Modelsim運行DSP Builder生成文件來(lái)驗證QuartusII中所做VHDL設計的測試方法。實(shí)驗表明,該測試方法能有效模擬控制器的
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Stratix II FPGA系統電源設計

  • 基于MAX1951的諸多特點(diǎn),本文給出了采用該器件為Stratix II FPGA系統供電以降低其功耗的設計方案。
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Altera宣布其Cyclone III FPGA提供對EtherCAT IP支持

  •   Altera公司日前宣布為EtherCAT技術(shù)協(xié)會(huì )的EtherCAT協(xié)議提供知識產(chǎn)權(IP)支持。此前IP是針對Cyclone® II器件,現在將針對Altera新的低成本、低功耗Cyclone III FPGA。   EtherCAT技術(shù)協(xié)會(huì )執行總監Martin Rostan說(shuō):“在競爭非常激烈的工廠(chǎng)自動(dòng)化設備市場(chǎng)上,企業(yè)正在尋找能夠迅速突出產(chǎn)品優(yōu)勢的新功能和特性。Cyclone III FPGA實(shí)現對EtherCAT的支持,使設計人員能夠以高性?xún)r(jià)比方式,輕松加入實(shí)時(shí)以太網(wǎng)功能?!?   
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利用FPGA實(shí)現UART的設計

  • 引 言   隨著(zhù)計算機技術(shù)的發(fā)展和廣泛應用,尤其是在工業(yè)控制領(lǐng)域的應用越來(lái)越廣泛,計算機通信顯的尤為重要。串行通信雖然使設備之間的連線(xiàn)大為減少,但隨之帶來(lái)串/并轉換和位計數等問(wèn)題,這使串行通信技術(shù)比并行通信技術(shù)更為復雜。串/并轉換可用軟件實(shí)現,也可用硬件實(shí)現。用軟件實(shí)現串行傳送大多采用循環(huán)移位指令將一個(gè)字節由高位到低位(或低位到高位)一位一位依次傳送,這種方法雖然簡(jiǎn)單但速度慢,而且大量占用CPU的時(shí)間,影響系統的性能。更為方便的實(shí)現方法是用硬件,目前微處理器串行接口常用的LSI 芯片是UART(通用異
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降低FPGA功耗的設計

  •   使用這些設計技巧和ISE功能分析工具來(lái)控制功耗   新一代 FPGA的速度變得越來(lái)越快,密度變得越來(lái)越高,邏輯資源也越來(lái)越多。那么如何才能確保功耗不隨這些一起增加呢?很多設計抉擇可以影響系統的功耗,這些抉擇包括從顯見(jiàn)的器件選擇到細小的基于使用頻率的狀態(tài)機值的選擇等。   為了更好地理解本文將要討論的設計技巧為什么能夠節省功耗,我們先對功耗做一個(gè)簡(jiǎn)單介紹。   功耗包含兩個(gè)因素:動(dòng)態(tài)功耗和靜態(tài)功耗。動(dòng)態(tài)功耗是指對器件內的容性負載充放電所需的功耗。它很大程度上取決于  頻率、電壓和負載
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擴頻通信系統的FPGA實(shí)現

  •   擴頻通信自上世紀50年代中期被美國軍方開(kāi)始研究以來(lái),一直為軍事通信所獨占,廣泛應用于軍事通信、電子對抗以及導航、測量等各個(gè)領(lǐng)域。進(jìn)入上世紀90年代以后,擴頻通信又開(kāi)始向各種民用通信領(lǐng)域發(fā)展,典型的如CDMA和GPS等。應用最廣的是直接序列擴頻方式(DSSS)。它是將待傳送的信息數據被偽隨機碼調制,實(shí)現頻譜擴展后再傳輸,接收端則采用相同的編碼進(jìn)行解調及相關(guān)處理,恢復原始信息數據。   本文采用VHDL語(yǔ)言、Altera公司的集成開(kāi)發(fā)環(huán)境QuartusII 6.0和Cyclone系列芯片EPlC3T14
  • 關(guān)鍵字: 通訊  無(wú)線(xiàn)  網(wǎng)絡(luò )  FPGA  無(wú)線(xiàn)  通信  

快速實(shí)現基于FPGA的脈動(dòng)FIR濾波器

  • 引言   目前,用FPGA(現場(chǎng)可編程門(mén)陣列)實(shí)現FIR(有限沖擊響應)濾波器的方法大多利用FPGA中LUT(查找表)的特點(diǎn)采用DA(分布式算法)或CSD碼等方法,將乘加運算操作轉化為位與、加減和移位操作。這些結構需要占用器件較多的LE(邏輯元件)資源,設計周期長(cháng),工作頻率低,實(shí)時(shí)性差。本文提出一種基于Stratix系列FPGA器件的新的實(shí)時(shí)高速脈動(dòng)FIR濾波器的快速實(shí)現方法。利 用FGPA集成的DSP(數字信號處理器)乘加模塊定制卷積運算單元,利用VHDL(甚高速集成電路硬件描述語(yǔ)言)元件例化語(yǔ)句快
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采用FPGA的圖像采集卡的設計

  •   現代化生產(chǎn)和科學(xué)研究對視頻圖像采集系統的要求日益提高。傳統的圖像采集卡速度慢、處理功能簡(jiǎn)單、采用分立元件、電路非常復雜;而且可靠性差、不易調試、不能很好地滿(mǎn)足特殊要求。FPGA(現場(chǎng)可編程門(mén)陣列)是專(zhuān)用集成電路中集成度最高的一種,用戶(hù)可對FPGA內部的邏輯模塊和I/O模塊重新配置,以實(shí)現用戶(hù)所需邏輯功能。用戶(hù)對FPGA的編程數據放入芯片,通過(guò)上電加載到FPGA中,對其進(jìn)行初始化;也可在線(xiàn)對其編程,實(shí)現系統在線(xiàn)重構?;贔PGA技術(shù)的圖像采集主要是通過(guò)集成的FPGA開(kāi)發(fā)板,使用軟件編程把圖像的采集控制程
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利用Virtex-5 FPGA降低功耗

  • 在本文中,我將分析功耗降低所帶來(lái)的好處。還將介紹 Virtex-5 器件中所使用的多種技術(shù)和結構上的革新,它們能提供功耗最低的解決方案,并且不會(huì )在性能上有任何折扣。

  • 關(guān)鍵字: Virtex  FPGA  低功耗    

基于FPGA的OQPSK解調器的設計與實(shí)現

  • 根據軟件無(wú)線(xiàn)電的思想,以FPGA器件為核心實(shí)現了OQPSK的解調,大部分功能由FPGA內部資源來(lái)實(shí)現。
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xilinx fpga介紹

  Xilinx FPGA   Xilinx FPGA主要分為兩大類(lèi),一種側重低成本應用,容量中等,性能可以滿(mǎn)足一般的邏輯設計要求,如Spartan系列;還有一種側重于高性能應用,容量大,性能能滿(mǎn)足各類(lèi)高端應用,如Virtex系列,用戶(hù)可以根據自己實(shí)際應用要求進(jìn)行選擇。 在性能可以滿(mǎn)足的情況下,優(yōu)先選擇低成本器件。   Xilinx FPGA可編程邏輯解決方案縮短了電子設備制造商開(kāi)發(fā)產(chǎn)品的時(shí)間 [ 查看詳細 ]

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