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智權半導體/SmartDV力助高速發(fā)展的中國RISC-V CPU IP廠(chǎng)商走上高質(zhì)量發(fā)展之道
- 進(jìn)入2024年，全球RISC-V社群在技術(shù)和應用兩個(gè)方向上都在加快發(fā)展，中國國內的RISC-V CPU IP提供商也在內核性能和應用擴展方面取得突破。從幾周前在杭州舉行的2024年RISC-V中國峰會(huì )以及其他行業(yè)活動(dòng)和廠(chǎng)商活動(dòng)中，可以清楚地看到這一趨勢。作為全球領(lǐng)先的IP供應商，SmartDV也從其中國的客戶(hù)和志趣相投的RISC-V CPU IP供應商那里獲得了一些建議和垂詢(xún)，希望和我們建立伙伴關(guān)系攜手在A(yíng)I時(shí)代共同推動(dòng)芯片產(chǎn)業(yè)繼續高速發(fā)展。SmartDV也看到了這一新的浪潮。上一次在行業(yè)慶祝RISC-V
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將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿(mǎn)挑戰的任務(wù)！
- 本系列文章從數字芯片設計項目技術(shù)總監的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規劃進(jìn)行結合，詳細講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項目時(shí)，必須認真考慮的一些問(wèn)題。文章從介紹使用預先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設計時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細分享了利用ASIC IP來(lái)在FPGA上開(kāi)發(fā)原型驗證系統設計時(shí)需要考量的因素。在上篇文章中，我們分享了第二到第四主題，介紹了使用FPGA進(jìn)行原型設計時(shí)需要立即想到哪些基本概念、在將專(zhuān)為ASIC技術(shù)而設計的I
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新思科技推出業(yè)內首款獲得ISO/SAE 21434網(wǎng)絡(luò )安全合規認證的IP產(chǎn)品，加速汽車(chē)安全領(lǐng)域發(fā)展
- 摘要：●? ?新思科技ARC HS4xFS處理器IP和新思科技IP開(kāi)發(fā)流程均通過(guò)獨立審計機構SGS-T?V Saar的ISO/SAE 21434認證?！? ?獲得ISO/SAE 21434認證可應對不斷變化的網(wǎng)絡(luò )安全威脅，有助于在整個(gè)生命周期內為汽車(chē)系統提供長(cháng)期的安全性與可靠性?！? ?經(jīng)過(guò)安全風(fēng)險分析（SRA）認證的新思科技ARC HS4xFS處理器IP助力開(kāi)發(fā)者能夠以安全的方式將IP集成到系統中，從而滿(mǎn)足ISO/SAE 21434要求?！?n
- 關(guān)鍵字： 新思科技 ISO/SAE 21434 網(wǎng)絡(luò )安全合規認證 IP 汽車(chē)安全
將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿(mǎn)挑戰的任務(wù)!
- 本系列文章從數字芯片設計項目技術(shù)總監的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設計和驗證規劃進(jìn)行結合，詳細講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項目時(shí)，必須認真考慮的一些問(wèn)題。文章從介紹使用預先定制功能即IP核的必要性開(kāi)始，通過(guò)闡述開(kāi)發(fā)ASIC原型設計時(shí)需要考慮到的IP核相關(guān)因素，用八個(gè)重要主題詳細分享了利用ASIC所用IP來(lái)在FPGA上開(kāi)發(fā)原型驗證系統設計時(shí)需要考量的因素。在上篇文章中，我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性，并對原型設計中各種考量因素進(jìn)行了總體概述，分析開(kāi)發(fā)A
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燦芯半導體發(fā)布通用高性能小數分頻鎖相環(huán)IP及相關(guān)解決方案
- 一站式定制芯片及IP供應商——燦芯半導體（上海）股份有限公司近日宣布成功研發(fā)出一款通用高性能小數分頻鎖相環(huán)（fractional-N PLL） IP，支持24bits高精度小數分頻，最高輸出頻率4.5Ghz，另外還支持擴頻時(shí)鐘（SSC）功能，可以為客戶(hù)提供多功能的小數分頻 PLL解決方案。PLL電路一般用于產(chǎn)生輸出頻率，輸出頻率值與PLL的參考輸入頻率呈倍數關(guān)系。小數分頻PLL通過(guò)頻率乘法比例的小數值，實(shí)現更精確的輸出頻率控制，從而提供更高精度和準確度的輸出頻率。SSC發(fā)生器是在一定頻率范圍內調制時(shí)鐘信號
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IC設計倚重IP、ASIC趨勢成形
- 半導體制程進(jìn)入2奈米，擷發(fā)科技董事長(cháng)楊健盟指出，IC設計難度陡增，未來(lái)硅智財、ASIC角色將更加吃重，協(xié)助IC設計以SoC方式因應AI新世代。楊健盟分析，過(guò)往IDM分拆晶圓代工之典范，將在IC設計上發(fā)生，AI時(shí)代IC設計大者恒大趨勢成形。 擷發(fā)科技已獲國際芯片大廠(chǎng)AI芯片外包訂單，楊健盟認為，現在芯片晶體管動(dòng)輒百億個(gè)，考驗IC設計業(yè)者研發(fā)量能。大量采用基礎、接口IP使研發(fā)能力更能專(zhuān)注前段設計，海外大廠(chǎng)甚至將后段交由ASIC業(yè)者，未來(lái)倚重IP、ASIC趨勢只會(huì )更加明顯。中國臺灣半導體產(chǎn)業(yè)鏈在邏輯先進(jìn)制程、先
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半導體知識產(chǎn)權市場(chǎng)規模將增長(cháng)27.1億美元
- 根據Technavio的報告，全球半導體知識產(chǎn)權（IP）市場(chǎng)規模預計將在2024年至2028年間增長(cháng)27.1億美元。預計在預測期內，市場(chǎng)的復合年增長(cháng)率（CAGR）將超過(guò)7.47%。復雜芯片設計和多核技術(shù)的使用推動(dòng)了市場(chǎng)的增長(cháng)，同時(shí)納米光子集成電路（ICs）的出現也是一大趨勢。然而，半導體IP的重復使用構成了一項挑戰。主要市場(chǎng)參與者包括Achronix Semiconductor Corp.、Advanced Micro Devices Inc.、Alphawave IP Group plc、Arm Ltd
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Arm發(fā)布基于3nm芯片工藝的新CPU、GPU IP
- 芯片設計公司Arm今日發(fā)布了針對旗艦智能手機的新一代CPU和GPU IP（設計方案）：Cortex-X925 CPU、Immortalis G925 GPU。新產(chǎn)品均使用了其最新的Armv9架構，基于臺積電3nm制程工藝方案，針對終端設備在A(yíng)I應用上的性能進(jìn)行設計優(yōu)化。此外還將提供軟件工具，讓開(kāi)發(fā)人員更容易在采用Arm架構的芯片上運行生成式AI聊天機器人和其他AI代碼。預計搭載最新內核設計的手機將于2024年底上市。據官方介紹，新的CPU與GPU IP是目前旗下同類(lèi)產(chǎn)品中性能最強的一代，新CPU性能提升3
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西門(mén)子推出 Solido IP 驗證套件，為下一代 IC 設計提供端到端的芯片質(zhì)量保證
- ●? ?西門(mén)子集成的驗證套件能夠在整個(gè)IC設計周期內提供無(wú)縫的IP質(zhì)量保證，為IP開(kāi)發(fā)團隊提供完整的工作流程西門(mén)子數字化工業(yè)軟件日前推出 Solido? IP 驗證套件 (Solido IP Validation Suite)，這是一套完整的自動(dòng)化簽核解決方案，可為包括標準單元、存儲器和 IP 模塊在內的設計知識產(chǎn)權 (IP) 提供質(zhì)量保證。這一全新的解決方案提供完整的質(zhì)量保證 (QA) 覆蓋范圍，涵蓋所有 IP 設計視圖和格式，還可提供 “版本到版本” 的 IP 認證，能夠提升完整芯
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炬芯科技的智能手表SoC采用了芯原的2.5D GPU IP
- 芯原股份近日宣布低功耗?AIoT?芯片設計廠(chǎng)商炬芯科技股份有限公司（炬芯科技，?股票代碼：688049.SH）在其高集成度的雙模藍牙智能手表SoC? ATS3085S和ATS3089系列中采用了芯原低功耗且功能豐富的2.5D圖形處理器（GPU）IP。?炬芯科技的智能手表SoC ATS3085S和ATS3089系列擁有卓越的圖形顯示性能，采用2D+2.5D雙GPU硬件加速配置，支持JPEG硬件解碼，具有高幀率、低功耗等特點(diǎn)。該系列SoC以其高集成度，可實(shí)現單
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一文把TCP/IP協(xié)議講絕了！
- 本文整理了一些TCP/IP協(xié)議簇中需要必知必會(huì )的十大問(wèn)題，既是面試高頻問(wèn)題，又是程序員必備基礎素養。一、TCP/IP模型TCP/IP協(xié)議模型（Transmission Control Protocol/Internet Protocol），包含了一系列構成互聯(lián)網(wǎng)基礎的網(wǎng)絡(luò )協(xié)議，是Internet的核心協(xié)議?；赥CP/IP的參考模型將協(xié)議分成四個(gè)層次，它們分別是鏈路層、網(wǎng)絡(luò )層、傳輸層和應用層。下圖表示TCP/IP模型與OSI模型各層的對照關(guān)系。TCP/IP協(xié)議族按照層次由上到下，層層包裝。最上面的是應用層
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銳成芯微亮相北京車(chē)展 發(fā)布應用于wBMS的藍牙RF IP
- 25日，北京國際車(chē)展火熱開(kāi)幕，銳成芯微攜旗下車(chē)規級IP亮相車(chē)展中國芯展區，并發(fā)布應用于wBMS（無(wú)線(xiàn)電池管理系統）的車(chē)規級藍牙RF IP。銳成芯微亮相2024北京車(chē)展中國芯展區（左）隨著(zhù)電動(dòng)汽車(chē)和新能源市場(chǎng)的快速發(fā)展，電池管理系統的需求也在不斷增加。無(wú)線(xiàn)電池管理系統（wBMS）作為提升電池性能、安全性和可靠性的關(guān)鍵技術(shù)之一，正逐漸成為汽車(chē)廠(chǎng)商、特別是頭部汽車(chē)廠(chǎng)商的關(guān)注焦點(diǎn)。而車(chē)規級藍牙RF IP作為wBMS中的重要組成部分，結合了藍牙的通信能力和RF IP的定位功能，為實(shí)現安全可靠的電池管理保駕護航。立足
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嘉楠基于RISC-V的端側AIoT SoC采用了芯原的ISP IP和GPU IP
- 芯原股份（芯原）近日宣布嘉楠科技（嘉楠）全球首款支持RISC-V Vector 1.0標準的商用量產(chǎn)端側AIoT芯片K230集成了芯原的圖像信號處理器（ISP）IP ISP8000、畸變矯正（DeWarp）處理器IP DW200，以及2.5D圖形處理器（GPU）IP GCNanoV。該合作極大地優(yōu)化了高精度、低延遲的端側AIoT解決方案，可廣泛適用于各類(lèi)智能產(chǎn)品及場(chǎng)景，如邊緣側大模型多模態(tài)接入終端、3D結構光深度感知模組、交互型機器人、開(kāi)源硬件，以及智能制造、智能家居和智能教育相關(guān)硬件設備等。芯原的ISP
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芯原業(yè)界領(lǐng)先的嵌入式GPU IP賦能先楫高性能的HPM6800系列RISC-V MCU
- 2024年3月4日，中國上?！驹煞荩ㄐ驹?，股票代碼：688521.SH）今日宣布先楫半導體（簡(jiǎn)稱(chēng)“先楫”）的HPM6800系列新一代數字儀表顯示及人機界面系統應用平臺采用了芯原的高性能2.5D圖形處理器（GPU）IP。HPM6800系列產(chǎn)品基于RISC-V CPU內核，具備高算力、低功耗、高集成度和出色的多媒體功能，適用于汽車(chē)儀表、人機交互界面（HMI），以及電子后視鏡（CMS）等需要復雜圖形處理、高分辨率顯示和高性能多媒體用戶(hù)界面的應用。 芯原支持OpenVG的2.5D GPU IP能夠
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采用芯原NPU IP的AI類(lèi)芯片已在全球出貨超過(guò)1億顆
- 芯原股份近日宣布集成了芯原神經(jīng)網(wǎng)絡(luò )處理器（NPU）IP的人工智能（AI）類(lèi)芯片已在全球范圍內出貨超過(guò)1億顆，主要應用于物聯(lián)網(wǎng)、可穿戴設備、智慧電視、智慧家居、安防監控、服務(wù)器、汽車(chē)電子、智能手機、平板電腦、智慧醫療等10個(gè)市場(chǎng)領(lǐng)域。在過(guò)去七年里，芯原在嵌入式AI/NPU領(lǐng)域全球領(lǐng)先，其N(xiāo)PU IP已被72家客戶(hù)用于上述市場(chǎng)領(lǐng)域的128款AI芯片中。芯原的NPU IP是一款高性能的AI處理器IP，采用了低功耗、可編程和可擴展的架構設計。它可以靈活配置，以滿(mǎn)足客戶(hù)對芯片尺寸和功耗的不同要求，使之成為具有成本效
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歡迎您創(chuàng )建該詞條，闡述對ip cam的理解，并與今后在此搜索ip cam的朋友們分享。 創(chuàng )建詞條
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