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FPGA開(kāi)發(fā)要注意的十大要點(diǎn)

  • FPGA開(kāi)發(fā)要注意的十大要點(diǎn)-FPGA器件選型的7個(gè)原則:器件供貨渠道和開(kāi)發(fā)工具的支持、器件的硬件資源、器件的電氣接口標準、器件的速度等級、器件的穩定等級、器件的封裝和器件的價(jià)格。
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6系列FPGA中使用塊RAM的心得(4)

  • 6系列FPGA中使用塊RAM的心得(4)-然后調用sinplify,對其進(jìn)行綜合,結果很不順利。首先是synplify報不支持器件,才發(fā)現synplify 9.6.2是2008年的產(chǎn)品,比Spartan6器件還要老。更新到Synplify Pro D-2010.03之后,器件是支持了,但是一綜合就報錯停止了,卻不提示有什么錯誤。
  • 關(guān)鍵字: FPGA  RAM  

6系列FPGA中使用塊RAM的心得(3)

  • 6系列FPGA中使用塊RAM的心得(3)-接下來(lái)就是調用IPcore,來(lái)產(chǎn)生ROM的IP了。流程就不多講了,不清楚的同學(xué)可以看書(shū),也可以簡(jiǎn)單瀏覽一下。在建立IPcore的時(shí)候,選擇為Block Memory Generator,就進(jìn)入了塊RAM的調用。
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ASIC設計轉FPGA時(shí)需要注意的幾點(diǎn)

  • ASIC設計轉FPGA時(shí)需要注意的幾點(diǎn)-FPGA原型驗證和其他驗證方法是不同的,任何一種其他驗證方法都是ASIC驗證中的一個(gè)環(huán)節,而FPGA驗證卻是一個(gè)過(guò)程。
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FPGA開(kāi)發(fā)基礎知識問(wèn)答

  • FPGA開(kāi)發(fā)基礎知識問(wèn)答-首先要將安裝的ModelSim目錄下的ModelSim.ini屬性設置為存檔類(lèi)型(去掉只讀)
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FPGA開(kāi)發(fā)要掌握的六大基礎知識(3)

  • FPGA開(kāi)發(fā)要掌握的六大基礎知識(3)-Xilinx FPGA開(kāi)發(fā)軟件為ISE.現在其版本更新比較快,大家現在常用的版本都在ISE12.1了。
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影響FPGA設計周期生產(chǎn)力的最大因素是什么?

  • 影響FPGA設計周期生產(chǎn)力的最大因素是什么?-提高FPGA設計生產(chǎn)力的工具、技巧和方法,9影響FPGA設計周期生產(chǎn)力的最大因素是什么?
  • 關(guān)鍵字: FPGA  時(shí)序  

FPGA學(xué)習的四大誤區

  • FPGA學(xué)習的四大誤區-FPGA為什么是可以編程的?恐怕很多菜鳥(niǎo)不知道,他們也不想知道。因為他們覺(jué)得這是無(wú)關(guān)緊要的。他們潛意識的認為可編程嘛,肯定就是像寫(xiě)軟件一樣啦。軟件編程的思想根深蒂固,看到Verilog或者VHDL就像看到C語(yǔ)言或者其它軟件編程語(yǔ)言一樣。
  • 關(guān)鍵字: FPGA  可編程邏輯  

在FPGA開(kāi)發(fā)中盡量避免全局復位的使用?(2)

  • 在FPGA開(kāi)發(fā)中盡量避免全局復位的使用?(2)-在Xilinx 的FPGA器件中,全局的復位/置位信號(Global Set/Reset (GSR))(可以通過(guò)全局復位管腳引入)是幾乎絕對可靠的,因為它是芯片內部的信號。
  • 關(guān)鍵字: FPGA  

如何使用腳本對Xilinx FPGA編程

  • 如何使用腳本對Xilinx FPGA編程-最近在做一個(gè)GUI的項目,想試著(zhù)用FPGA實(shí)現一個(gè)簡(jiǎn)單的GUI。硬件基本模塊和整個(gè)硬件系統已經(jīng)完成設計,但是軟件程序上還處在調試階段,由于程序比較大,FPGA內部的BRAM已經(jīng)完全不夠用了,只能將運行的程序放到DDR DRAM中
  • 關(guān)鍵字: GUI  FPGA  Xilinx  

為基于FPGA的嵌入式系統進(jìn)行安全升級

  • 為基于FPGA的嵌入式系統進(jìn)行安全升級-“系統正在更新,請勿關(guān)閉電源?!蔽覀兌伎吹竭^(guò)這個(gè)警告,它通常在電子器件要在閃存安裝代碼更新時(shí)出現。如果更新被中斷,閃存將無(wú)法正確更新,代碼將會(huì )損壞,而器件無(wú)法運行,即“磚頭化” (bricked)。這種大家熟悉的警告存在的原因,是因為使用閃存的大多數半導體器件在編程或擦除操作期間需要一直供電。顯然,防止器件“磚頭化”是非常重要的。但是,只發(fā)出警告就夠了嗎?有些嵌入式器件甚至都沒(méi)有用戶(hù)顯示器,因此無(wú)法產(chǎn)生警告。在設計中如何才能確??煽壳野踩倪h程系統更新呢?
  • 關(guān)鍵字: fpga  嵌入式系統  

FPGA全局時(shí)鐘和第二全局時(shí)鐘資源的使用方法

  • FPGA全局時(shí)鐘和第二全局時(shí)鐘資源的使用方法-目前,大型設計一般推薦使用同步時(shí)序電路。同步時(shí)序電路基于時(shí)鐘觸發(fā)沿設計,對時(shí)鐘的周期、占空比、延時(shí)和抖動(dòng)提出了更高的要求。為了滿(mǎn)足同步時(shí)序設計的要求,一般在FPGA設計中采用全局時(shí)鐘資源驅動(dòng)設計的主時(shí)鐘,以達到最低的時(shí)鐘抖動(dòng)和延遲。
  • 關(guān)鍵字: 全局時(shí)鐘  FPGA  賽靈思  

Verilog設計中的一些避免犯錯的小技巧

  • Verilog設計中的一些避免犯錯的小技巧-這是一個(gè)在設計中常犯的錯誤列表,這些錯誤常使得你的設計不可靠或速度較慢,為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過(guò)所有的這些檢查。
  • 關(guān)鍵字: FPGA  Verilog  

基于verilog的FPGA編程經(jīng)驗總結

  • 基于verilog的FPGA編程經(jīng)驗總結-用了半個(gè)多月的ISE,幾乎全是自學(xué)起來(lái)的,碰到了很多很多讓人DT好久的小問(wèn)題,百度也百不到,后來(lái)還是都解決了,為了盡量方便以后的剛學(xué)ISE的童鞋不再因為一些小問(wèn)題而糾結,把這幾天的經(jīng)驗總結了一下。好了,廢話(huà)不多說(shuō),上料!
  • 關(guān)鍵字: verilog  FPGA  

多核處理器會(huì )取代FPGA嗎?

  • 多核處理器會(huì )取代FPGA嗎?-有人認為諸如圖形處理器(GPU)和Tilera處理器等多核處理器在某些應用中正逐步替代現場(chǎng)可編程門(mén)陳列(FPGA)。理由是這些多核處理器的處理性能要高很多,例如,由于GPU起初主要負責圖形繪制,因此,其尤其善于處理單精度(SP)及(某種情況下)雙精度(DP)浮點(diǎn)(FP)運算。
  • 關(guān)鍵字: FPGA  GPU  Tilera  
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