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組合運用多種智能I/O規劃工具能使引腳分配過(guò)程變輕松

  • 組合運用多種智能I/O規劃工具能使引腳分配過(guò)程變輕松-對于需要在PCB板上使用大規模FPGA器件的設計人員來(lái)說(shuō)，I/O引腳分配是必須面對的眾多挑戰之一。
  • 關(guān)鍵字： 賽靈思  FPGA  

FPGA與單片機實(shí)現數據串行通信的解決方案

  • FPGA與單片機實(shí)現數據串行通信的解決方案-本文針對由FPGA構成的高速數據采集系統數據處理能力弱的問(wèn)題，提出FPGA與單片機實(shí)現數據串行通信的解決方案。
  • 關(guān)鍵字： FPGA  串行通信  

FPGA與DSPs高速互聯(lián)的方案

  • FPGA與DSPs高速互聯(lián)的方案-DSP與FPGA高速的數據傳輸有三種常用接口方式: EMIF, HPI 和 McBSP 方式。而采用 EMIF 接口方式, 利用 FPGA ( 現場(chǎng)可編程邏輯門(mén)陣列) 設計 FIFO的接口電路，即可實(shí)現高速互聯(lián)。
  • 關(guān)鍵字： FPGA  DSPs  

FPGA設計中對輸入信號的處理

  • FPGA設計中對輸入信號的處理-一般來(lái)說(shuō)，在全同步設計中，如果信號來(lái)自同一時(shí)鐘域，各模塊的輸入不需要寄存。只要滿(mǎn)足建立時(shí)間，保持時(shí)間的約束，可以保證在時(shí)鐘上升沿到來(lái)時(shí)，輸入信號已經(jīng)穩定，可以采樣得到正確的值。
  • 關(guān)鍵字： FPGA  全同步設計  

3系列FPGA中使用LUT構建分布式RAM(4)

  • 3系列FPGA中使用LUT構建分布式RAM(4)-前面講了分布式RAM的方方面面，下面以RAM_16S為例，分別給出其在VHDL和Verilog HDL下面的模板代碼（在ISE Project Navigator中選擇 Edit--- Language Templates，然后選擇VHDL 或者Verilog, 最后是Synthesis Templates --- RAM，在中也有具體調用過(guò)程的描述）
  • 關(guān)鍵字： FPGA  LUT  RAM  

3系列FPGA中使用LUT構建分布式RAM（3）

  • 3系列FPGA中使用LUT構建分布式RAM（3）-前面簡(jiǎn)要介紹了Spartan-3系列FPGA中分布式RAM的基本特性。為什么不從更高級的Virtex系列入手呢？我仔細看了一下各個(gè)系列的介紹、對比，Spartan系列基本就是Virtex系列的精簡(jiǎn)版，其基本原理是一樣的，所以從簡(jiǎn)單的入手來(lái)融會(huì )貫通未嘗不是一個(gè)好辦法。
  • 關(guān)鍵字： FPGA  LUT  RAM  

3系列FPGA中使用LUT構建分布式RAM（1）

  • 3系列FPGA中使用LUT構建分布式RAM（1）-在賽靈思Spartan-3、3E等系列的FPGA中，其邏輯單元CLB中一般含有不同數量的單端口RAM（SRAM）或者雙端口RAM（DRAM），這里的“單”或者“雙”是由我們開(kāi)發(fā)人員定義的。
  • 關(guān)鍵字： FPGA  LUT  RAM  

3系列FPGA中使用LUT構建分布式RAM（2）

  • 3系列FPGA中使用LUT構建分布式RAM（2）-帶有異步寫(xiě)/同步讀的SRAM，其中的同步讀取可以使用與分布式RAM相關(guān)聯(lián)的觸發(fā)器實(shí)現。
  • 關(guān)鍵字： FPGA  LUT  RAM  

工程師對于有關(guān)FPGA項目的九大感言

  • 工程師對于有關(guān)FPGA項目的九大感言-要和人配合。以我們做硬件的工程師為例，測試的時(shí)候一般都需要軟件的配合，一個(gè)對硬件來(lái)說(shuō)無(wú)比復雜的工作，可能在軟件工程師看來(lái)就是幾行簡(jiǎn)單的代碼。
  • 關(guān)鍵字： FPGA  

未來(lái)只有懂FPGA開(kāi)發(fā)的人才堪稱(chēng)計算機專(zhuān)家？

  • 未來(lái)只有懂FPGA開(kāi)發(fā)的人才堪稱(chēng)計算機專(zhuān)家？-由于微電子和超大規模集成電路工藝技術(shù)設備的缺失，使國人根本沒(méi)有條件能夠自由地進(jìn)入這個(gè)領(lǐng)域體驗，這是一個(gè)嚴重的問(wèn)題。
  • 關(guān)鍵字： FPGA  嵌入式  計算機  

一個(gè)合格FPGA 工程師的基本要求

  • 一個(gè)合格FPGA 工程師的基本要求-一個(gè)合格的FPGA工程師需要掌握哪些知識？這里根據自己的一些心得總結一下，其他朋友可以補充啊。
  • 關(guān)鍵字： FPGA  Verilog  

ARM、DSP、FPGA的區別是什么？

  • ARM、DSP、FPGA的區別是什么？-ARM（Advanced RISC Machines）是微處理器行業(yè)的一家知名企業(yè)，設計了大量高性能、廉價(jià)、耗能低的RISC處理器、相關(guān)技術(shù)及軟件。
  • 關(guān)鍵字： ARM  DSP  FPGA  

FPGA學(xué)習流程總結

  • FPGA學(xué)習流程總結-熟悉數字電路，門(mén)電路，組合邏輯電路、時(shí)序邏輯電路
  • 關(guān)鍵字： FPGA  門(mén)電路  組合邏輯電路  

FPGA/CPLD設計小技巧

  • FPGA/CPLD設計小技巧-這是一個(gè)在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過(guò)所有的這些檢查 。
  • 關(guān)鍵字： FPGA  CPLD  

FPGA的結構特點(diǎn)與開(kāi)發(fā)

  • FPGA的結構特點(diǎn)與開(kāi)發(fā)-我這個(gè)題目想說(shuō)明的是，FPGA的內部的有其相應的Fabric，如何在開(kāi)發(fā)過(guò)程中最好最大限度的使用它。
  • 關(guān)鍵字： FPGA  SRL16  STARTUP  
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fpga-pwm介紹

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