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基于FPGA的循環(huán)冗余校驗碼設計

  • ? ? ?在現代數字通信中,要求信息在傳輸過(guò)程中造成的數字差錯必須足夠低。但由于通信信道存在噪聲和傳輸特性不 理想等原因造成了信號的碼間串擾,導致信息在傳輸過(guò)程產(chǎn) 生差錯。為了最大限度地保證通信過(guò)程中信息的完整性,需 要采用信道編碼技術(shù)對可能發(fā)生的差錯進(jìn)行有效地控制,而 循環(huán)冗余校驗碼就是其中一個(gè)最有效的編碼技術(shù)。1 ?循環(huán)冗余校驗碼基本思想循環(huán)冗余校驗碼是一種校錯能力很強且使用非常廣泛 的差錯檢驗方法。循環(huán)冗余校驗碼采用在發(fā)送的有用碼后面 加入校驗碼來(lái)實(shí)現數字通信
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英特爾新FPGA 臺積電20納米代工

  •   因應快速成長(cháng)的物聯(lián)網(wǎng)應用市場(chǎng),英特爾宣布推出Intel Cyclone 10可編程邏輯閘陣列(FPGAs)系列產(chǎn)品,均采用臺積電20納米先進(jìn)制程生產(chǎn)。這款FPGA的設計是要提供快速、省電的處理能力,并可適用于包括汽車(chē)、工業(yè)自動(dòng)化、專(zhuān)業(yè)影音及視覺(jué)系統等各種應用。   隨著(zhù)各種“物件”的連結程度愈來(lái)愈高,且能在彼此間相互分享大量的即時(shí)數據,數據也變得越來(lái)越不容易處理。來(lái)自于建筑物、工廠(chǎng)、家庭以及車(chē)輛上的各種感應器和攝影機的資訊傳送速度不斷地增加,因此單靠微處理器及微控制器(MCU
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人工智能的進(jìn)展及發(fā)展建議

  • 2017年1月12日,清華大學(xué)計算機系教授鄧志東在“科學(xué)傳播與科技期刊論壇暨刊媒惠年度大會(huì )”上,做了《擁抱人工智能的春天》的報告。介紹了四個(gè)方面:2016年人工智能迎來(lái)了春天,人工智能引起社會(huì )的極大關(guān)注,人工智能上升為國家發(fā)展戰略,發(fā)展我國人工智能技術(shù)與產(chǎn)業(yè)的建議。
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為何說(shuō)嵌入式FPGA改變了芯片和SoC的未來(lái)設計方式

  • 芯片設計人員在開(kāi)展項目時(shí),會(huì )知道他們在項目期間擁有隨時(shí)更改RTL的靈活性,這是前所未有的,這就是嵌入式FPGA帶來(lái)的改變。
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美樂(lè )威采用萊迪思半導體FPGA實(shí)現最新USB視頻采集設備

  •   南京美樂(lè )威電子科技有限公司(“Magewell”)今日宣布將在2017年發(fā)布的多款最新USB?3.0視頻采集設備中集成萊迪思半導體的ECP現場(chǎng)可編程門(mén)陣列(FPGA)系列產(chǎn)品,包括上個(gè)月剛發(fā)布的USB?Capture?Plus系列?! ⌒驴钜曨l采集產(chǎn)品結合了美樂(lè )威深厚的產(chǎn)品設計經(jīng)驗以及各行業(yè)的用戶(hù)反饋。美樂(lè )威采用LatticeECP3和ECP5?FPGA實(shí)現了更低功耗和更高性能的采集設備。全新的USB?Capture?Plus系列支持SDI、
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分布式異構處理的行業(yè)應用

  •   引言  通過(guò)按鈕與消費電子產(chǎn)品進(jìn)行互動(dòng)的時(shí)代已經(jīng)過(guò)去。人機交互在過(guò)去幾年中發(fā)生了巨大變化并仍不斷發(fā)展。本文將提供人機界面變化的一些實(shí)例,幫助讀者更充分地了解如何使用一種特別的架構實(shí)現低功耗解決方案,提升電池供電應用的用戶(hù)體驗。該架構由基于低功耗FPGA實(shí)現的異構處理單元實(shí)現?! ∪藱C界面(HMI)發(fā)展趨勢  大多數移動(dòng)設備在被喚醒進(jìn)入工作之前都會(huì )進(jìn)入睡眠或低功耗模式,所以您與設備的第一次交互操作即是喚醒。這種“喚醒”可以通過(guò)手腕翻轉、搖動(dòng)、單擊或雙擊、來(lái)電或消息、機械按鈕按壓以及特定短語(yǔ)、手勢或聲音(
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美高森美發(fā)布業(yè)界最低功耗的成本優(yōu)化FPGA產(chǎn)品系列

  •   致力于在功耗、安全、可靠性和性能方面提供差異化半導體技術(shù)方案的領(lǐng)先供應商美高森美公司(Microsemi?Corporation)宣布提供全新成本優(yōu)化PolarFire??現場(chǎng)可編程邏輯器件(FPGA)?產(chǎn)品系列,在中等密度范圍FPGA器件中具備了業(yè)界最低功耗、?12.7?Gbps串化/解串?(SerDes)收發(fā)器,以及領(lǐng)先的安全性和可靠性。該?FPGA產(chǎn)品系列適合廣泛的應用范圍,涵蓋有線(xiàn)?接入?網(wǎng)絡(luò )和?
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中密度FPGA燃起戰火,Microsemi發(fā)布PolarFire

  •   PolarFire橫空出世  在兩大FPGA巨擎激戰高密度FPGA市場(chǎng)時(shí),Microsemi近日在京召開(kāi)新聞發(fā)布會(huì ),宣布推出PolarFire?FPGA,定位低功耗、中等密度產(chǎn)品?! ∝撠烣PGA業(yè)務(wù)的系統級芯片產(chǎn)品組高級產(chǎn)品線(xiàn)營(yíng)銷(xiāo)總監Shakeel?Peera稱(chēng):Microsemi于2010年收購了Actel。因此,Microsemi的FPGA有三十年歷史。此次推出的PolarFire有四大優(yōu)勢:1.低功耗,比競爭對手低50%功耗;2.成本優(yōu)化;3.可靠性與安全性?xún)?yōu)勢;4.邏輯范
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英特爾推出面向工業(yè)和汽車(chē)市場(chǎng)的全新多功能FPGA

  • 為支持日益增多的物聯(lián)網(wǎng)(IoT)應用,英特爾公司今天發(fā)布了英特爾??Cyclone??10?系列現場(chǎng)可編程門(mén)陣列(FPGA)。該系列旨在提供快速、節能的處理能力,可用于廣泛領(lǐng)域,包括汽車(chē)、工業(yè)自動(dòng)化、專(zhuān)業(yè)視聽(tīng)和視覺(jué)系統等。隨著(zhù)“萬(wàn)物”具有更高的互聯(lián)水平并能夠彼此共享大量實(shí)時(shí)數據,數據處理變得愈發(fā)困難。建筑物、工廠(chǎng)、家庭和車(chē)輛中的傳感器和攝像頭發(fā)出的信息日益增多,微處理器或微控制器已經(jīng)無(wú)法單獨處理這些信息。英特爾FPGA等高性能處理設備能夠收集和發(fā)送數據,根據物聯(lián)網(wǎng)設備的輸入做
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人工智能、物聯(lián)網(wǎng)需要什么芯片?CPU和GPU將讓位于FPGA

  • 與傳統CPU和GPU相比,FPGA執行效率比CPU和GPU大幅提高,而在智能化、物聯(lián)網(wǎng)、機器人FPGA似乎無(wú)所不能,如果FPGA在行業(yè)巨頭的推動(dòng)下,成為大數據和物聯(lián)網(wǎng)時(shí)代的趨勢性IC,未來(lái)代替CPU\GPU也不是不可能。
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基于DSP處理器的紅外電視調焦控制器設計

  •   摘要:本文以DSP為核心處理器,配合FPGA和外圍電路,設計了一套光電跟蹤測量系統紅外電視調焦控制器,實(shí)現了根據目標距離和環(huán)境溫度等參數對電視焦距進(jìn)行自動(dòng)調整。通過(guò)數據分析與實(shí)踐檢驗,該系統能夠滿(mǎn)足紅外電視的調焦控制要求。   1.引言   隨著(zhù)紅外成像技術(shù)的快速發(fā)展,紅外測量電視成為光電跟蹤系統的重要組成部分。紅外相機的自動(dòng)和連續調焦,是保證紅外電視成像質(zhì)量,實(shí)現光電跟蹤系統高精度穩定跟蹤的關(guān)鍵技術(shù)。一般來(lái)說(shuō),影響紅外電視成像的因素有很多,而目標的距離和環(huán)境溫度等參數對成像質(zhì)量影響較大,如何根據
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FPGA競局 賽靈思進(jìn)展迅速直逼英特爾

  • 雖然英特爾目前仍然主宰數據中心市場(chǎng),但是后來(lái)者也在持續增長(cháng)中,如果英特爾不加快腳步趕上市場(chǎng)變化,英特爾可能慢慢失去在FPGA市場(chǎng)的霸主地位。
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FPGA 發(fā)展到頭了嗎?看FPGA 經(jīng)歷的幾個(gè)時(shí)代

  • FPGA 發(fā)展何時(shí)才能到頭?可編程性的基本價(jià)值已經(jīng)為業(yè)界所共識,小型、高效的邏輯操作可加速很多重要算法并降低功耗,FPGA 技術(shù)會(huì )持續存在, 并不斷發(fā)展演進(jìn)。
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FPGA設計異步復位同步釋放有講究

  •   異步復位同步釋放  首先要說(shuō)一下同步復位與異步復位的區別?! ⊥綇臀皇侵笍臀恍盘栐跁r(shí)鐘的上升沿或者下降沿才能起作用,而異步復位則是即時(shí)生效,與時(shí)鐘無(wú)關(guān)。異步復位的好處是速度快?! ≡賮?lái)談一下為什么FPGA設計中要用異步復位同步釋放?! 臀恍盘柕尼尫攀怯兄v究的:  我們知道,DFF的D端和clk端之間時(shí)序關(guān)系是有約束的,這種約束我們通過(guò)setup?time和hold?time來(lái)?check。即D端的data跳變的時(shí)刻要與clk端的時(shí)鐘上升沿(或者下降沿)跳變要錯開(kāi),如果
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內嵌Xilinx FPGA,由VisualApllet編程實(shí)現顛覆性嵌入式機器視覺(jué)系統

  •   背景:  早在2014年,All?Programmable技術(shù)和器件的全球領(lǐng)先的Xilinx公司聯(lián)手生態(tài)合作伙伴德國Silicon?Software公司推出了Silicon?Software公司的VisualApplet軟件平臺。這套軟件平臺針對Xilinx?Zynq-7000?All?Programmable?SoC實(shí)現了一個(gè)圖像化FPGA設計和編程的環(huán)境。之后此平臺幾乎顛覆了傳統的嵌入式機器視覺(jué)系統,為那些從事和尋找先進(jìn)的、高性
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