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FPGA研發(fā)之道(11)-設計不是湊波形(一)FIFO(上)
- FIFO是FPGA內部一種常用的資源，可以通過(guò)FPGA廠(chǎng)家的的IP生成工具生成相應的FIFO。FIFO可分為同步FIFO和異步FIFO，其區別主要是，讀寫(xiě)的時(shí)鐘是否為同一時(shí)鐘，如使用一個(gè)時(shí)鐘則為同步FIFO，讀寫(xiě)時(shí)鐘分開(kāi)則為異步FIFO。一般來(lái)說(shuō)，較大的FIFO可以選擇使用內部BLOCK RAM資源，而小的FIFO可以使用寄存器資源例化使用。 一般來(lái)說(shuō)，FIFO的主要信號包括： 實(shí)際使用中，可編程滿(mǎn)的信號(XILINX 的FIFO)較為常用，ALTERA的FIFO中，可以通過(guò)寫(xiě)深度(即寫(xiě)入
- 關(guān)鍵字： FPGA FIFO RAM
FPGA研發(fā)之道(4)靈活性的陷阱
- 如果說(shuō)用一個(gè)詞來(lái)描述FPGA的特性，靈活性肯定名列前茅。 FPGA的靈活性在于： (一)I/O的靈活性，其可以通過(guò)其I/O組成各種接口與各種器件連接，并且支持不同的電氣特性。 (二)內部存儲器靈活性，可以通過(guò)IP生成工具生成各種深度和寬度的RAM或者FIFO等。 (三)邏輯的靈活性，內部邏輯通可生成的各種類(lèi)型IP。 對于I/O接口來(lái)說(shuō)，FPGA的I/O可以支持不同類(lèi)型的電平和驅動(dòng)能力，各I/O未定義之前其地位平等，例如一個(gè)數據信號可將其約束在任意引腳，只要其電平符合連接的
- 關(guān)鍵字： FPGA RAM FIFO
賽普拉斯為其領(lǐng)先業(yè)界的高容量F-RAM產(chǎn)品線(xiàn)增添新的封裝方式和溫度范圍選項
- 賽普拉斯半導體公司日前宣布，其鐵電隨機存取存儲器(F-RAM™)產(chǎn)品系列中的1Mb并行異步接口F-RAM增加44-pin TSOPII封裝方式，其2 Mb串行外設接口(SPI)F-RAM的溫度范圍擴展為-40?C 至 +105?C。 新封裝方式可在替代標準的電池供電的SRAM時(shí)實(shí)現管腳兼容，應用于工業(yè)自動(dòng)化、計算、網(wǎng)絡(luò )和汽車(chē)電子應用中的關(guān)鍵任務(wù)系統中。F-RAM與生俱來(lái)的非易失性可以實(shí)現瞬間數據捕獲，無(wú)需電池即可實(shí)現長(cháng)達百年的保存時(shí)間。棄用電池可以降低系統成本和復雜性。2 Mb SP
- 關(guān)鍵字： 賽普拉斯 F-RAM SRAM
多參數室內環(huán)境智能監測系統設計
- 摘要：針對室內環(huán)境質(zhì)量與人們的健康和工作效率密切相關(guān)的情況，設計了一種多參數多采集點(diǎn)室內環(huán)境監測系統。系統硬件主要包括單片機系統、FPGA數據采集電路、傳感器信號調理電路等。軟件包括單片機硬件驅動(dòng)程序、FPGA數字邏輯設計和基于VB的上位機應用程序。實(shí)驗結果表明：系統工作穩定，誤差在設計允許范圍內。 引言 隨著(zhù)經(jīng)濟持續快速發(fā)展，人們的生活水平不斷提高，對各種室內環(huán)境的要求也越來(lái)越高。傳統的室內環(huán)境監測設備實(shí)時(shí)性差、精度低、體積大、功耗大，難以適應現代經(jīng)濟發(fā)展的要求?；谝陨媳尘?，本文設計了
- 關(guān)鍵字： FPGA 單片機 監測系統 傳感器 STC89C52 RAM 201409
基于FPGA的監測數字示波器設計
- 摘要：在核監測中，常將各種傳感器輸出的信號通過(guò)A/D轉換器轉換為數字信號，然后利用數字信號處理技術(shù)對各種核信號進(jìn)行數字處理。為了準確測量核信號數字波形的各種參數，對基于FPGA雙口RAM的數字示波器進(jìn)行了設計和測試分析。實(shí)驗表明，該數字示波器能準確獲取核信號的數字渡形及各種參數的值，可對核信號的波形進(jìn)行錄制、回放和精確分析，為核監測及其儀器準確設計提供有力的保證。 福島核事故促進(jìn)了核監測儀器的飛速發(fā)展。在核爆監測中，需對核輻射的各種信號如光輻射、放射線(xiàn)沾染、沖擊波、電磁輻射等進(jìn)行測量，通過(guò)測量這些信號的
- 關(guān)鍵字： FPGA RAM
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