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Cadence推出Tempus時(shí)序簽收解決方案
- 為設計收斂和簽收提供前所未有的性能和容量 Tempus?時(shí)序簽收解決方案提供的性能比傳統的時(shí)序分析解決方案提升了一個(gè)數量級。 可擴展性，能夠對具有上億個(gè)實(shí)例的設計進(jìn)行全扁平化分析。 集成的簽收精度的時(shí)序收斂環(huán)境利用創(chuàng )新的考慮物理layout的ECO技術(shù)，可以使設計閉合提前數周時(shí)間。 為簡(jiǎn)化和加速復雜IC的開(kāi)發(fā)，Cadence 設計系統公司推出Tempus? 時(shí)序簽收解決方案。這是一款新的靜態(tài)時(shí)序分析與收斂工具，旨在幫助系統級芯片 (SoC) 開(kāi)發(fā)者加速時(shí)序收斂，將芯片設計快速轉
- 關(guān)鍵字： Cadence Tempus 時(shí)序簽收
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