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Chirp：用聲吶識別手勢控制智能手表

  • 可穿戴技術(shù)最熱門(mén)的設備之一當屬智能手表，但是智能手表有件事情比較令人抓狂，那就是屏幕太小。不過(guò)加州大學(xué)伯克利及戴維斯分校的研究人員已經(jīng)開(kāi)發(fā)出了一種利用超聲波的微型芯片，將這種芯片集成進(jìn)可穿戴設備后，后者就可以識別 3D 手勢。屆時(shí)你只要比劃幾下就可以讓它聽(tīng)從指示了。
  • 關(guān)鍵字： Chirp  智能手表  

基于鎖相環(huán)的Chirp超寬帶信號源的設計與實(shí)現

  • 摘要：在傳統的模擬法產(chǎn)生Chirp超寬帶信號的基礎上，提出了一種基于鎖相環(huán)(PLL)法的Chirp超寬帶信號源設計方案。與傳統的模擬方法相比，該方法產(chǎn)生的Chirp超寬帶信號載頻穩定性高，能夠達到參考信號的頻率穩定度。從
  • 關(guān)鍵字： 設計  實(shí)現  信號源  寬帶  相環(huán)  Chirp  基于  

基于NCOIPcore的Chirp函數實(shí)現設計

  • 隨著(zhù)電子系統的越來(lái)越復雜，PLD設計的越來(lái)越龐大，這就增加了市場(chǎng)對IP核的需求，各大FPGA／CPLD廠(chǎng)商陸續推出了許多IP核。
  • 關(guān)鍵字： NCOIPcore  Chirp  函數    

基于NCO IP core的Chirp函數實(shí)現設計

  • 首先分析Chirp函數在頻域上的一般特性，并且分析Altrea公司提供的數控振蕩器知識產(chǎn)權核(NCO IP core)的輸入／輸出特性，通過(guò)MegaCore環(huán)境確定其輸入控制字，通過(guò)外圍邏輯電路實(shí)時(shí)向NCO IP core調入控制頻率控制字以達到改變輸出頻率的目的，并通過(guò)在示波器上觀(guān)測FPGA的運行情況，驗證了該設計具有很好的輸出效果。
  • 關(guān)鍵字： Chirp  core  NCO  IP    

一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案

  • 由于超寬帶信號的帶寬很寬，傳統的信號產(chǎn)生辦法已不能直接應用于超寬帶通信。為此，提出一種基于DDS+PLL的Chirp-UWB信號產(chǎn)生方案，該方法聯(lián)合使用了DDS和PLL兩種信號產(chǎn)生技術(shù)，優(yōu)勢互補。通過(guò)ADS結合Matlab對系統的模型建立和性能分析證明，該方案輸出信號性能優(yōu)良，完全能滿(mǎn)足設計要求，并已成功應用于某超寬帶通信系統。
  • 關(guān)鍵字： 產(chǎn)生  方案  信號  Chirp-UWB  DDS  PLL  基于  轉換器  

基于DSP Builder的Chirp信號源設計

  • 設計分析了Chirp函數在時(shí)域和頻域內的一般特點(diǎn)和解析公式。提出首先在A(yíng)ltera DSP開(kāi)發(fā)工具DSP Builder中實(shí)現直接數字合成器(DDS)模塊，根據Chirp函數特定的輸入／輸出(線(xiàn)性和非線(xiàn)性)關(guān)系，計算出當前輸入字與輸出頻率的對應關(guān)系；然后設計控制字子模塊產(chǎn)生DDS模塊的頻率控制字，驅動(dòng)DDS產(chǎn)生不同的輸出頻率，通過(guò)在Matlab的Simu-link環(huán)境下的仿真驗證，得出不同時(shí)刻輸出的頻譜圖，驗證了該設計能很好地實(shí)現Chirp信號源。
  • 關(guān)鍵字： Builder  Chirp  DSP  信號源    

Chirp函數的Nios Ⅱ嵌入式實(shí)現

  • Chirp函數的Nios Ⅱ嵌入式實(shí)現,摘 要：首先分析Chirp函數在頻域上的一般特性，提出利用FPGA的嵌入式軟核NiosⅡ處理器在嵌入式操作系統μC／OS－Ⅱ上實(shí)現Chirp的方法，即通過(guò)NiosⅡ處理器根據Chirp函數在頻域上頻率的跳變情況實(shí)時(shí)改變輸出DDS(直接數
  • 關(guān)鍵字： 實(shí)現  嵌入式  Nios  函數  Chirp  
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