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40/100G高速以太網(wǎng)測試解決方案

  • 標簽:以太網(wǎng) 并行通道隨著(zhù)40/100G高速以太網(wǎng)標準IEEE 802.3ba的標準最終確定,網(wǎng)絡(luò )設備廠(chǎng)商在40/100G方面開(kāi)始推出產(chǎn)品,運營(yíng)商也開(kāi)始評估高速網(wǎng)絡(luò )的未來(lái)發(fā)展方向。40/100G和10G以太網(wǎng)相比較,主要是在光電接口和物
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ARM 20nm處理器明年到來(lái)

  • 我們獲悉,ARM第一款20nm處理器,將在明年年底上市。ARM今天對外確認,首款20nm處理器將在2013年底出現。和目前設計相比,新的20nm處理器將帶來(lái)卓越性能和出色的功耗效率。當然,ARM目前還沒(méi)有公布具體參數,但是其很
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AFM:應對65nm以下測量技術(shù)挑戰

  • 半導體工業(yè)目前已經(jīng)進(jìn)入65納米及以下技術(shù)時(shí)代,關(guān)鍵特征通常為納米級,如此小特征的制造工藝要求特殊的測量?jì)x器,以便能夠表征出納米級幾何尺寸,從而檢驗出任何偏離工藝規格中心值的情況,確保與設計規格保持一致。
  • 關(guān)鍵字: AFM  65  nm  測量技術(shù)    

一種用于13 bit 40 MS/s流水線(xiàn)ADC中的采樣保持電路

  • 近年來(lái),隨著(zhù)通信和多媒體市場(chǎng)的快速增長(cháng),數字系統無(wú)論在處理能力還是處理速度上都取得了飛速的發(fā)展,因此對作為模擬信號通向數字信號橋梁的模數轉換器(ADC)的性能要求也越來(lái)越高 [1]。在各種ADC結構中,流水線(xiàn)ADC在
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可用10DB為單位選定40~90DB增益的可編程放大器電路

  • 電路的功能當用OP放大器進(jìn)行高倍數AC放大時(shí),若改變反饋電路的分壓比,使放大倍數改變,頻率特性也會(huì )大幅度地改變。本電路設有40、20、20、10DB增益固定的放大器,通過(guò)繼電器選用這些放大器,可使最大增益達90DB。本
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UPS逆變模塊的Nm冗余并聯(lián)結構和均流

  • 0 引言 隨著(zhù)國民經(jīng)濟的發(fā)展和用電設備的不斷增加,對UPS容量的要求越來(lái)越大。大容量的UPS有兩種構成方式:一種是采用單臺大容量UPS;另一種是在UPS單機內部采用功率模塊N+m冗余并聯(lián)結構。前者的缺點(diǎn)是成本高
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用FPGA解決65nm芯片設計難題

  •  隨著(zhù)工藝技術(shù)向65nm以及更小尺寸的邁進(jìn),出現了兩類(lèi)關(guān)鍵的開(kāi)發(fā)問(wèn)題:待機功耗和開(kāi)發(fā)成本。這兩個(gè)問(wèn)題在每一新的工藝節點(diǎn)上都非常突出,現在已經(jīng)成為設計團隊面臨的主要問(wèn)題。在設計方法上從專(zhuān)用集成電路(ASIC)和專(zhuān)
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可用10DB為單位選定40~90DB增益的可編程放大器

  • 電路的功能當用OP放大器進(jìn)行高倍數AC放大時(shí),若改變反饋電路的分壓比,使放大倍數改變,頻率特性也會(huì )大幅度地改變。本電路設有40、20、20、10DB增益固定的放大器,通過(guò)繼電器選用這些放大器,可使最大增益達90DB。本
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在28-nm FPGA 上實(shí)現集成100-GbE 交換解決方案

  • 隨著(zhù)高速100-GbE 通信網(wǎng)絡(luò )標準的完成,交換功能在互聯(lián)網(wǎng)正常運行中扮演了重要角色。網(wǎng)絡(luò )總流量每6個(gè)月翻倍,通過(guò)多種協(xié)議進(jìn)行傳送,網(wǎng)絡(luò )越來(lái)越復雜,交換體系結構面臨很大的挑戰。目前的單芯片體系結構無(wú)法滿(mǎn)足越來(lái)越大的帶寬和復雜度要求,因此,需要開(kāi)發(fā)高效算法和交換體系結構,以滿(mǎn)足高速網(wǎng)絡(luò )需求。Stratix V FPGA 支持硬件設計人員在下一代交換機和路由器中集成100-GbE 元件,在系統中均衡的分配數據,確保QoS。 詳情參見(jiàn) http://share.eepw.com.cn/share/downlo
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在28-nm FPGA 上實(shí)現100-Gbit OTN 復用轉發(fā)器解決方案

  • 視頻和寬帶無(wú)線(xiàn)技術(shù)對帶寬越來(lái)越高的要求使得通信網(wǎng)絡(luò )承受了很大的壓力。目前的10-Gbit OTN 基礎設備通道容量接近了極限,面臨帶寬耗盡的問(wèn)題。面對越來(lái)越高的資本支出和運營(yíng)支出以及不斷下滑的利潤,服務(wù)提供商轉向了100-Gbit OTN 解決方案,將目前的10-Gbit 網(wǎng)絡(luò )容量提高10 倍。但是,還有很多在用的低速率OTN、SONET、以太網(wǎng)和存儲系統,這需要通過(guò)100-Gbit OTN 復用轉發(fā)器將這些系統置入到新的基礎光設施中。Altera Stratix V FPGA 系列采用了多項關(guān)鍵創(chuàng )新技術(shù)
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Altera發(fā)布28-nm Stratix V FPGA系列

  • Stratix V FPGA突破帶寬瓶頸,同時(shí)降低了系統功耗和成本 2010年4月20號,北京——Altera公司(NASDAQ: ALTR)今天發(fā)布業(yè)界帶寬最大的FPGA——下一代28-nm Stratix? V FPGA。Stratix V FPGA具有1.6 Tbps串行交換能力,采用各種創(chuàng )新技術(shù)和前沿28-nm工藝,降低了寬帶應用的成本和功耗。 Stratix V FPGA系列采用TSMC 28-nm高性能(HP)工藝進(jìn)行制造,提供1
  • 關(guān)鍵字: Altera  28-nm  Stratix V FPGA  

在40G/100G 應用中使用10-Gbps收發(fā)器

  • 本白皮書(shū)介紹向100G 接口過(guò)渡的關(guān)鍵推動(dòng)力量,以及怎樣利用FPGA 特有的功能來(lái)實(shí)現這一高速接口。數據中心以及核心網(wǎng)系統中新出現的40GbE 和100GbE 標準主要依靠FPGA 來(lái)鏈接本系統和其他協(xié)議的基礎設備。Stratix IV
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采用帶有收發(fā)器的全系列40-nm FPGA 和ASIC 實(shí)現創(chuàng )

  • 人們對寬帶服務(wù)的帶寬要求越來(lái)越高,促使芯片供應商使用更多的高速串行收發(fā)器。因此,下一代應用采用了多種數據速率,從幾Mbps 到數百Gbps,在一種設備中集成了多種協(xié)議和服務(wù)。以太網(wǎng)等迅速發(fā)展的標準以及對提高
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在40-nm 工藝節點(diǎn)實(shí)現世界上最先進(jìn)的定制邏輯器件

  • 實(shí)現世界上最先進(jìn)的定制邏輯器件引言
    Altera于2008年第二季度推出Stratix® IV和HardCopy® IV器件系列標志著(zhù)世界上首款40-nm FPGA和業(yè)界唯一
    40-nm ASIC 無(wú)風(fēng)險移植途徑的誕生。Altera 通過(guò)三年周密的規劃和
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26~40GHz磁調帶通濾波混頻組件研究

  • 1、引言 近年來(lái),隨著(zhù)微波毫米波技術(shù)的飛速發(fā)展,對寬帶微波毫米波測試儀器的提出了更高的要求,頻譜分析儀、噪聲系數分析儀等接收機類(lèi)儀器的工作頻率已經(jīng)拓展到40GHz,本文介紹了一種可以作為前端預選器用于
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40-nm介紹

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